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EEPW首頁 >> 主題列表 >> 硬件加速器

PG26 MCU大容量存儲 + 快速AI/ML推理滿足未來的物聯(lián)網需求

  • Silicon Labs（亦稱“芯科科技”）最新發(fā)布的EFM32PG26（PG26）?32位微控制器（MCU）系列通過提升兩倍的閃存和RAM容量，以及GPIO的數量來滿足各種低功耗和高性能嵌入式物聯(lián)網應用需求。面向無線連接功能的需求，PG26可作為EFR32xG26多協(xié)議無線SoC平臺的軟件兼容MCU版本，有助于開發(fā)人員基于同一平臺設計快速且無縫地升級低功耗藍牙、Matter、Thread、Zigbee或專有無線連接設計。高效的PG26提供80 MHz ARM Cortex-M33內核并支持LC
  • 關鍵字： PG26  MCU  硬件加速器  

基于FPGA/Nios-Ⅱ的矩陣運算硬件加速器設計

  • 針對復雜算法中矩陣運算量大,計算復雜,耗時多,制約算法在線計算性能的問題,從硬件實現角度,研究基于FPGA/Nios-Ⅱ的矩陣運算硬件加速器設計,實現矩陣并行計算。首先根據矩陣運算的算法分析,設計了矩陣并行計算的硬件實現結構,并在Modelsim中進行功能模塊的仿真,然后將功能模塊集成一個自定制組件,并通過Avalon總線與NiosⅡ主處理器通信,作為硬件加速器。最后在FPGA芯片中構建SoPC系統(tǒng),并在Altera DE3開發(fā)板中進行矩陣實時計算測試。測試結果驗證了基于FPGA/Nios-Ⅱ矩陣運算硬件
  • 關鍵字： 硬件加速器  矩陣運算  FPGA  

Intel開發(fā)硬件加速器 AES加解密效率陡升

  • 研究日上，Intel技術人員拿出了一塊特殊的晶圓，聲稱是一種硬件加速器的原型，但卻沒有給出具體說明。其中到底蘊含著什么秘密呢?我們知道，現代
  • 關鍵字： Intel  AES  硬件加速器   

H.264解碼器中CABAC硬件加速器的實現

  • 引言 H.264是由國際電信聯(lián)盟(ITU)和國際標準化組織(ISO)共同制定的新一代視頻編碼標準，該標準采用一系列先進的編碼技術，在編碼效率、網絡適應性等諸多方面都超越了以往的視頻標準。H.264有兩種熵編碼方案：一種是從可變長編碼方案發(fā)展而來的基于上下文的自適應可變長編碼CAVLC；另一種是從算術編碼發(fā)展而來的基于上下文的自適應二進制算術編碼CABAC。與CAVLC相比，CABAC可以節(jié)省約7％的碼流，但增加了10％的計算時間。在解高清碼流時，用軟件來做CABAC這樣復雜的熵解碼，無法完成實時解碼的
  • 關鍵字： H.264  解碼器CABAC  消費電子  硬件加速器  消費電子  
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硬件加速器介紹

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