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EEPW首頁(yè) >> 主題列表 >> 高斯白噪聲

混合同余法產(chǎn)生隨機(jī)噪聲的FPGA實(shí)現(xiàn)

  • 混合同余法產(chǎn)生隨機(jī)噪聲的FPGA實(shí)現(xiàn),摘要：隨著電子對(duì)抗技術(shù)的快速發(fā)展，在有源式干擾機(jī)中需要用到數(shù)字高斯白噪聲。通過對(duì)混合同余法產(chǎn)生隨機(jī)序列的原理研究，本文提出了一種利用FPGA產(chǎn)生高斯白噪聲的方法。該方法在PC主控端的控制下，采用ROM查找表的方
  • 關(guān)鍵字： 高斯白噪聲  混合同余法  FPGA  Verilog HDL  

基于FPGA的高斯白噪聲發(fā)生器設(shè)計(jì)

  • 0 引 言
    現(xiàn)代通訊電子設(shè)備的抗干擾測(cè)試已經(jīng)成為必須的測(cè)試項(xiàng)目，主要的干擾類型為噪聲干擾。在通信信道測(cè)試和電子對(duì)抗領(lǐng)域里，噪聲始終是最基本、最常用的干擾源之一。如何產(chǎn)生穩(wěn)定和精確的噪聲信號(hào)已經(jīng)成為一
  • 關(guān)鍵字： FPGA  高斯白噪聲  發(fā)生器    

用 FPGA 產(chǎn)生高斯白噪聲序列的一種快速方法

  • 0 引言 短波信道存在多徑時(shí)延、多普勒頻移和擴(kuò)散、高斯白噪聲干擾等復(fù)雜現(xiàn)象。為了測(cè)試短波通信設(shè)備的性能，通常需要進(jìn)行大量的外場(chǎng)實(shí)驗(yàn)。相比之下，信道模擬器能夠在實(shí)驗(yàn)室環(huán)境下進(jìn)行類似的性能測(cè)試，而且測(cè)試費(fèi)用
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高斯白噪聲介紹

　　高斯白噪聲：如果一個(gè)噪聲，它的幅度分布服從高斯分布，而它的功率譜密度又是均勻分布的，則稱它為高斯白噪聲。 　　熱噪聲和散粒噪聲是高斯白噪聲。 　　所謂高斯白噪聲中的高斯是指概率分布是正態(tài)函數(shù)，而白噪聲是指它的二階矩不相關(guān)，一階矩為常數(shù)，是指先后信號(hào)在時(shí)間上的相關(guān)性。這是考查一個(gè)信號(hào)的兩個(gè)不同方面的問題。 [ 查看詳細(xì) ]

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