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美高森美新型Libero SoC v11.4軟件改善運(yùn)行時(shí)間高達(dá)35%,顯著提升FPGA設(shè)計(jì)生產(chǎn)率
- 致力于提供功耗、安全、可靠與高性能半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation) 宣布推出最新11.4版本Libero系統(tǒng)級(jí)芯片(SoC)綜合設(shè)計(jì)軟件,用于開發(fā)美高森美最新一代FPGA產(chǎn)品。 美高森美新型Libero SoC v11.4用于獲獎(jiǎng)的SmartFusion2™ SoC FPGA和IGLOO2™ FPGA,改善設(shè)計(jì)流程運(yùn)行時(shí)間多達(dá)35%。新產(chǎn)品還提供了更高的設(shè)計(jì)效率,具有改善的SmartDesign圖形設(shè)計(jì)畫布、改善的文本編
美高森美新型Libero SoC v11.4軟件改善運(yùn)行時(shí)間高達(dá)35%,顯著提升FPGA設(shè)計(jì)生產(chǎn)率
- 致力于提供功耗、安全、可靠與高性能半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation) 宣布推出最新11.4版本Libero系統(tǒng)級(jí)芯片(SoC)綜合設(shè)計(jì)軟件,用于開發(fā)美高森美最新一代FPGA產(chǎn)品。 美高森美新型Libero SoC v11.4用于獲獎(jiǎng)的SmartFusion2™ SoC FPGA和IGLOO2™ FPGA,改善設(shè)計(jì)流程運(yùn)行時(shí)間多達(dá)35%。新產(chǎn)品還提供了更高的設(shè)計(jì)效率,具有改善的SmartDesign圖形設(shè)計(jì)畫布、改善的文本編
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Actel Libero IDE具備全新功率驅(qū)動(dòng)布局和功率分析功能
- Actel Libero IDE具備全新功率驅(qū)動(dòng)布局和功率分析功能,為了擴(kuò)展其業(yè)界領(lǐng)先的專門針對(duì)芯片級(jí)和系統(tǒng)級(jí)節(jié)省功率的解決方案,Actel公司宣布推出全新版本Libero集成設(shè)計(jì)環(huán)境(IDE),具備嶄新的重要功能包括功率驅(qū)動(dòng)布局,使設(shè)計(jì)人員得以進(jìn)一步優(yōu)化設(shè)計(jì),并可減少典型設(shè)計(jì)的動(dòng)態(tài)
- 關(guān)鍵字: 功率 驅(qū)動(dòng) 布局 分析 功能 全新 Libero IDE 具備 Actel
Actel推出LIBERO IDE 8.6版本
- 愛特公司 (Actel Corporation) 宣布推出Libero® 集成開發(fā)環(huán)境 (IDE) 8.6版本,繼續(xù)領(lǐng)跑低功耗設(shè)計(jì)領(lǐng)域。最新版本的Libero IDE為設(shè)計(jì)人員提供了數(shù)項(xiàng)全新功能,包括使用SmartPower工具和布局布線后 (post-layout) 探針插入功能來進(jìn)行器件調(diào)試,提供更強(qiáng)大的功耗分析功能。SmartPower 8.6版本包括全新的設(shè)計(jì)分析算法,無需使用傳統(tǒng)的VCD (Value Change Dump) 文件,便可進(jìn)行快速、精確的功耗分析。此外,全新I/O A
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Actel推出Libero集成開發(fā)環(huán)境 8.4
- Actel公司宣布其Libero® 集成開發(fā)環(huán)境 (IDE) 增添全新的功耗優(yōu)化和增強(qiáng)的設(shè)計(jì)創(chuàng)建功能。全新的Libero IDE 8.4針對(duì)基于 Flash的IGLOO®、IGLOO PLUS和 ProASIC®3L現(xiàn)場(chǎng)可編程門陣列 (FPGA),提供由1.14V至 1.575V的FPGA內(nèi)核工作電壓范圍,為設(shè)計(jì)人員提供額外的內(nèi)核電壓選擇,以實(shí)現(xiàn)更低的功耗。新版本Libero IDE改進(jìn)了SmartPower功耗分析工具,便于比較同一設(shè)計(jì)的多種設(shè)計(jì)實(shí)現(xiàn)和器件不同工作條件下的狀況
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ACTEL針對(duì)低功耗和混合信號(hào)提升LIBERO IDE的性能
- Actel推出最新版本的Libero 集成設(shè)計(jì)環(huán)境 (IDE),為 Actel最新以Flash 為基礎(chǔ)的現(xiàn)場(chǎng)可編程門陣列 (FPGA) 解決方案 – 低功耗IGLOO™ 系列產(chǎn)品,提供全面支持。Libero IDE 7.3同時(shí)具有全新易于使用的功能,協(xié)助設(shè)計(jì)人員運(yùn)用Actel混合信號(hào)Fusion™ 可編程系統(tǒng)芯片 (PSC) 以及低成本Pr
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