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模擬集成電路設(shè)計的九個階段，你到幾段了？

  • 　　這篇文章是來自復(fù)旦大學的博士生的長篇感言，我完整地閱讀了下，覺得寫的很好，忍不住分享下。 　　一段你剛開始進入這行，對PMOS/NMOS/BJT什么的只不過有個大概的了解，各種器件的特性你也不太清楚，具體設(shè)計成什么樣的電路你也沒什么主意，你的電路圖主要看國內(nèi)雜志上的文章，或者按照教科書上現(xiàn)成的電路，你總覺得他們說得都有道理。你做的電路主要是小規(guī)模的模塊，做點差分運放，或者帶隙基準的仿真什么的你就計算著發(fā)文章，生怕到時候論文湊不夠。總的來說，基本上看見運放還是發(fā)怵。你覺得spice是一個非常難以使用而
  • 關(guān)鍵字： 模擬集成電路設(shè)計  PVT  transient仿真  

3.7 GHz寬帶CMOS LC VCO的設(shè)計

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  • 關(guān)鍵字： CMOS  LCVCO  電感  射頻開關(guān)  PVT  鎖相環(huán)  
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