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Silicon Labs推出新型PCI Express緩沖器簡化數(shù)據(jù)中心時鐘設(shè)計

  • 　　為互聯(lián)網(wǎng)基礎(chǔ)設(shè)施提供高性能時鐘解決方案的領(lǐng)導(dǎo)廠商SiliconLabs(芯科實驗室有限公司)今天宣布推出PCIExpress(PCIe)Gen1/2/3扇出緩沖器，此產(chǎn)品為包括服務(wù)器、存儲器和交換機在內(nèi)的數(shù)據(jù)中心應(yīng)用而設(shè)計。針對當(dāng)今領(lǐng)先的x86主板和服務(wù)器系統(tǒng)，新型的Si5310x/11x/019 PCIe緩沖器是業(yè)內(nèi)最高能效的扇出緩沖器，有效擴展了Silicon Labs不斷壯大的PCIe計時產(chǎn)品線。憑借靈活的輸出數(shù)量選項，新型的PCIe緩沖器能夠完整滿足98%的基于x86的服務(wù)器/存儲器主板設(shè)計需
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基于PEX8648交換芯片的數(shù)據(jù)處理模塊設(shè)計

  • 　　0 引言 　　PCI Express是第三代高性能IO總線，在總線結(jié)構(gòu)上采取了根本性的變革，主要體現(xiàn)在兩個方面：一是由并行總線轉(zhuǎn)變?yōu)榇锌偩€;二是采用點到點的互連。將原并行總線結(jié)構(gòu)中橋下面掛連設(shè)備的一條總線變成一條鏈路，一條鏈路可包含一條或多條通路，每條通路由兩對差分信號線組成雙單工的串行傳輸通道，沒有專用的數(shù)據(jù)、地址、控制和時鐘線，總線上各種事務(wù)組成信息包來傳送。點到點的互連方式使得每個設(shè)備由獨立的鏈路連接，獨享帶寬，這是提高傳輸速率的有效解決方案。 　　隨著數(shù)量不斷增長的PCIe處理單元和外設(shè)
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如何優(yōu)化PCIe 應(yīng)用中的時鐘分配

  • 　　PCI Express® (PCIe®) 是一項業(yè)界領(lǐng)先的標(biāo)準(zhǔn)輸入/輸出 (I/O) 技術(shù)，是服務(wù)器、個人電腦以及其它應(yīng)用中最常用的 I/O 接口之一。該標(biāo)準(zhǔn)多年來不斷發(fā)展，以適應(yīng)更高的數(shù)據(jù)速率(見表 1)。第 3 代 PCIe 引入了全新的編碼方案，其可在不增加數(shù)據(jù)速率一倍的情況下，將數(shù)據(jù)吞吐量提升一倍。PCI-SIG 近期宣布推出的第 4 代 PCIe 具有 16 G 每秒傳輸 (GT/s) 的比特率。第 4 代的規(guī)范預(yù)計將在 2014 或 2015 年發(fā)布。 表 1：各代
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一種基于PCI交換的數(shù)據(jù)處理模塊設(shè)計

  • 　　摘要：PCI Express突破傳統(tǒng)總線，采用點到點的互連方式，每個設(shè)備都由獨立的鏈路連接，獨享帶寬，提高傳輸速率。PCIE交換和橋接器提供協(xié)議轉(zhuǎn)換能力為系統(tǒng)間的互連帶來了便捷的解決方案，同時豐富了整個應(yīng)用環(huán)境。本文基于PEX8648交換芯片設(shè)計實現(xiàn)了多PCIE設(shè)備互連的數(shù)據(jù)處理模塊，對其硬件結(jié)構(gòu)及軟件配置方法進行了詳細介紹。 　　0 引言 　　PCI Express是第三代高性能IO總線，在總線結(jié)構(gòu)上采取了根本性的變革，主要體現(xiàn)在兩個方面：一是由并行總線轉(zhuǎn)變?yōu)榇锌偩€;二是采用點到點的互連。將原
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IDT 發(fā)布 1.5 伏特 PCI Express 時鐘緩沖器系列，實現(xiàn)行業(yè)領(lǐng)先的空間和節(jié)能

  • 　　集成元件技術(shù)公司 (IDT®)今天發(fā)布了業(yè)內(nèi)第一個 1.5 伏特 PCI Express (PCIe®) 緩沖器系列，擴展了其領(lǐng)先的 PCIe 時鐘產(chǎn)品組合。 IDT 新的 U 系列超低功率 PCIe 緩沖器運行在與流行的SoC 和現(xiàn)場可編程門陣列 (FPGA) 相同的供給電壓下，使得設(shè)計師能夠使用相同的電源軌，從而降低系統(tǒng)復(fù)雜性、實際大小和功耗。 　　9DBU 緩沖器提供 2 至 9 個輸出配置，可應(yīng)對幾乎任何 PCIe 應(yīng)用，支持非 PLL 扇出和 PLL 零延遲緩沖模式。 　
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一種基于CPCI總線的變頻器電源設(shè)計

  • 　　摘要：基于CPCI結(jié)構(gòu)變頻器若直接采用CPCI機箱內(nèi)部的開關(guān)電源，存在較為嚴重的電磁干擾，為了消除此電磁干擾，文中通過分析基于CPCI結(jié)構(gòu)變頻器的電磁干擾源及切斷干擾源的方法，設(shè)計了一種電源處理方式，通過實際電路的雜散指標(biāo)測試，得出該處理方式可以有效地隔離數(shù)字電路與模擬電路間的電磁干擾，降低開關(guān)電源對變頻器的干擾及其輸出紋波。此外，本設(shè)計可以為其他接收機電源設(shè)計提供參考。 　　CompactPCI簡稱CPCI總線，是“PCI總線工業(yè)計算機制造商組織”推出的一種工業(yè)計算機總線標(biāo)
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Synopsys發(fā)布業(yè)界首款完整的PCI Express 4.0 IP解決方案

  • 　　為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識產(chǎn)權(quán)(IP)及服務(wù)的全球性領(lǐng)先供應(yīng)商新思科技公司(Synopsys, Inc.，納斯達克股票市場代碼：SNPS)日前發(fā)布了業(yè)界首款完整的PCI Express 4.0 IP解決方案，它由DesignWare PHY、控制器和Verification IP(VIP)組成，專門針對諸如服務(wù)器、網(wǎng)絡(luò)設(shè)備、存儲系統(tǒng)以及固態(tài)硬盤(SSD)等企業(yè)級計算應(yīng)用。PCI Express 4.0是PCI Express I/O的下一代標(biāo)準(zhǔn)，其吞吐量增加了一倍至16 GT/s，目前外
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基于FPGA狀態(tài)機和片上總線的CompactPCI異步串口板設(shè)計方案

  • 摘要：首先簡要介紹了CompactPCI異步串口板的通常設(shè)計方法，并且提出了這些方法的不足之處，重點闡述了基于FPGA狀態(tài)機和片上總線的新設(shè)計方案，以及該方案的技術(shù)優(yōu)勢，隨后公布了基于該方案的異步串口板達到的性能指標(biāo)。通過比較有關(guān)應(yīng)答延遲的試驗數(shù)據(jù)，提出了基于FPGA狀態(tài)機和基于DSP處理器的異步串口板卡存在明顯的處理速度差異問題，并基于兩種設(shè)計方案，解釋了形成差異的原因。最后提出了FPGA狀態(tài)機對外部總線存儲器或端口的訪問管理性能大幅超越了任何一款DSP處理器的觀點，并對同行提出了類似研發(fā)項目的設(shè)計建議
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泛華恒興推出帶液晶顯示屏的8槽PXI機箱

  • 　　致力于為各行業(yè)用戶提供高品質(zhì)測試測量解決方案和成套檢測設(shè)備的北京泛華恒興科技有限公司(簡稱：泛華恒興)近日推出了一款帶液晶顯示屏的8槽3U PXI機箱PS PXI-9308。PS PXI-9308符合 PXI 和 CompactPCI 規(guī)范，兼容PXI 和 CompactPCI 模塊，提供1個系統(tǒng)槽和7個PXI外圍卡槽。機箱背板總線信號包括本地總線信號、10MHz 系統(tǒng)參考時鐘、觸發(fā)總線、星形觸發(fā)、局部總線等。該機箱配備電源可輸出最大功率為500W，為搭建有效的測試測量系統(tǒng)提供可靠保障?！　XI-9
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Imagination與Express合作擴大ThreadX RTOS的進一步支持

  • Imagination Technologies (IMG.L) 和 Express Logic 近日宣布，已擴展 Express Logic 廣受歡迎的 ThreadX? RTOS (實時操作系統(tǒng)) 對 Imagination MIPS CPU 的支持。采用 MIPS interAptiv CPU 后，進一步延伸了 ThreadX 對各代 MIPS CPU 的支持，從深度嵌入式內(nèi)核到高性能應(yīng)用處理器均涵蓋在內(nèi)。
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PCI Express實驗開發(fā)平臺與IP

  • 自從2004年P(guān)CI-E 1.0a規(guī)范之后，主板上就開始有了最新的串行高速PCI-E總線，相比原來的PCI V2.3，PCI-E總線有很大 ...
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利用WinDriver實現(xiàn)鏈?zhǔn)紻MA

  • 利用WinDriver實現(xiàn)鏈?zhǔn)紻MA,摘要：PCI Express協(xié)議由于其高速串行、系統(tǒng)拓撲簡單等特點被廣泛用于各種領(lǐng)域。Altera公司的Arria II GX FPGA內(nèi)集成了支持鏈?zhǔn)紻MA傳輸功能的PCI Express硬核，適應(yīng)了PCI Express總線高速度的要求。文中利用Jungo公司
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Silicon Labs推出節(jié)能的PCI Express時鐘

  • 　　Silicon Labs (芯科實驗室有限公司)宣布推出新型1路和2路輸出PCI Express(PCIe)時鐘發(fā)生器，該PCIe時鐘發(fā)生器具有業(yè)界最小封裝和最低功耗，進一步擴展其在業(yè)界領(lǐng)先的PCIe時鐘解決方案。Si52111和Si52112時鐘發(fā)生器IC完全滿足PCIe Gen 1/2/3標(biāo)準(zhǔn)的嚴格要求，特別針對注重電路板空間、功耗和系統(tǒng)成本敏感型的批量消費類、嵌入式、通信和企業(yè)級應(yīng)用而設(shè)計。 　　Silicon Labs公司Si5211x時鐘發(fā)生器適用于空間受限、對功耗敏感，以及需要工業(yè)標(biāo)準(zhǔn)P
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基于Virtex-6的PCI Express高速采集卡設(shè)計

  • 為了提高數(shù)據(jù)采集速率，適應(yīng)大數(shù)據(jù)量交互處理要求，介紹了一種應(yīng)用Virtex-6芯片的PCI Express高速采集卡設(shè)計。Virtex-6內(nèi)嵌PCIE協(xié)議硬核能完成完整的PCIE分層協(xié)議，實現(xiàn)與上位機通信。設(shè)計了DMA控制器，作為采集卡數(shù)據(jù)傳輸主控，實現(xiàn)基于PCI Express總線的DMA高速數(shù)據(jù)傳輸方案。主機軟件系統(tǒng)包括驅(qū)動程序和應(yīng)用軟件2部分。經(jīng)實驗測試，該采集卡能完成時外部高速數(shù)據(jù)的實時采集，性能穩(wěn)定可靠。
  • 關(guān)鍵字： Express  Virtex  PCI  高速采集    

借助SC Express減少結(jié)構(gòu)化測試次數(shù)

  • 對飛機、火車、軍用車輛和土建結(jié)構(gòu)等大型復(fù)雜的結(jié)構(gòu)進行測試對于確保這些結(jié)構(gòu)的安全性和高性能至關(guān)重要。這些測試通常是生產(chǎn)的一大難題。要確保設(shè)計按時間進度進行，必須正確配置和執(zhí)行測試，且數(shù)據(jù)采集系統(tǒng)提供的數(shù)據(jù)對設(shè)計團隊來說精確、可靠和及時。
  • 關(guān)鍵字： NI  結(jié)構(gòu)化測試  Express  
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