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基于Verilog簡易UART的FPGA/CPLD實(shí)現(xiàn)

  • 基于Verilog簡易UART的FPGA/CPLD實(shí)現(xiàn),目標(biāo)：在xo640上實(shí)現(xiàn)一個(gè)簡單的Uart，能夠解析串口數(shù)據(jù)，并在寄存器中存儲(chǔ)，用FIFO實(shí)現(xiàn)數(shù)據(jù)的傳遞。那么后期可以通過開發(fā)板上的串口經(jīng)CPLD訪問各種數(shù)據(jù)。比如PC=CPLD=EEPROM等等，極大方便后期的開發(fā)和調(diào)試。
  • 關(guān)鍵字： FPGA/CPLD  實(shí)現(xiàn)  UART  簡易  Verilog  基于  

基于CPLD和嵌入式系統(tǒng)的LED點(diǎn)陣顯示

  • 基于CPLD和嵌入式系統(tǒng)的LED點(diǎn)陣顯示,采用自頂向下的設(shè)計(jì)思想，綜合運(yùn)用EDA 技術(shù)、CPLD技術(shù)和共享式雙口RAM，解決了大屏幕LED點(diǎn)陣顯示屏無閃爍顯示的技術(shù)難題。給出了系統(tǒng)設(shè)計(jì)方法及實(shí)際電路。
  • 關(guān)鍵字： 點(diǎn)陣  顯示  LED  系統(tǒng)  CPLD  嵌入式  基于  

基于CPLD／FPGA的多串口設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要：在工業(yè)控制中如何提高一對多的串口通訊可靠性和系統(tǒng)的集成性成為研究熱點(diǎn)。本文利用嵌入式技術(shù)，提出基于CPLD／FPGA的多串口擴(kuò)展設(shè)計(jì)方案。實(shí)現(xiàn)并行口到多個(gè)全雙工異步通訊口之間的轉(zhuǎn)換，并根據(jù)嵌入式系統(tǒng)實(shí)時(shí)
  • 關(guān)鍵字： CPLD  FPGA  多串口    

采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計(jì)方法

  • 采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計(jì)方法,采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計(jì)方法搭建一種低成本的嵌入式視覺系統(tǒng)，系統(tǒng)由CMOS圖像傳感器、CPLD、ARM7微處理器以及SRAM構(gòu)成。其中，CPLD識別時(shí)序，解決了圖像采集系統(tǒng)存在的嚴(yán)格時(shí)序同步和雙CPU共享一片SRAM的總
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基于Matlab/Simulink的滑模軟起動(dòng)器仿真研究

PROFIBUS DP總線I/O設(shè)備的開發(fā)研究

  • 總線I/O是現(xiàn)場總線遠(yuǎn)程I/O的簡稱，是基于現(xiàn)場總線控制系統(tǒng)FCS中的主要設(shè)備，PROFIBUS-DP是總線I/O的主流通信協(xié)議。一個(gè)總線I/O設(shè)備可能需要多種總線接口，對于設(shè)備的開發(fā)人員來講，他們專注于設(shè)備功能單元的核心技
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基于CPLD的USB總線的隔離接口實(shí)現(xiàn)

  • 本設(shè)計(jì)的主要?jiǎng)?chuàng)新點(diǎn)在于 USB總線的協(xié)議的復(fù)雜性和快速性為設(shè)計(jì)實(shí)現(xiàn)必須面對許多的挑戰(zhàn)，能在分析協(xié)議的基礎(chǔ)上利用 CPLD解決了 USB總線隔離的問題，巧妙的檢測信息包起始、快切換和包結(jié)束的難題，克服了傳輸信息包結(jié)束慢上拉與過渡，保證系統(tǒng)的完整性。
  • 關(guān)鍵字： CPLD  USB  總線  隔離接口    

基于CPLD和Embedded System的LED點(diǎn)陣顯示

  • 基于CPLD和Embedded System的LED點(diǎn)陣顯示,摘要：采用自頂向下的設(shè)計(jì)思想，綜合運(yùn)用EDA 技術(shù)、CPLD技術(shù)和共享式雙口RAM，解決了大屏幕LED點(diǎn)陣顯示屏無閃爍顯示的技術(shù)難題。給出了系統(tǒng)設(shè)計(jì)方法及實(shí)際電路。LED點(diǎn)陣顯示屏是顯示公共信息的一種重要顯示終端，其中
  • 關(guān)鍵字： 點(diǎn)陣  顯示  LED  System  CPLD  Embedded  基于  

CPLD在線纜快速測試技術(shù)中的應(yīng)用

  • 1.引言隨著電子技術(shù)的發(fā)展，復(fù)雜可編程邏輯器件CPLD（ComplexProgrammableLogicDevice）以其高速、高...
  • 關(guān)鍵字： CPLD  線纜快速測試  

基于CPLD的視頻疊加

  • 上個(gè)月接到任務(wù)，要求設(shè)計(jì)一視頻鉆孔機(jī)，用攝像頭檢測孔位，腳踏開關(guān)控制電機(jī)鉆孔。由于要對準(zhǔn)孔位，因此顯示器上要...
  • 關(guān)鍵字： LM1881  CPLD  電視  

基于CPLD/FPGA高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

  • 0引言傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)一般采用單片機(jī)，系統(tǒng)大多通過PCI總線完成數(shù)據(jù)的傳輸。其缺點(diǎn)是數(shù)學(xué)運(yùn)算能力差...
  • 關(guān)鍵字： CPLD  FPGA  數(shù)據(jù)采集系統(tǒng)  

基于DSP與CPLD的多通道數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

  • 基于DSP與CPLD的多通道數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì),用于實(shí)時(shí)控制系統(tǒng)的嵌入式系統(tǒng)經(jīng)常需要對模擬量進(jìn)行測量，通常的方法是以MCU為主產(chǎn)生采集控制時(shí)序控制模數(shù)轉(zhuǎn)換器，并通過中斷或查詢的方式讀取轉(zhuǎn)換后的結(jié)果。由MCU產(chǎn)生采集控制時(shí)序?qū)⒄加幂^多的系統(tǒng)軟硬件資源。而在
  • 關(guān)鍵字： 系統(tǒng)  設(shè)計(jì)  數(shù)據(jù)采集  通道  DSP  CPLD  基于  

基于DSP的視頻采集存儲(chǔ)系統(tǒng)的研究與設(shè)計(jì)

  • 數(shù)字圖象處理技術(shù)在電子通信與信息處理領(lǐng)域得到了廣泛的應(yīng)用，設(shè)計(jì)一種功能靈活、使用方便、便于嵌入到系統(tǒng)中...
  • 關(guān)鍵字： 視頻監(jiān)控  圖像信號采集  CPLD  

基于DSP+CPLD的智能IED設(shè)計(jì)

  • 基于DSP+CPLD的智能IED設(shè)計(jì),本文的設(shè)計(jì)師基于DSP和CPLD搭建的智能IED(Intelligent Electronic Device，智能電力監(jiān)測裝置)可以同時(shí)采集多路信號，并通過FFT算法得到電網(wǎng)運(yùn)行的關(guān)鍵數(shù)據(jù)。　　基于IEC61850的智能變電站的邏輯如圖1所示。IEC61850協(xié)
  • 關(guān)鍵字： IED  設(shè)計(jì)  智能  CPLD  DSP  基于  

基于CPLD系統(tǒng)的信號發(fā)生器設(shè)計(jì)

  • 摘要：文中采用Quartus II開發(fā)平臺，基于可編程邏輯器件CPLD設(shè)計(jì)出多波形信號發(fā)生器，可輸出頻率、幅度可調(diào)的三角波、正弦波和方波。任意波形模塊可由用戶輸出用戶所需的特殊波形，滿足了教學(xué)實(shí)驗(yàn)和開發(fā)新的實(shí)驗(yàn)項(xiàng)目
  • 關(guān)鍵字： CPLD  系統(tǒng)  信號發(fā)生器    
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