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精確綜合：下一代FPGA綜合平臺(tái)

概述電子系統(tǒng)設(shè)計(jì)正在發(fā)生著重要的轉(zhuǎn)變?？删幊踢壿嬈骷乖O(shè)計(jì)者可以開(kāi)發(fā)具有千萬(wàn)門以上、頻率超過(guò)300MHz以及嵌入式處理器的電路，能夠集成完整的系統(tǒng)。這一技術(shù)進(jìn)步通過(guò)提供ASIC領(lǐng)域之外的全面的方法，正在引起設(shè)計(jì)過(guò)程的轉(zhuǎn)變。在迅速變化的可編程邏輯領(lǐng)域，EDA提供商面臨的挑戰(zhàn)是，如何提供與硅容量和復(fù)雜性同步的設(shè)計(jì)工具和方法。例如，ASIC領(lǐng)域用了15年來(lái)合并硅處理和基于可靠的功能性EDA軟件的設(shè)計(jì)方法。這種ASIC技術(shù)曾經(jīng)是工業(yè)領(lǐng)域的驅(qū)動(dòng)力和發(fā)展方向。可以說(shuō)ASIC處理造就了電子工業(yè)廉價(jià)的方案，導(dǎo)
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基于TMS320C5402的數(shù)字壓縮語(yǔ)音錄放系統(tǒng)

電子設(shè)計(jì)應(yīng)用2004年第9期摘要：本文選用TMS320C5402作為DSP芯片，單片機(jī)選用AT89C51，設(shè)計(jì)了一個(gè)主從式數(shù)字壓縮語(yǔ)音錄放系統(tǒng)，用來(lái)實(shí)現(xiàn)語(yǔ)音數(shù)字錄音和播放的功能。關(guān)鍵詞：DSP；AT89C51；主從式；語(yǔ)音錄放系統(tǒng)簡(jiǎn)介本系統(tǒng)的主要功能是通過(guò)對(duì)語(yǔ)音信號(hào)進(jìn)行壓縮，以實(shí)現(xiàn)高效率數(shù)字錄音，可用于電話留言，語(yǔ)聲應(yīng)答等場(chǎng)合。采用磁帶錄音實(shí)現(xiàn)電話留言，雖然錄音的時(shí)間較長(zhǎng)，但不便于查找和保存。數(shù)字錄音可以克服磁帶錄音的缺點(diǎn)，不僅查找速度快，而且對(duì)錄音信息進(jìn)行編輯整理也
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GPIB接口的FPGA實(shí)現(xiàn)

電子設(shè)計(jì)應(yīng)用2004年第10期摘要：GPIB接口是測(cè)試儀器中常用的接口方式。通過(guò)將接口設(shè)計(jì)分解為同步狀態(tài)機(jī)設(shè)計(jì)和寄存器讀寫電路設(shè)計(jì)，采用Verilog語(yǔ)言實(shí)現(xiàn)了滿足IEEE488.1協(xié)議的IP Core設(shè)計(jì)。將此IP Core固化到FPGA芯片中即可實(shí)現(xiàn)GPIB各種接口功能。關(guān)鍵詞：GPIB接口；狀態(tài)機(jī)；FPGA引言在自動(dòng)測(cè)試領(lǐng)域中，GPIB通用接口是測(cè)試儀器常用的接口方式，具有一定的優(yōu)勢(shì)。通過(guò)GPIB組建自動(dòng)測(cè)試系統(tǒng)方便且費(fèi)用低廉。而GPIB控制芯片是自動(dòng)測(cè)試系統(tǒng)中
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實(shí)現(xiàn)FPGA與PC的串行通信

電子設(shè)計(jì)應(yīng)用2004年第10期摘要：本文主要介紹了基于FPGA技術(shù)實(shí)現(xiàn)與PC串行通信的過(guò)程，給出了各個(gè)模塊的具體實(shí)現(xiàn)方法，分析了實(shí)現(xiàn)結(jié)果，驗(yàn)證了串行通信的正確性。關(guān)鍵詞：串行通信；FPGA引言串行通信即串行數(shù)據(jù)傳輸，實(shí)現(xiàn)FPGA與PC的串行通信在實(shí)際中，特別是在FPGA的調(diào)試中有著很重要的應(yīng)用。調(diào)試過(guò)程一般是先進(jìn)行軟件編程仿真，然后將程序下載到芯片中驗(yàn)證設(shè)計(jì)的正確性，目前還沒(méi)有更好的工具可以在下載后實(shí)時(shí)地對(duì)FPGA的工作情況和數(shù)據(jù)進(jìn)行分析。通過(guò)串行通信，可以向FPGA
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應(yīng)用SoPC Builder開(kāi)發(fā)電子系統(tǒng)

電子設(shè)計(jì)應(yīng)用2004年第9期摘要：本文從系統(tǒng)總線設(shè)計(jì)、用戶自定義指令和FPGA協(xié)處理器的應(yīng)用這三個(gè)方面詳細(xì)介紹了如何應(yīng)用SoPC設(shè)計(jì)思想和SoPC Builder工具來(lái)開(kāi)發(fā)電子系統(tǒng)。通過(guò)應(yīng)用SoPC Builder開(kāi)發(fā)工具，設(shè)計(jì)者可以擺脫傳統(tǒng)的、易于出錯(cuò)的軟硬件設(shè)計(jì)細(xì)節(jié)，從而達(dá)到加快項(xiàng)目開(kāi)發(fā)、縮短開(kāi)發(fā)周期、節(jié)約開(kāi)發(fā)成本的目的。關(guān)鍵詞：SoPC；SoPC Builder；FPGA引言隨著技術(shù)的進(jìn)一步發(fā)展，SoC設(shè)計(jì)面臨著一些諸如如何進(jìn)行軟硬件協(xié)同設(shè)計(jì)，如何縮短電子產(chǎn)品開(kāi)
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DSP的特點(diǎn)、發(fā)展趨勢(shì)與應(yīng)用

2004年5月A版　　數(shù)字化技術(shù)正在極大地改變著我們的生活和體驗(yàn)。作為數(shù)字化技術(shù)的基石，數(shù)字信號(hào)處理(DSP)技術(shù)已經(jīng)、正在、并且還將在其中扮演一個(gè)不可或缺的角色。DSP的核心是算法與實(shí)現(xiàn)，越來(lái)越多的人正在認(rèn)識(shí)、熟悉和使用它。因此，理性地評(píng)價(jià)DSP器件的優(yōu)缺點(diǎn)，及時(shí)了解DSP的現(xiàn)狀以及發(fā)展趨勢(shì)，正確使用DSP芯片，才有可能真正發(fā)揮出DSP的作用。 DSP器件與算法　　DSP(數(shù)字信號(hào)處理器)作為一種微處理器，其設(shè)計(jì)的出發(fā)點(diǎn)和通用CPU以及MCU等處理器是不同的。DSP是為完成實(shí)時(shí)數(shù)字信號(hào)處理任務(wù)
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DSP內(nèi)核—VLIW與SIMD珠聯(lián)璧合

2004年5月A版　　DSP 在手機(jī)、音樂(lè)播放器和其他消費(fèi)品中的應(yīng)用，直接關(guān)系著系統(tǒng)的功能與價(jià)格。在適當(dāng)?shù)膬r(jià)位上，DSP 必需提供足夠的功能滿足當(dāng)前需求，并且有充裕的可擴(kuò)展性和空間，以便設(shè)計(jì)人員對(duì)硬件無(wú)需大動(dòng)干戈，便能為系統(tǒng)添加新功能或強(qiáng)化現(xiàn)有功能。　　當(dāng)傳送遠(yuǎn)遠(yuǎn)超過(guò)競(jìng)爭(zhēng)性的 DSP 引擎級(jí)別的功能時(shí)，CEVA-X DSP 內(nèi)核架構(gòu)也符合這些需求。CEVA 公司前身為 Parthus-Ceva，他們把單指令/多數(shù)據(jù)(SIMD)和超長(zhǎng)指令字(VLIW)兩套方案組合成最佳環(huán)境，使性能發(fā)揮到極致。VLI
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汽車電子類MCU/DSP器件及應(yīng)用

2004年8月B版　　MM908E624/25系列單片機(jī)主要是為汽車和工業(yè)控制而設(shè)計(jì)。它們都是由高性能的HC08單片機(jī)(MCU)核和SmartMOS集成電路芯片構(gòu)成，具有集成度高、價(jià)格低等特點(diǎn)。　　該系列單片機(jī)所帶的HC08單片機(jī)核基本都是一樣的，都包括16K字節(jié)的片上flash存儲(chǔ)器，512字節(jié)的RAM，兩個(gè)16位2通道的定時(shí)器，增強(qiáng)型串行通訊接口(ESCI)，10位精度的模數(shù)轉(zhuǎn)換器(ADC)，串行外設(shè)接口(SPI)和16個(gè)單片機(jī)通用I/O口。　　但二者內(nèi)部的SmartMOS集成電路部分略有
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智能儀表類MCU/DSP

2004年5月B版引言　　儀器儀表是常見(jiàn)的MCU應(yīng)用場(chǎng)合，通常需要擔(dān)任控制器的MCU/DSP具有有效的輸入接口、快捷的數(shù)據(jù)處理能力、豐富的輸出接口、較低的電源功耗： Freescale為該類應(yīng)用特別設(shè)計(jì)了多款合適的微控制器。　　MC9S08GB32和68HC08LK24都是HCS08家族成員。HCS08家族是HC08系列單片機(jī)的升級(jí)產(chǎn)品，使用了增強(qiáng)的HCS08內(nèi)核和多種外圍功能模塊，更低的工作電壓、業(yè)界領(lǐng)先的FLASH存儲(chǔ)技術(shù)和無(wú)與倫比的開(kāi)發(fā)工具支持。 MC68HC908LK24結(jié)構(gòu)特點(diǎn)
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利用DSP智能電機(jī)控制提高能量效率

　　目前，工業(yè)用電的三分之二為電機(jī)所消耗，而在居民用電中這一比例亦高達(dá)四分之一，有鑒于此，電機(jī)的效率問(wèn)題繼續(xù)受到更大的關(guān)注。標(biāo)準(zhǔn)的電機(jī)應(yīng)用完全能以更高的能量效率運(yùn)行，就電能到機(jī)械能的轉(zhuǎn)換而言，大多數(shù)電機(jī)的效率較低。這意味著它們浪費(fèi)了大量的能量，以發(fā)熱的形式散失掉，而未能變換為有用的機(jī)械能。　　此外，既然一個(gè)未受控制的電機(jī)必須克服瞬態(tài)機(jī)械負(fù)載的影響，設(shè)計(jì)者除了加大電機(jī)尺寸外很難作出其它的選擇，而一個(gè)尺寸過(guò)大的AC感應(yīng)電機(jī)(最常用的電機(jī)類型)，其效率必然更低，因?yàn)殡姍C(jī)是在小于其設(shè)計(jì)負(fù)載的條件下工作。提
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基于FPGA的誤碼測(cè)試儀

2004年4月A版摘要：本文提出了一種基于FPGA的誤碼測(cè)試方案，并在FPGA上實(shí)現(xiàn)了其功能。該方案不僅納入了“同步保護(hù)”的思想，同時(shí)對(duì)誤碼率量級(jí)的判斷也提出了一種簡(jiǎn)化而又可行的方法。關(guān)鍵詞：誤碼測(cè)試；FPGA；m序列；同步　　在數(shù)字通信系統(tǒng)中，為了檢測(cè)系統(tǒng)的性能，通常使用誤碼分析儀對(duì)其誤碼性能進(jìn)行測(cè)量。誤碼分析儀給工程實(shí)際應(yīng)用帶來(lái)了極大的便利，比如它有豐富的測(cè)試接口和測(cè)試內(nèi)容，并能將結(jié)果直觀、準(zhǔn)確的顯示出來(lái)。但是它的價(jià)格昂貴，并且通常需要另加外部輔助長(zhǎng)線驅(qū)動(dòng)電路才能與某些系統(tǒng)接
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2004年，賽靈思成立20周年慶典

　　2004年，賽靈思成立20周年慶典。通過(guò)表彰員工、用戶、股東、合作伙伴和當(dāng)?shù)厣鐓^(qū)，公司慶祝了它的20歲生日。
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基于DSP的自適應(yīng)數(shù)字抗噪聲模塊

摘要：本文介紹了一種基于專用DSP芯片，采用獨(dú)特的軟件抗噪聲算法的數(shù)字抗噪聲模塊，實(shí)現(xiàn)了在120分貝噪聲環(huán)境中話音的清晰度不小于98。此模塊已成功應(yīng)用于我國(guó)機(jī)載通信設(shè)備中。關(guān)鍵詞：數(shù)字信號(hào)處理(DSP)；噪聲概述國(guó)內(nèi)目前第三代抗噪聲產(chǎn)品是利用動(dòng)態(tài)降噪(DNR)技術(shù)。DNR技術(shù)是通過(guò)變化的話音峰值動(dòng)態(tài)地調(diào)節(jié)輸出話音開(kāi)關(guān)，從而達(dá)到降噪的目的。它雖然是目前較好的一種抗噪聲模擬處理技術(shù)，但也存在一些局限性，包括輕符音掉字和強(qiáng)音噪聲拖尾；降噪效果偏重于低頻；降噪完全采用硬件電路實(shí)現(xiàn)，調(diào)試和維修比較麻煩等
關(guān)鍵字：數(shù)字信號(hào)處理(DSP) 噪聲模塊

橢圓曲線加密的硬件實(shí)現(xiàn)

摘要：橢圓曲線加密是一種目前已知的所有公鑰密碼體制中能夠提供最高比特強(qiáng)度的一種公鑰體制。在FPGA實(shí)現(xiàn)橢圓曲線加密系統(tǒng)時(shí)，基于GF(2)的多項(xiàng)式有限域中的乘法、求逆運(yùn)算是其中的兩大難點(diǎn)。本文提供了一種橢圓曲線加密的FPGA實(shí)現(xiàn)的結(jié)構(gòu)，著重討論了基于GF(2)的多項(xiàng)式有限域中的乘法、求逆運(yùn)算的實(shí)現(xiàn)，并與軟件實(shí)現(xiàn)的性能進(jìn)行了比較。關(guān)鍵詞： FPGA；多項(xiàng)式有限域；橢圓曲線加密系統(tǒng)加密的安全性從數(shù)論的角度來(lái)說(shuō)，任何公鑰密碼系統(tǒng)都建立在一個(gè)NP(無(wú)法處理的問(wèn)題)的基礎(chǔ)上，即對(duì)于特定的問(wèn)題，沒(méi)有辦法找到一個(gè)
關(guān)鍵字： FPGA 多項(xiàng)式有限域橢圓曲線加密系統(tǒng)

WCDMA速率適配算法的FPGA實(shí)現(xiàn)

摘要：為了支持多媒體業(yè)務(wù)的傳輸，第三代移動(dòng)通信WCDMA系統(tǒng)采用了獨(dú)特的編碼復(fù)接方案，同時(shí)也加大了系統(tǒng)復(fù)雜度，并引入了較長(zhǎng)的處理時(shí)延。速率適配算法是業(yè)務(wù)復(fù)用方案的核心算法。本文具體提出了在FPGA中進(jìn)行模塊合并、產(chǎn)生鑿孔圖樣進(jìn)行比特積攢搬移的實(shí)現(xiàn)方案，縮短了處理延時(shí)，大大提高了系統(tǒng)的處理能力。關(guān)鍵詞：編碼復(fù)接；速率適配；FPGA；鑿孔圖樣；保留比特搬移引言隨著因特網(wǎng)爆炸性的增長(zhǎng)以及各種無(wú)線業(yè)務(wù)需求的增加，傳統(tǒng)的無(wú)線通信網(wǎng)已經(jīng)越來(lái)越無(wú)法適應(yīng)人們的需要。因此，以大容量、高數(shù)據(jù)率和承載多媒體業(yè)務(wù)為目的的
關(guān)鍵字： FPGA 保留比特搬移編碼復(fù)接速率適配鑿孔圖樣