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無線基站中的FPGA和DSP組合(07-100)

  • 　　FPGA和DSP之間的“智能配分”可使無線系統(tǒng)設(shè)計(jì)師獲得最佳性能組合和成本——效能。應(yīng)用DSP和FPGA組合可使成本降低。對于無線基站，組合有DSP可編程邏輯的系統(tǒng)配分，可促使更大的產(chǎn)品設(shè)計(jì)和市場成功率。
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基于模糊控制的遲早門同步器及其FPGA實(shí)現(xiàn)

  • 在數(shù)字通信系統(tǒng)中,必須以符號速率對解調(diào)器的輸出進(jìn)行周期性地采樣.為此,接收器需要一個采樣時鐘信號,這個時鐘信號的頻率和符號速率相等,相位則必須保證采樣時刻是最佳的.在接收器中獲得這個采樣時鐘的過程被稱為符號
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如何發(fā)現(xiàn)并解決FPGA設(shè)計(jì)中的時序問題

  • 耗費(fèi)數(shù)月精力做出的設(shè)計(jì)卻無法滿足時序要求，這確實(shí)非常令人傷心。然而，試圖正確地對設(shè)計(jì)進(jìn)行約束以保證滿足時序要求的過程幾乎同樣令人費(fèi)神。找到并確定時序約束本身通常也是非常令人頭痛的問題。時序問題的惱人之
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PCB版圖設(shè)計(jì)DD基于高速FPGA的PCB設(shè)計(jì)技術(shù)

  • 如果高速PCB設(shè)計(jì)能夠像連接原理圖節(jié)點(diǎn)那樣簡單，以及像在計(jì)算機(jī)顯示器上所看到的那樣優(yōu)美的話，那將是一件多么美好的事情。然而，除非設(shè)計(jì)師初入PCB設(shè)計(jì)，或者是極度的幸運(yùn)，實(shí)際的PCB設(shè)計(jì)通常不像他們所從事的電路設(shè)
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基于FPGA的防盜定位追蹤系統(tǒng)(08-100)

  • 　　雖然現(xiàn)在市面上有很多類似的基于GPS的防盜系統(tǒng)，但并不能很好地實(shí)現(xiàn)防盜和丟失后找回功能。本作品利用Spartan-3E開發(fā)板彌補(bǔ)了以上缺陷。系統(tǒng)由防盜目標(biāo)終端和尋找指引終端組成。兩終端均基于FPGA設(shè)計(jì)實(shí)現(xiàn)。當(dāng)裝有防盜目標(biāo)終端的物品丟失后，防盜目標(biāo)終端將其所在經(jīng)緯度位置信息加密并發(fā)送給尋找指引終端，指引終端解密該信息并計(jì)算出與目標(biāo)終端的相對位置并通知用戶,從而最大限度地幫助人們找回丟失的物品的同時也保證了傳送信息的安全。
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高可靠FPGA通信系統(tǒng)(08-100)

  • 本作品主要目的在于針對ZigBee無線傳感器網(wǎng)絡(luò)中中心節(jié)點(diǎn)到控制中心的信息通信過程中存在的信息泄露和安全隱患，自行設(shè)計(jì)一套可移動基于FPGA平臺的高可靠通信系統(tǒng)。在獨(dú)立開發(fā)的基于CC2430芯片的無線傳感器星型網(wǎng)絡(luò)中，無線網(wǎng)絡(luò)節(jié)點(diǎn)與Spartan平臺進(jìn)行信息交互，其中端到端的數(shù)據(jù)傳輸均實(shí)現(xiàn)AES加密。中心節(jié)點(diǎn)的服務(wù)器對有線網(wǎng)絡(luò)進(jìn)行實(shí)時安全監(jiān)測，當(dāng)網(wǎng)絡(luò)中存在危險情況時通過GSM報警，由此實(shí)現(xiàn)了高可靠的網(wǎng)絡(luò)通信保障環(huán)境。
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40nm FPGA搶灘登陸 ASIC尚能飯否

  • ??????? “我們新的管理團(tuán)隊(duì)大部分人來自ASIC公司?！痹赬ilinx二十五周年慶典之時，Xilinx全球副總裁湯立人風(fēng)趣的說道，“他們也是因?yàn)榭吹搅薃SIC已達(dá)到局限性，因此決定‘棄暗投明’了?！? ????????繼Altera于2008年底發(fā)布了首款基于40-nm技術(shù)的FPG
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高可靠FPGA通信系統(tǒng)

  • 1 系統(tǒng)設(shè)計(jì)　　在工業(yè)控制領(lǐng)域，利用ZigBee和傳感器網(wǎng)絡(luò)，使得數(shù)據(jù)的自動采集、分析和處理變得更加容易，作為決策輔助系統(tǒng)的重要組成部分，ZigBee無線傳感器網(wǎng)絡(luò)在無線數(shù)據(jù)采集及監(jiān)控等領(lǐng)域得到了廣泛應(yīng)用。無線傳感
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基于FPGA的數(shù)字解擴(kuò)解調(diào)模塊設(shè)計(jì)及實(shí)現(xiàn)

  • 1引 言擴(kuò)頻通信系統(tǒng)是將基帶信號的頻譜擴(kuò)展到很寬的頻帶上，然后進(jìn)行傳輸，通過增大頻帶寬度來提高信噪比的一種系統(tǒng)。由于擴(kuò)頻系統(tǒng)具有抗干擾能力強(qiáng)、保密性高、截獲概率低、多址復(fù)用和任意選址等優(yōu)點(diǎn)，在移動通信等
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用內(nèi)部邏輯分析儀調(diào)試FPGA(08-100)

  • 　　進(jìn)行硬件設(shè)計(jì)的功能調(diào)試時，F(xiàn)PGA的再編程能力是關(guān)鍵的優(yōu)點(diǎn)。CPLD和FPGA早期使用時，如果發(fā)現(xiàn)設(shè)計(jì)不能正常工作，工程師就使用“調(diào)試鉤”的方法。先將要觀察的FPGA內(nèi)部信號引到引腳，然后用外部的邏輯分析儀捕獲數(shù)據(jù)。然而當(dāng)設(shè)計(jì)的復(fù)雜程度增加時，這個方法就不再適合了，其中有幾個原因。第一是由于FPGA的功能增加了，而器件的引腳數(shù)目卻緩慢地增長。因此，可用邏輯對I/O的比率減小了，參見圖1。此外，設(shè)計(jì)很復(fù)雜時，通常完成設(shè)計(jì)后只有幾個空余的引腳，或者根本就沒有空余的引腳能用于調(diào)試。
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提升創(chuàng)造力的數(shù)字設(shè)計(jì)工具：FPGA Editor(08-100)

  • 　　工程師在設(shè)計(jì)過程中，經(jīng)常需要一定的創(chuàng)造力(不妨稱之為數(shù)字管道膠帶)才能夠保證設(shè)計(jì)的順利完成。過去8年時間里，我曾經(jīng)目睹許多優(yōu)秀工程師利用這一方法出色地完成了許多工作，而他們采用的最主要工具就是FPGA Editor。
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克服FPGA I/O引腳分配挑戰(zhàn)(08-100)

  • 　　對于需要在PCB板上使用大規(guī)模FPGA器件的設(shè)計(jì)人員來說，I/O引腳分配是必須面對的眾多挑戰(zhàn)之一。 由于眾多原因，許多設(shè)計(jì)人員發(fā)表為大型FPGA器件和高級BGA封裝確定I/O引腳配置或布局方案越來越困難。 但是組合運(yùn)用多種智能I/O規(guī)劃工具，能夠使引腳分配過程變得更輕松。
  • 關(guān)鍵字： Xilinx  FPGA  I/O引腳  

用FPGA實(shí)現(xiàn)FIR濾波器(08-100)

  • 　　你接到要求用FPGA實(shí)現(xiàn)FIR濾波器的任務(wù)時，也許會想起在學(xué)校里所學(xué)的FIR基礎(chǔ)知識，但是下一步該做什么呢?哪些參數(shù)是重要的?做這個設(shè)計(jì)的最佳方法是什么?還有這個設(shè)計(jì)應(yīng)該怎樣在FPGA中實(shí)現(xiàn)?現(xiàn)在有大量的低成本IP核和工具來幫助你進(jìn)行設(shè)計(jì)，因?yàn)镕IR是用FPGA實(shí)現(xiàn)的最普通的功能。
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為FPGA軟處理器選擇操作系統(tǒng)(08-100)

  • 　　操作系統(tǒng)能夠提高可移植性，并提供多種經(jīng)過測試的抽象層，服務(wù)層和應(yīng)用模塊層以供選擇，從而加快產(chǎn)品上市時間并減少應(yīng)用程序出錯的可能性。然而，選擇一個嵌入式操作系統(tǒng)( OS )從來就不是一個簡單的過程，因?yàn)榧汕度胧杰浖姆绞竭x擇余地很大，你可以完全都由自己來編寫，或通過商業(yè)定制專門實(shí)時操作系統(tǒng)，也可以直接購買通用操作系統(tǒng)不作任何修改，現(xiàn)成的通用操作系統(tǒng)。FPGA性能的提高和軟處理器核的出現(xiàn)，直接導(dǎo)致了可編程邏輯SoC解決方案的產(chǎn)生，隨著這一變化，關(guān)于選擇標(biāo)準(zhǔn)，設(shè)計(jì)方案以及折中考慮等傳統(tǒng)經(jīng)驗(yàn)也需要與時俱進(jìn)以
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混合信號的FPGA促進(jìn)臨床醫(yī)療應(yīng)用發(fā)展

  • 由于醫(yī)療服務(wù)成本的不斷攀升、慢性病的流行、人口的老齡化，以及中國、印度和巴西等大規(guī)模新興市場的崛起，對價...
  • 關(guān)鍵字： FPGA  醫(yī)療設(shè)備  混合信號  
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