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基于FPGA的RISC微處理器的設(shè)計與實現(xiàn)

  • 基于FPGA和電子設(shè)計自動化技術(shù)，采用模塊化設(shè)計的方法和VHDL語言，設(shè)計一個基于FPGA的RISC微處理器。
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基于FPGA的微處理器內(nèi)核設(shè)計與實現(xiàn)

  • 與傳統(tǒng)投片實現(xiàn)ASIC相比，F(xiàn)PGA具有實現(xiàn)速度快、風(fēng)險小、可編程、可隨時更改升級等一系列優(yōu)點，因而得到了越米越廣泛的應(yīng)用。MCS-51應(yīng)用時間長、范圍廣，相關(guān)的軟硬件資源豐富，因而往往在FPGA應(yīng)用中嵌人MCS-51內(nèi)核作為微控制器。但是傳統(tǒng)MCS-51的指令效率太低，每個機器周期高達12時鐘周期，因此必須對內(nèi)核加以改進，提高指令執(zhí)行速度和效率，才能更好地滿足FPGA的應(yīng)用。 通過對傳統(tǒng)MCS-51單片機指令時序和體系結(jié)構(gòu)的分析，使用VHDL語言采用自頂向下的設(shè)計方法重新設(shè)計了一個高效的微控制器內(nèi)核
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采用軟處理器IP規(guī)避器件過時的挑戰(zhàn)

  • 在向一個嵌入式產(chǎn)品設(shè)計做出幾年的財力和物力投資之后，你最不愿意聽到的消息就是你所采用的器件已經(jīng)“生命終止”。在分立的嵌入式處理中，陳舊過時意味著你必須為你的下一個設(shè)計轉(zhuǎn)向采用另外一種處理器，并且完全可能要重新設(shè)計你想在市場中保持的現(xiàn)有產(chǎn)品。即使是半導(dǎo)體行業(yè)中的巨頭，也并不是總能夠為所有類型的應(yīng)用找到利用個別分立解決方案的途徑。許多最終產(chǎn)品無法證明采用特定的分立器件是恰當(dāng)?shù)模虼?，隨著時間的推移，甚至長期供應(yīng)商也會在不合適的時間停止為他們的客戶提供器件支持。 英特爾公司最近宣布他們將退出嵌入式市場。在1
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利用Virtex-5 FPGA實現(xiàn)更高的性能

  • 在FPGA系統(tǒng)設(shè)計中，要達到性能最大化需要平衡具有混合性能效率的元器件，包括邏輯構(gòu)造(fabric)、片上存儲器、DSP和I/O帶寬。在本文中，我將向你解釋怎樣能在追求更高系統(tǒng)級性能的過程中受益于Xilinx® 的Virtex™-5 FPGA構(gòu)建模塊，特別是新的ExpressFabric™技術(shù)。以針對邏輯和算術(shù)功能的量化預(yù)期性能改進為例，我將探究ExpressFabric架構(gòu)的主要功能?；趯嶋H客戶設(shè)計的基準(zhǔn)將說明Virtex-5ExpressFabric技術(shù)性能平均比前一
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FPGA與DSP的高速通信接口設(shè)計與實現(xiàn)

  • 在雷達信號處理、數(shù)字圖像處理等領(lǐng)域中，信號處理的實時性至關(guān)重要。由于FPGA芯片在大數(shù)據(jù)量的底層算法處理上的優(yōu)勢及DSP芯片在復(fù)雜算法處理上的優(yōu)勢，DSP+FPGA的實時信號處理系統(tǒng)的應(yīng)用越來越廣泛。ADI公司的TigerSHARC系列DSP芯片浮點處理性能優(yōu)越，故基于這類。DSP的DSP+FPGA處理系統(tǒng)正廣泛應(yīng)用于復(fù)雜的信號處理領(lǐng)域。同時在這類實時處理系統(tǒng)中，F(xiàn)PGA與DSP芯片之間數(shù)據(jù)的實時通信至關(guān)重要。 TigerSHARC系列DSP芯片與外部進行數(shù)據(jù)通信主要有兩種方式：總線方式和鏈路口方式。鏈路
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面向FPGA的ESL工具

  • 邏輯設(shè)計領(lǐng)域正在發(fā)生根本變化。新一代設(shè)計工具幫助軟件開發(fā)者將其算法表達直接轉(zhuǎn)換成硬件，而無需學(xué)習(xí)傳統(tǒng)的硬件設(shè)計技術(shù)。 這些工具及相關(guān)設(shè)計方法學(xué)一起被歸類為電子系統(tǒng)級 (ESL) 設(shè)計，廣泛地指從比目前主流的寄存器傳輸級 (RTL) 更高的抽象級別上開始的系統(tǒng)設(shè)計與驗證方法學(xué)。與硬件語言如 Verilog 和 VHDL比起來，ESL 設(shè)計語言在語法和語義上與流行的 ANSI C 比較接近。 ESL 與 FPGA 有何關(guān)系？ ESL 工具已經(jīng)存在了一段時間，而許多人覺得這些工具主要專注于 ASIC 設(shè)計
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賽靈思宣布SPARTAN-3A I/O優(yōu)化FPGA全線產(chǎn)品實現(xiàn)量產(chǎn)

  • 　　賽靈思公司（Xilinx, Inc. ）今天宣布90nm I/O優(yōu)化的Spartan™-3A平臺全線產(chǎn)品實現(xiàn)量產(chǎn)。這些產(chǎn)品包括Spartan-3A平臺的全部五款器件：XC3S50A、XC3S200A、XC3S400A、XC3S700A和XC3S1400A。 　　隨著產(chǎn)品架構(gòu)的不斷演進和成本的迅速降低，賽靈思Spartan系列FPGA自從1998年推出以來，應(yīng)用范圍不斷擴展，目前已經(jīng)成為全球消費電子和汽車應(yīng)用設(shè)計人員的首選器件平臺。其主要應(yīng)用包括數(shù)字顯示、手機、PDA、汽車后座娛樂系統(tǒng)和
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采用靈活的汽車FPGA來提高片上系統(tǒng)級集成和降低物料成本

  • 汽車制造商們堅持不懈地改進車內(nèi)舒適性、安全性、便利性、工作效能和娛樂性，反過來，這些努力又推動了各種車內(nèi)數(shù)字技術(shù)的應(yīng)用。然而，汽車業(yè)較長的開發(fā)周期卻很難跟上最新技術(shù)的發(fā)展，尤其是一直處于不斷變化中的車內(nèi)聯(lián)網(wǎng)規(guī)范，以及那些來自消費市場的快速興起和消失的技術(shù)，從而造成了較高的工程設(shè)計成本和大量過時。向這些組合因素中增加低成本目標(biāo)、擴展溫度范圍、高可靠性與質(zhì)量目標(biāo)和有限的物理板空間，以及汽車設(shè)計中存在的挑戰(zhàn)，最多使人進一步感到沮喪?？删幊踢壿嬈骷?nbsp;(PLD)，如現(xiàn)場可編程門陣列 (FPGA)
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Actel推出業(yè)界最低功耗的FPGA系列——IGLOO

  • 　　Actel 公司宣布推出業(yè)界最低功耗的現(xiàn)場可編程門陣列 (FPGA) -- IGLOO™ 系列。這個以 Flash 為基礎(chǔ)的產(chǎn)品系列的靜態(tài)功耗為5µW，是最接近競爭產(chǎn)品功耗的四分之一；與目前領(lǐng)先的PLD產(chǎn)品比較，更可延長便攜式應(yīng)用的電池壽命達5倍，因而奠定了低功耗的新標(biāo)準(zhǔn)。 　　由于便攜式產(chǎn)品的生命周期短及市場競爭激烈，設(shè)計人員必需不斷增加新的功能和復(fù)雜性，但卻不能耗用更多的電池能量。這個需求使到可重編程及全功能的Actel IGLOO 方案別具吸引力，足以取代ASIC和 C
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基于 FPGA 的 MPEG-4 編解碼器

  • 您是否曾想在您的FPGA設(shè)計中使用先進的視頻壓縮技術(shù)，卻發(fā)現(xiàn)實現(xiàn)起來太過復(fù)雜？現(xiàn)在您無需成為一名視頻專家就能在您的系統(tǒng)中使用視頻壓縮。賽靈思新推出的 MPEG-4 編碼器/解碼器核可以幫助您滿足視頻壓縮需求。 視頻和多媒體系統(tǒng)正變得日益復(fù)雜，因此能否獲得適用于您的系統(tǒng)的低成本的可靠 IP 核對您的產(chǎn)品上市極為關(guān)鍵。特別是，視頻壓縮算法與標(biāo)準(zhǔn)已變成極為復(fù)雜的電路，需要花費很長時間來設(shè)計，并且常常成為系統(tǒng)測試和發(fā)貨的瓶頸。這些 MPEG-4 簡易 (simple profile) 編碼器/解碼器核也許正好
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Altera推出低成本Arria GX FPGA系列

  • Altera公司(NASDAQ: ALTR)今天宣布推出低成本Arria™ GX系列，繼續(xù)擴大了公司在收發(fā)器FPGA市場上的領(lǐng)先優(yōu)勢。Arria GX FPGA經(jīng)過優(yōu)化，支持速率高達2.5Gbps的PCI Express (PCIe)、千兆以太網(wǎng)(GbE)和Serial RapidIO™ (SRIO)標(biāo)準(zhǔn)；這些標(biāo)準(zhǔn)迅速成為很多市場和應(yīng)用領(lǐng)域的主流協(xié)議。Arria GX系列的特性包括成熟的Str
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亞科鴻禹發(fā)布新版FPGA原型驗證板StarFire6S-DARM

  • 　　亞科鴻禹科技有限公司（HyperSilicon）于近日在北京推出了名為StarFire6S-DARM的系列新型FPGA原型驗證系統(tǒng)。該公司原有的StarFire5S-V系列主要針對各類視音頻SOC的設(shè)計驗證，被國內(nèi)設(shè)計公司廣泛采用累計達20多套。這款新的StarFire6S-DARM系列繼承了StarFire5S-V系列的大部分優(yōu)點，在容量、靈活性和性能指標(biāo)方面有了進一步提高，同時支持采用各類型ARMTM處理器的SOC驗證，從而適應(yīng)更廣泛的SOC/ASIC/IP/FPGA的原型驗證和算法實現(xiàn)的要求。
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基于CPCI總線架構(gòu)設(shè)計的實時圖像信號處理平臺

  • 摘要:  本文主要介紹了基于CPCI 總線設(shè)計的實時信號處理業(yè)務(wù)所需的一種專用設(shè)備平臺。關(guān)鍵詞： CPCI BUS；平臺；實時信號處理；DSP+FPGA 系統(tǒng)設(shè)計DSP+FPGA混用設(shè)計為了提高算法效率，實時處理圖像信息，本處理系統(tǒng)是基于DSP+FPGA混用結(jié)構(gòu)設(shè)計的。業(yè)務(wù)板以FPGA為處理核心，實現(xiàn)數(shù)字視頻信號的實時圖像處理，DSP實現(xiàn)了部分的圖像處理算法和FPGA的控制邏輯，并響應(yīng)中斷，實現(xiàn)數(shù)據(jù)通信和存儲實時信號。首先，本系統(tǒng)要求DSP可以滿足算法控制結(jié)構(gòu)復(fù)雜、運算速度高、尋址靈
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基于FPGA的高階全數(shù)字鎖相環(huán)的設(shè)計與實現(xiàn)

  • 本文提出了一種基于PI 控制算法的三階全數(shù)字鎖相環(huán)，采用EDA 技術(shù)進行系統(tǒng)設(shè)計，并用可編程邏輯器件予以實現(xiàn)。
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FPGA與DS18B20型溫度傳感器通信的實現(xiàn)

  • DS18B20是DALLAS公司生產(chǎn)的一線式數(shù)字溫度傳感器，采用3引腳TO-92型小體積封裝；溫度測量范圍為-55℃～+125℃，可編程為9位～12位A/D轉(zhuǎn)換精度，測溫分辨率可達0.0625℃，被測溫度用符號擴展的16位數(shù)字量方式串行輸出。  一線式(1-WIRE)串行總線是利用1條信號線就可以與總線上若干器件進行通信。具體應(yīng)用中可以利用微處理器的I/O端口對DS18B20直接進行通信，也可以通過現(xiàn)場可編程門陣列(FPGA)等可編程邏輯器件(PLD)實現(xiàn)對1-WIRE器件的通信。 
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