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基于DSP及FPGA的水下目標定位系統(tǒng)數(shù)字信號處理模塊

  • 隨著水下武器和水下航行器等水下目標的快速發(fā)展，對其進行定位和跟蹤從而檢驗其性能的試驗具有非常重要的意義，這也是水下目標試驗場的重要工作內(nèi)容。水下試驗場的定位系統(tǒng)根據(jù)被測目標是否加裝合作聲信標，可以分為
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基于層次型AdaBoost檢測算法的快速人臉檢測在FPGA

  • 人臉檢測是指對于給定的圖像或視頻，判斷其中是否存在人臉，如果存在，則進一步確定人臉的個數(shù)、具體位置以及大小的過程[1]。作為一個模式識別問題，人臉檢驗包含兩個方面的內(nèi)容，一是特征提取，二是分類方法設(shè)計。近
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一種遠程在線更新FPGA程序的方法

  • 1 概述
    現(xiàn)場可編程門陣列(Field Programmable Gate Array，F(xiàn)PGA)器件具有高密度、低功耗、高速、高可靠性等優(yōu)點，在航空航天、通信、工業(yè)控制等方面得到了大量應(yīng)用。FPGA的處理器分為軟核和硬核，并且軟核處理器
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基于FPGA和單片機的位移測量裝置的設(shè)計

  • 　　位移傳感器廣泛應(yīng)用于工業(yè)和控制領(lǐng)域，如過程檢測、物理測量和自動控制等。由于其測量精度不高，往往滿足不 ...
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嵌入式處理器Nios II與液晶顯示模塊的接口及應(yīng)用

  • 嵌入式處理器Nios II與液晶顯示模塊的接口及應(yīng)用,液晶顯示器(LCD)由于具有工作電壓低、功耗低、體積小、顯示信息量大、壽命長、不產(chǎn)生電磁輻射污染、可以顯示復(fù)雜的文字及圖形等優(yōu)點，液晶顯示器已被廣泛應(yīng)用于各種儀器儀表、電子設(shè)備及控制領(lǐng)域中，成為測量結(jié)果顯示
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基于Nios Ⅱ軟核的人臉檢測系統(tǒng)設(shè)計

  • 引言人臉檢測跟蹤是計算機視覺中十分重要的研究領(lǐng)域，正受到越來越多的關(guān)注。傳統(tǒng)基于PC平臺的人臉檢測跟蹤系統(tǒng)體積大，不能滿足便攜的要求，更不適合露天使用；而采用通用的DSP芯片組成的系統(tǒng)，外圍電路較復(fù)雜，設(shè)計
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一種基于FPGA的B超數(shù)字波束形成技術(shù)

  • 論述了一種運行在FPGA芯片上應(yīng)用于B超的全數(shù)字波束形成技術(shù)。采用孔徑變跡、幅度加權(quán)變跡和動態(tài)變跡相結(jié)合的綜合變跡技術(shù)和動態(tài)聚焦技術(shù)，兩種技術(shù)均形成直觀的數(shù)學(xué)模型，在FPGA上的實現(xiàn)方法類似，先將數(shù)學(xué)模型數(shù)字化，然后計算出數(shù)據(jù)表存入ROM，運行時將ROM中提取的數(shù)據(jù)與輸入數(shù)據(jù)進行運算，即可得到預(yù)期的輸出數(shù)據(jù)。在Matlab仿真和樣機測試中達到了很好的抑制旁瓣和動態(tài)聚焦效果，提高了波束形成的精度。
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Xilinx對FPGA的技術(shù)市場展望

  • 2011 年 12 月 13 日，可編程平臺廠商賽靈思公司 (Xilinx )進駐北京新址，并開設(shè)研發(fā)中心。會上，Xilinx介紹了FPGA的發(fā)展方向
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基于Actel FPGA的TFT控制器技術(shù)方案設(shè)計

  • 基于Actel FPGA的TFT控制器技術(shù)方案設(shè)計,在1970年，F(xiàn)ergason制造了第一臺具有實用性的LCD，從此之后，用戶產(chǎn)品的界面發(fā)生了巨大改變，變得更加的美觀、實用，在一定場合下逐漸取代傳統(tǒng)的數(shù)碼管、LED的顯示。TFT誕生于80年代末，在1995年之后被廣泛的應(yīng)用，現(xiàn)
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基于FPGA NiosII的MPEG-4視頻播放器

  • 引 言多媒體技術(shù)實用化的關(guān)鍵技術(shù)之一，就是解決視頻、音頻數(shù)字化以后數(shù)據(jù)量大，與數(shù)字存儲媒體、通信網(wǎng)容量小的矛盾，其解決途徑就是壓縮。為了支持低比特率視頻傳輸業(yè)務(wù)，MPEG(Moving Picture Expert5 Group)推出了
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基于單片機的CPLD/FPGA被動串行下載配置的實現(xiàn)

  • 1引言隨著電子技術(shù)的發(fā)展，當前數(shù)字系統(tǒng)的設(shè)計正朝著速度快、容量大、體積小、重量輕的方向發(fā)展。推動該潮流迅猛發(fā)展的引擎就是日趨進步和完善的高密度現(xiàn)場可編程邏輯器件設(shè)計技術(shù)。高密度現(xiàn)場可編程邏輯器件（CPLD/
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基于VC++的FPGA重配置方案設(shè)計

  • 基于VC++的FPGA重配置方案設(shè)計,采用VC++程序的FPGA重配置設(shè)計方案利用現(xiàn)場可編程邏輯器件FPGA的多次可編程配置特點，通過重新下載存儲于存儲器的不同系統(tǒng)數(shù)據(jù)，從而實現(xiàn)不同的芯片邏輯功能，可以在很大程度上提高資源利用率。原始配置FPGA的方法是
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基于NIOS II的SOPC存儲器型外設(shè)接口的設(shè)計

  • 基于NIOS II的SOPC存儲器型外設(shè)接口的設(shè)計,0 引言

    隨著微電子設(shè)計技術(shù)與工藝的發(fā)展，數(shù)字集成電路由最初的電子管、晶體管逐步發(fā)展成專用集成電路(ASIC，Application Specific IntegratedCircuit)，同時可編程邏輯器件也取得了長足進步。

    如今，可完成超
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基于FPGA的高速異步FIFO的設(shè)計與實現(xiàn)

  • 基于FPGA的高速異步FIFO的設(shè)計與實現(xiàn),引言 　　現(xiàn)代集成電路芯片中，隨著設(shè)計規(guī)模的不斷擴大．一個系統(tǒng)中往往含有數(shù)個時鐘。多時鐘帶來的一個問題就是，如何設(shè)計異步時鐘之間的接口電路。異步FIFO(First In First Out)是解決這個問題的一種簡便、快捷的解
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FPGA上同步開關(guān)噪聲的分析與解決方法介紹

  • FPGA上同步開關(guān)噪聲的分析與解決方法介紹,概述 　　隨著半導(dǎo)體技術(shù)的快速發(fā)展，近年來FPGA 的器件容量和輸入輸出的管腳數(shù)量都極大的增加了，例如StratixIV 器件，最大的一款EP4SE680 擁有68.11 萬個邏輯單元和1104個輸入輸出管腳。大量的輸出管腳在同一時刻翻
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