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EEPW首頁 >> 主題列表 >> fpga-nios

實現(xiàn)電源排序的簡單電路

  • 　　asic、fpga和dsp可能需要多個電源電壓，而這些電源電壓的啟動順序有種種限制。通常電壓值最高的i/o電壓常常必須首先啟動，然后其他電壓按照從高到低的順序逐一啟動，最后啟動的是芯核電壓。這種情況可能還要求一個電源線的電壓不能比另一電源線的電壓大一個二極管壓降以上;否則過大的電流可從i/o電壓通過ic回流到較低的電壓，有可能損壞昂貴的ic。你控制這一順序的常用方法是，在排序的相鄰電壓線之間連接外部二極管，以便把一個較高的電壓嵌位到一個較低電壓的一個二極管壓降以內(nèi)，從而防止ic中可能出現(xiàn)的閂鎖現(xiàn)象。二
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基于FPGA的SOC系統(tǒng)中的串口設(shè)計

  • 　　1　概述 　　在基于FPGA的SOC設(shè)計中,常使用串口作為通信接口,但直接用FPGA進行串口通信數(shù)據(jù)的處理是比較繁雜的,特別是直接使用FPGA進行串口通信的協(xié)議的解釋和數(shù)據(jù)打包等處理,將會消耗大量的FPGA硬件資源。 　　為簡化設(shè)計,降低硬件資源開銷,可以在FPGA中利用IP核實現(xiàn)的嵌入式微處理器來對串口數(shù)據(jù)進行處理。 　　本文中的設(shè)計采用了XILINX的FPGA,可選用的嵌入式微處理器IP核種類繁多,但基于對硬件資源開銷最少的考慮,最終選用了Picoblaze。 　　嵌入式微處理器PicoB
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SEP3203處理器與FPGA數(shù)據(jù)通信接口設(shè)計

  • 采樣數(shù)據(jù)經(jīng)過FPGA的算法處理后，SEP3203處理器通過DMA方式將運算結(jié)果存儲到片外SDRAM，SEP3203與FPGA的數(shù)據(jù)通信遵循SRAM時序。通過兩組FIFO存儲A／D數(shù)據(jù)，系統(tǒng)實現(xiàn)了信號的不間斷采集和信號處理的流水線操作。
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前沿技術(shù)提高圖像處理實例分析

  • 　　intevac是商用和軍用市場光學(xué)產(chǎn)品的前沿開發(fā)商。本文介紹該公司nightvista嵌入式電子系統(tǒng)的開發(fā)，該產(chǎn)品是高性能超低亮度緊湊型攝像機。該攝像機最初采用了流行的數(shù)字信號處理器、幾個assp和外部存儲器件。系統(tǒng)對性能的需求越來越高，工程師團隊決定試驗一種替代方案——在可編程邏輯中實現(xiàn)可配置軟核處理器。這一決定帶來了以下好處： 　　達到了目標所要求的性能： 　　1.在單個FPGA中集成了分立的元件和數(shù)字信號處理(dsp)功能 　　2.功耗降低了近80% 　　3.將五塊元件板縮減到一塊，顯著
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一種基于FPGA的新型誤碼測試儀的設(shè)計與實現(xiàn)

  • 　　引言 　　誤碼儀是評估信道性能的基本測量儀器。本文介紹的誤碼儀結(jié)合FPGA 的特點,采用全新的積分式鑒相結(jié)構(gòu)，提出了一種新的誤碼測試方法，經(jīng)多次測試驗證，方案可行，設(shè)計的系統(tǒng)穩(wěn)定。本文設(shè)計的誤碼儀由兩部分組成：發(fā)信機和接收機。 　　1 發(fā)信機 　　發(fā)信機的主要功能是產(chǎn)生具有隨機特性的偽隨機m 序列，通過FPGA 由VHDL 編程實現(xiàn)。偽隨機序列產(chǎn)生原理如下： 　　 　　圖1 偽隨機序列產(chǎn)生原理圖 　　其中，ak-i是各移位寄存器的狀態(tài)，Ci對應(yīng)各寄存器的反饋系數(shù)，為1表示參與反饋
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ARM、DSP、FPGA的技術(shù)特點和區(qū)別是什么

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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在FPGA中置入可配置的32位處理器增加設(shè)計靈活度

  • 　　嵌入式系統(tǒng)與桌面PC結(jié)構(gòu)非常不同，但其底層技術(shù)發(fā)展卻是一樣的，而且遵循著類似發(fā)展趨勢。當桌面PC轉(zhuǎn)向64位架構(gòu)來滿足不斷增長的存儲器要求時，嵌入式系統(tǒng)也由于同樣的原因快速轉(zhuǎn)向32位處理器。桌面/服務(wù)器計算市場主要是圍繞x86架構(gòu)，大多數(shù)創(chuàng)新和差異都在系統(tǒng)級，如雙核、四核或多核中央處理架構(gòu)、集成圖像處理器單元和存儲器控制器等等。同樣，嵌入式系統(tǒng)則主要圍繞簡單的32位RISC處理器，多核架構(gòu)、集成外設(shè)以及可配置處理等系統(tǒng)級發(fā)展，使得設(shè)計人員能夠快速適應(yīng)不斷變化的應(yīng)用要求。 　　根據(jù)iSuppli的研究報
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半導(dǎo)體業(yè)界領(lǐng)袖08新視點 低功耗是一種優(yōu)勢

  • 　　Altera公司產(chǎn)品和企業(yè)市場副總裁DannyBiran 　　低功耗是一種戰(zhàn)略優(yōu)勢 　　在器件的新應(yīng)用上，F(xiàn)PGA功耗和成本結(jié)構(gòu)的改進起到了非常重要的作用。Altera針對低功耗，同時對體系結(jié)構(gòu)和生產(chǎn)工藝進行改進，使我們的高端StratixIIIFPGA能夠用于高性能計算領(lǐng)域，而低成本CycloneIIIFPGA用于軟件無線電，MaxIIZCPLD則適合便攜式應(yīng)用。 　　在生產(chǎn)工藝方面，Altera在很大程度上受益于和TSMC的合作。這種緊密的合作關(guān)系使Altera能夠在CycloneIII中充
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FPGA中的IP集成方法對比

  • 引言  從最初的計算機和電話開始，互聯(lián)網(wǎng)絡(luò)一直是電子工程的關(guān)鍵構(gòu)成。在超大規(guī)模集成(VLSI)電路時代，由于MOS晶體管的驅(qū)動特性以及片內(nèi)互聯(lián)相對較大的電容，互聯(lián)網(wǎng)絡(luò)變得尤其重要。  芯片內(nèi)部用于連接功能單元的互聯(lián)網(wǎng)絡(luò)對芯片性能有很大的影響，甚至是決定性的影響?？偩€雖然是一種最簡單的互聯(lián)，但從容量或者電源角度看，卻是較差的選擇，因為驅(qū)動總線以最大速率工作時需要的電源和空間隨總線電容呈指數(shù)增大。而且，多點連接網(wǎng)絡(luò)也不是一種好選擇，因為即使每次只需要一次對話，或者會話限于最近的鄰居之間，也
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采用靈活的汽車FPGA提高片上系統(tǒng)級集成和降低物料成本

  • 　　汽車制造商們堅持不懈地改進車內(nèi)舒適性、安全性、便利性、工作效能和娛樂性，反過來，這些努力又推動了各種車內(nèi)數(shù)字技術(shù)的應(yīng)用。然而，汽車業(yè)較長的開發(fā)周期卻很難跟上最新技術(shù)的發(fā)展，尤其是一直處于不斷變化中的車內(nèi)聯(lián)網(wǎng)規(guī)范，以及那些來自消費市場的快速興起和消失的技術(shù)，從而造成了較高的工程設(shè)計成本和大量過時。向這些組合因素中增加低成本目標、擴展溫度范圍、高可靠性與質(zhì)量目標和有限的物理板空間，以及汽車設(shè)計中存在的挑戰(zhàn)，最多使人進一步感到沮喪?？删幊踢壿嬈骷?(PLD)，如現(xiàn)場可編程門陣列 (FPGA) 和復(fù)雜 PLD
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Xilinx推出針對Intel Xeon 7300系列平臺的前端總線FPGA解決方案

  • 　　賽靈思宣布開始正式發(fā)放高性能計算行業(yè)首款針對Intel前端總線(FSB)的FPGA加速解決方案商業(yè)許可。基于高性能65nm Virtex™-5 平臺 FPGA 和Intel® QuickAssist技術(shù)，賽靈思公司的加速計算平臺(Accelerated Computing Platform, ACP)M1許可包支持實現(xiàn)全速1066MHz FSB性能。ACP M1許可包目前已開始向系統(tǒng)集成商提供，支持他們進行解決方案的開發(fā)，以提高基于Intel處理器的服務(wù)器平臺的性能，并保證把功耗和
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FPGA：65nm器件上量低功耗市場興起

  • 　　隨著65nm工藝的應(yīng)用以及更多低功耗技術(shù)的采用，F(xiàn)PGA擁有了更低的成本、更高的性能以及突破性的低耗電量，具備進入更廣泛市場的條件。FPGA從業(yè)者表示，今年FPGA快速增長，而預(yù)計明年仍將是一個增長年。 　　比拼65nm器件 加快45nm研發(fā) 　　就像兩三年前，可編程邏輯器件領(lǐng)域的兩大廠商在90nm器件上進行大比拼一樣，2007年，這兩家企業(yè)Xilinx和Altera又在新一代技術(shù)節(jié)點65nm器件上開始了競賽。一方面Xilinx宣稱他們比競爭對手領(lǐng)先推出了65nm器件，另一方面Altera則在宣布
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