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EEPW首頁 >> 主題列表 >> fpga-nios

基于FPGA的高速并行Viterbi譯碼器的設計與實現

  • 針對319卷積編碼，提出一種Viterbi譯碼器的FPGA實現方案。該方案兼顧了資源消耗和譯碼效率，通過有效的時鐘和存儲介質復用，實現了高速并行的譯碼功能，并利用Verilog語言在Xilinx ISE 6．2中進行了建模仿真和綜合實現。
  • 關鍵字： 卷積編碼  Viterbi譯碼器  FPGA  

FPGA加速三維CT圖像重建

  • 針對三維圖像重建的經典算法(FDK算法)在FPGA上的加速，提出了并行無等待流水線的實現方法。實驗結果表明，該方法獲得了較高的加速比。
  • 關鍵字： 三維圖像重建  FDK算法  FPGA  

一種改進Turbo碼譯碼器的FPGA設計與實現

  • 提出了一種基于MAX-Log-MAP算法的更有效減小譯碼延時的方法，通過并行計算前向狀態(tài)度量和后向狀態(tài)度量，將半次迭代譯碼延時縮短一半，而譯碼性能沒有損失，同時也減小了硬件實現中的時序控制復雜度。
  • 關鍵字： Turbo碼  迭代譯碼  FPGA  

基于FPGA的立體視頻轉換系統(tǒng)

  • 給出了以FPGA為核心、針對自由立體顯示器的立體視頻格式轉換系統(tǒng)的設計與實現方法。詳細介紹了系統(tǒng)的硬件構成和FPGA邏輯設計，包括DVI控制、視頻格式轉換以及數據緩沖系統(tǒng)等。
  • 關鍵字： 視頻格式轉換  數據緩沖系統(tǒng)  FPGA  

用FPGA實現優(yōu)化的指紋識別預處理算法

  • 在選取較優(yōu)化的指紋識別預處理算法的基礎上，根據算法的結構選取具有并行處理、低功耗、速度快等特點的FPGA作為實現算法的基本器件。由于用FPGA實現復雜算法較傳統(tǒng)器件從思考角度和實現方向上都有很大區(qū)別，所以本次設計從新的方向來完成傳統(tǒng)的指紋處理的設計。
  • 關鍵字： 指紋識別  預處理  FPGA  

基于FPGA的FIR濾波器的實現

  • 提出了一種采用現場可編程門陣列器件FPGA并利用窗函數法實現線性FIR數字濾波器硬件電路的方案，并以一個十六階低通FIR數字濾波器電路的實現為例說明了利用Xilinx公司XC4000系列芯片的設計過程。設計的電路通過軟件程序進行了驗證和硬件仿真，結果表明電路工作正確可靠，能滿足設計要求。
  • 關鍵字： FIR濾波器  窗函數  FPGA  

IIR數字濾波器的FPGA仿真與實現

  • 采用自頂向下的模塊化設計思想，介紹了一種采用級聯(lián)結構在FPGA上實現IIR數字濾波器的設計方案。設計IIR數字濾波器的二階節(jié)，將二階節(jié)IIR數字濾波器級聯(lián)實現高階IIR數字濾波器，從而實現通過修改外圍參數來改變?yōu)V波器的頻率響應,根據不同的要求在不同規(guī)模的FPGA上加以實現。
  • 關鍵字： IIR數字濾波器  級聯(lián)結構  FPGA  

FPGA設計的常見問題

  • 只要輸入信號同時變化，（經過內部走線）組合邏輯必將產生毛刺。將它們的輸出直接連接到時鐘輸入端、清零或置位端口的設計方法是錯誤的，這可能會導致嚴重的后果。 所以我們必須檢查設計中所有時鐘、清零和置位等對毛刺敏感的輸入端口，確保輸入不會含有任何毛刺。
  • 關鍵字： 毛刺  置位信號  FPGA  

基于FPGA的電子密碼鎖的研制

  • 介紹在QUATUSII環(huán)境下，采用FPGA可編程邏輯器件開發(fā)的電子密碼鎖，并利用狀態(tài)機（FSM）實現鍵盤消抖及系統(tǒng)主控模塊的行為控制，從實際工程設計角度闡述了系統(tǒng)所有模塊及其工作原理、軟件設計方法，提出了系統(tǒng)設計注意要點。
  • 關鍵字： QUATUSII  密碼鎖  FPGA  狀態(tài)機  

MP3的FPGA設計

  • FPGA能滿足MP3整個系統(tǒng)的價格、功耗和性能要求,它們靈活的結構使系統(tǒng)設計人員能在每種MP3播放機中最佳地實現各種功能。
  • 關鍵字： MP3  邏輯模塊  FPGA  

基于FPGA和單片機的掃頻儀研究與設計

  • 在系統(tǒng)設計時，各個網絡的頻率特性對該系統(tǒng)的穩(wěn)定性、工作頻帶、傳輸特性等都具有重要影響。實際操作中，掃頻儀大大簡化了測量操作，提高了工作效率，達到了測量過程快速、直觀、準確、方便的目的，在生產、科研、教學上得到廣泛運用。
  • 關鍵字： 頻率特性  掃頻儀  FPGA  

帶硬件地址識別的UART IP的設計和實現

  • 在通信和控制系統(tǒng)中，常使用異步串行通信控制器（UART）實現系統(tǒng)輔助信息的傳輸。為實現多點通信，通常用軟件識別發(fā)往本站點或其它站點的數據，這會加大CPU的開銷。介紹了一種基于FPGA的UART IP，由硬件實現多點通信時的數據過濾功能，降低了CPU的負擔，提高了系統(tǒng)性能。
  • 關鍵字： UART  IP  FPGA  

H.264/AVC中CAVLC編碼器的硬件設計與實現

  • 設計了一種H.264標準的CAVLC編碼器，對原有軟件流程進行部分改進，提出了并行處理各編碼子模塊的算法結構。
  • 關鍵字： 變長編碼  非零系數級編碼  FPGA  

FPGA/CPLD狀態(tài)機穩(wěn)定性研究

  • 在FPGA/CPLD設計中,狀態(tài)機是最典型、應用最廣泛的時序電路模塊,如何設計一個穩(wěn)定可靠的狀態(tài)機是我們必須面對的問題.
  • 關鍵字： 時序電路  狀態(tài)機  FPGA  

數字變頻的FPGA實現

  • 本文介紹了數字下變頻的組成結構，并通過一個具體的實例，給出了FPGA實現的具體過程。
  • 關鍵字： 數字變頻  VHDL  FPGA  
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