lattice(萊迪思)半導(dǎo)體公司文章進(jìn)入lattice(萊迪思)半導(dǎo)體公司技術(shù)社區(qū)

萊迪思不斷快速擴(kuò)展產(chǎn)品組合,開啟下一個(gè)創(chuàng)新時(shí)代

在近日舉辦的萊迪思開發(fā)者大會(huì)上，低功耗可編程器件的領(lǐng)先供應(yīng)商萊迪思半導(dǎo)體公司近日宣布繼續(xù)擴(kuò)展其產(chǎn)品線，推出了多款全新硬件和軟件解決方案更新。萊迪思推出了兩款基于屢獲殊榮的萊迪思Avant?中端平臺(tái)打造的全新創(chuàng)新中端FPGA系列產(chǎn)品——萊迪思Avant-G?和萊迪思Avant-X?，分別用于通用設(shè)計(jì)和高級(jí)互連。萊迪思還發(fā)布了面向人工智能（AI）、嵌入式視覺、安全和工廠自動(dòng)化的專用解決方案集合的最新版本，添加了新的特性和功能，幫助客戶加快產(chǎn)品上市。此外，萊迪思還發(fā)布了其軟件工具以及Glance by Mira
關(guān)鍵字：萊迪思 FPGA Avant

萊迪思與英偉達(dá)合作加速推進(jìn)網(wǎng)絡(luò)邊緣AI

近日在萊迪思開發(fā)者大會(huì)上，萊迪思半導(dǎo)體公司近日宣布推出全新傳感器橋接參考設(shè)計(jì)，加速NVIDIA Jetson Orin和IGX Orin平臺(tái)的網(wǎng)絡(luò)邊緣AI應(yīng)用開發(fā)。這款開源參考開發(fā)板基于低功耗的萊迪思FPGA和NVIDIA Orin，旨在滿足開發(fā)人員在設(shè)計(jì)醫(yī)療保健、機(jī)器人和嵌入式視覺領(lǐng)域的高性能網(wǎng)絡(luò)邊緣AI應(yīng)用時(shí)的各種需求，包括各種傳感器和接口的互連、設(shè)計(jì)可擴(kuò)展性和低延遲等。萊迪思與英偉達(dá)的合作旨在通過改善傳感器與網(wǎng)絡(luò)邊緣AI計(jì)算應(yīng)用的連接，促進(jìn)開源開發(fā)者社區(qū)的發(fā)展。萊迪思半導(dǎo)體首席戰(zhàn)略與營銷官Esam
關(guān)鍵字：萊迪思英偉達(dá) 邊緣AI

萊迪思動(dòng)態(tài)前瞻:萊迪思開發(fā)者大會(huì)即將到來

備受期待的萊迪思開發(fā)者大會(huì)即將到來，萊迪思也剛剛公布了大會(huì)的全部議程。在12月5日至7日的三天時(shí)間內(nèi)將舉辦一系列精彩的主題演講、知名行業(yè)專家參與的技術(shù)小組會(huì)議，以及各類精彩的演示展示。在為期3天的線上活動(dòng)中，與會(huì)者將獲得寶貴的見解、提高他們的技能，并直接從多個(gè)行業(yè)的技術(shù)領(lǐng)導(dǎo)者那里了解有關(guān)人工智能（AI）、安全性、高級(jí)互連等領(lǐng)域的最新趨勢、機(jī)遇和可編程解決方案。來自BMW、Meta和英偉達(dá)的主題演講在12月5日，包括Jim Anderson（總裁兼首席執(zhí)行官）、Steve Douglass（首席技術(shù)官）和
關(guān)鍵字：萊迪思萊迪思開發(fā)者大會(huì) Lattice

Altera MAX10: 交通燈控制

簡易交通燈：本節(jié)將向您介紹Verilog語法之中的精髓內(nèi)容——狀態(tài)機(jī)，并且將利用狀態(tài)機(jī)實(shí)現(xiàn)十字路口的交通燈。====硬件說明與實(shí)現(xiàn)項(xiàng)目框圖====上圖為十字路口交通示意圖分之路與主路，要求如下：交通燈主路上綠燈持續(xù)15s的時(shí)間，黃燈3s的時(shí)間，紅燈10s的時(shí)間；交通燈支路上綠燈持續(xù)7s的時(shí)間，黃燈持續(xù)3秒的時(shí)間，紅燈18秒的時(shí)間；根據(jù)上述要求，狀態(tài)機(jī)設(shè)計(jì)框架分析如下：S1:主路綠燈點(diǎn)亮，支路紅燈點(diǎn)亮，持續(xù)15s的時(shí)間；S2:主路黃燈點(diǎn)亮，支路紅燈點(diǎn)亮，持續(xù)3s的時(shí)間；S3:主路紅燈點(diǎn)亮，支路綠燈點(diǎn)亮，持
關(guān)鍵字：交通燈狀態(tài)機(jī) FPGA Lattice Diamond 小腳丫

Lattice MXO2: 交通燈控制

簡易交通燈：本節(jié)將向您介紹Verilog語法之中的精髓內(nèi)容——狀態(tài)機(jī)，并且將利用狀態(tài)機(jī)實(shí)現(xiàn)十字路口的交通燈。硬件說明與實(shí)現(xiàn)項(xiàng)目框圖上圖為十字路口交通示意圖分之路與主路，要求如下： * 交通燈主路上綠燈持續(xù)15s的時(shí)間，黃燈3s的時(shí)間，紅燈10s的時(shí)間； * 交通燈支路上綠燈持續(xù)7s的時(shí)間，黃燈持續(xù)3秒的時(shí)間，紅燈18秒的時(shí)間；根據(jù)上述要求，狀態(tài)機(jī)設(shè)計(jì)框架分析如下： * S1:主路綠燈點(diǎn)亮，支路紅燈點(diǎn)亮，持續(xù)15s的時(shí)間； * S2:主路黃燈點(diǎn)亮，支路紅燈點(diǎn)亮，持續(xù)3s的時(shí)間； * S3:主路紅燈點(diǎn)亮，支
關(guān)鍵字：交通燈狀態(tài)機(jī) FPGA Lattice Diamond 小腳丫

Lattice MXO2: LED呼吸燈

呼吸燈：本節(jié)，我們將通過脈寬調(diào)制技術(shù)來實(shí)現(xiàn)“呼吸燈”，實(shí)現(xiàn)LED的亮度由最暗逐漸增加到最亮，再逐漸變暗的過程。脈沖寬度調(diào)制(PWM:Pulse Width Modulation)，簡稱脈寬調(diào)制。它是利用微控制器的數(shù)字輸出調(diào)制實(shí)現(xiàn)，是對模擬電路進(jìn)行控制的一種非常有效的技術(shù)，廣泛應(yīng)用于測量、通信、功率控制與變換等眾多領(lǐng)域。硬件說明呼吸燈的設(shè)計(jì)較為簡單，我們使用12MHz的系統(tǒng)時(shí)鐘作為高頻信號(hào)做分頻處理，調(diào)整占空比實(shí)現(xiàn)PWM，通過LED燈LD1指示輸出狀態(tài)。實(shí)現(xiàn)原理如上圖所示，脈沖信號(hào)的周期為T，高電平脈沖寬
關(guān)鍵字：呼吸燈 FPGA Lattice Diamond 小腳丫

小而美FPGA為邊緣AI賦能

1? ?小型和中端FPGA服務(wù)嵌入式AI領(lǐng)域?萊迪思經(jīng)過40多年的發(fā)展，目前擁有公司歷史上最強(qiáng)大的產(chǎn)品組合，其針對AI優(yōu)化、低功耗FPGA解決方案主要面向小型和中端FPGA市場。萊迪思旨在滿足客戶對各種網(wǎng)絡(luò)邊緣應(yīng)用日益增長的智能需求，提供超強(qiáng)適應(yīng)性的解決方案，幫助客戶跟進(jìn)不斷發(fā)展的AI算法。萊迪思提供包括嵌入式AI在內(nèi)的領(lǐng)先的解決方案，服務(wù)于工業(yè)、汽車、通信、計(jì)算和消費(fèi)類應(yīng)用。萊迪思sensAI?解決方案集合幫助客戶實(shí)現(xiàn)最新的工廠自動(dòng)化和工業(yè)機(jī)器視覺應(yīng)用，其低功耗FPGA提供
關(guān)鍵字： 202311 FPGA 萊迪思

Altera MAX10: 計(jì)時(shí)控制

計(jì)時(shí)控制在之前的實(shí)驗(yàn)中我們掌握了如何進(jìn)行時(shí)鐘分頻、如何進(jìn)行數(shù)碼管顯示與按鍵消抖的處理，那么在本節(jié)實(shí)驗(yàn)之中，我們將會(huì)實(shí)現(xiàn)一個(gè)籃球賽場上常見的24秒計(jì)時(shí)器。====硬件說明====在之前的實(shí)驗(yàn)中我們?yōu)樽x者詳細(xì)介紹過小腳丫MXO2板卡上的按鍵、數(shù)碼管、LED等硬件外設(shè)，在此不再贅述。本節(jié)將實(shí)現(xiàn)由數(shù)碼管作為顯示模塊，按鍵作為控制信號(hào)的輸入(包含復(fù)位信號(hào)和暫停信號(hào))，Altera MAX10作為控制核心的籃球讀秒系統(tǒng)，實(shí)現(xiàn)框圖如下：====Verilog代碼====// *****************
關(guān)鍵字：計(jì)時(shí)器 FPGA Lattice Diamond 小腳丫

Lattice MXO2: 計(jì)時(shí)控制

Warning: file_get_contents(https://www.eetree.cn/wiki/_media/%E8%AE%A1%E6%97%B6%E5%99%A8%E6%A1%86%E5%9B%BE.png?w=800&tok=0acdce): failed to open stream: HTTP request failed! HTTP/1.1 403 Forbidden in /var/www/html/www.edw.com.cn/www/rootapp/controll
關(guān)鍵字：計(jì)時(shí)器 FPGA Lattice Diamond 小腳丫

Altera MAX10: 按鍵消抖

按鍵消抖在之前的實(shí)驗(yàn)中我們學(xué)習(xí)了如何用按鍵作為FPGA的輸入控制，在本實(shí)驗(yàn)中將學(xué)習(xí)如何進(jìn)行按鍵消抖，用按鍵完成更多的功能。====硬件說明====按鍵是一種常用的電子開關(guān)，電子設(shè)計(jì)中不可缺少的輸入設(shè)備。當(dāng)按下時(shí)使開關(guān)導(dǎo)通，松開時(shí)則開關(guān)斷開，內(nèi)部結(jié)構(gòu)是靠金屬彈片來實(shí)現(xiàn)通斷。按鍵抖動(dòng)的原理抖動(dòng)的產(chǎn)生：通常的按鍵所用的開關(guān)為機(jī)械彈性開關(guān)，當(dāng)機(jī)械觸點(diǎn)斷開、閉合時(shí)，由于機(jī)械觸點(diǎn)的彈性作用，一個(gè)按鍵開關(guān)在閉合時(shí)不會(huì)馬上穩(wěn)定地接通，在斷開時(shí)也不會(huì)一下子斷開。因而在閉合及斷開的瞬間均伴隨有一連串的抖動(dòng)，為了不產(chǎn)生這種現(xiàn)
關(guān)鍵字：消抖 FPGA Lattice Diamond 小腳丫

Lattice MXO2: 按鍵消抖

按鍵消抖在之前的實(shí)驗(yàn)中我們學(xué)習(xí)了如何用按鍵作為FPGA的輸入控制，在本實(shí)驗(yàn)中將學(xué)習(xí)如何進(jìn)行按鍵消抖，用按鍵完成更多的功能。硬件說明按鍵是一種常用的電子開關(guān)，電子設(shè)計(jì)中不可缺少的輸入設(shè)備。當(dāng)按下時(shí)使開關(guān)導(dǎo)通，松開時(shí)則開關(guān)斷開，內(nèi)部結(jié)構(gòu)是靠金屬彈片來實(shí)現(xiàn)通斷。按鍵抖動(dòng)的原理抖動(dòng)的產(chǎn)生：通常的按鍵所用的開關(guān)為機(jī)械彈性開關(guān)，當(dāng)機(jī)械觸點(diǎn)斷開、閉合時(shí)，由于機(jī)械觸點(diǎn)的彈性作用，一個(gè)按鍵開關(guān)在閉合時(shí)不會(huì)馬上穩(wěn)定地接通，在斷開時(shí)也不會(huì)一下子斷開。因而在閉合及斷開的瞬間均伴隨有一連串的抖動(dòng)，為了不產(chǎn)生這種現(xiàn)象而作的措施就是
關(guān)鍵字：消抖 FPGA Lattice Diamond 小腳丫

Altera MAX10: LED流水燈

在時(shí)鐘分頻實(shí)驗(yàn)中我們練習(xí)了如何處理時(shí)鐘，接下來我們要學(xué)習(xí)如何利用時(shí)鐘來完成時(shí)序邏輯。====硬件說明====流水燈實(shí)現(xiàn)是很常見的一個(gè)實(shí)驗(yàn)，雖然邏輯比較簡單，但是里面也包含了實(shí)現(xiàn)時(shí)序邏輯的基本思想。要用FPGA實(shí)現(xiàn)流水燈有很多種方法，在這里我們會(huì)用兩種不同的方法實(shí)現(xiàn)。1，模塊化設(shè)計(jì)：在之前的實(shí)驗(yàn)中我們做了3-8譯碼器和時(shí)鐘分頻，如果把這兩個(gè)結(jié)合起來，我們就能搭建一個(gè)自動(dòng)操作的流水LED顯示。框圖如下：2，循環(huán)賦值：這是一種很簡潔的實(shí)現(xiàn)流水燈效果邏輯，就是定義一個(gè)8位的變量，在每個(gè)時(shí)鐘上升沿將最低位賦值給最高
關(guān)鍵字：流水燈 FPGA Lattice Diamond 小腳丫

Lattice MXO2: LED流水燈

在時(shí)鐘分頻實(shí)驗(yàn)中我們練習(xí)了如何處理時(shí)鐘，接下來我們要學(xué)習(xí)如何利用時(shí)鐘來完成時(shí)序邏輯。硬件說明流水燈實(shí)現(xiàn)是很常見的一個(gè)實(shí)驗(yàn)，雖然邏輯比較簡單，但是里面也包含了實(shí)現(xiàn)時(shí)序邏輯的基本思想。要用FPGA實(shí)現(xiàn)流水燈有很多種方法，在這里我們會(huì)用兩種不同的方法實(shí)現(xiàn)。1，模塊化設(shè)計(jì)：在之前的實(shí)驗(yàn)中我們做了3-8譯碼器和時(shí)鐘分頻，如果把這兩個(gè)結(jié)合起來，我們就能搭建一個(gè)自動(dòng)操作的流水LED顯示?？驁D如下：2，循環(huán)賦值：這是一種很簡潔的實(shí)現(xiàn)流水燈效果邏輯，就是定義一個(gè)8位的變量，在每個(gè)時(shí)鐘上升沿將最低位賦值給最高位，其他位右移一
關(guān)鍵字：流水燈 FPGA Lattice Diamond 小腳丫

Altera MAX10: 時(shí)鐘分頻

時(shí)鐘分頻在之前的實(shí)驗(yàn)中我們已經(jīng)熟悉了小腳丫的各種外設(shè)，掌握了verilog的組合邏輯設(shè)計(jì)，接下來我們將學(xué)習(xí)時(shí)序邏輯的設(shè)計(jì)。====硬件說明====時(shí)鐘信號(hào)的處理是FPGA的特色之一，因此分頻器也是FPGA設(shè)計(jì)中使用頻率非常高的基本設(shè)計(jì)之一。一般在FPGA中都有集成的鎖相環(huán)可以實(shí)現(xiàn)各種時(shí)鐘的分頻和倍頻設(shè)計(jì)，但是通過語言設(shè)計(jì)進(jìn)行時(shí)鐘分頻是最基本的訓(xùn)練，在對時(shí)鐘要求不高的設(shè)計(jì)時(shí)也能節(jié)省鎖相環(huán)資源。在本實(shí)驗(yàn)中我們將實(shí)現(xiàn)任意整數(shù)的分頻器，分頻的時(shí)鐘保持50%占空比。1，偶數(shù)分頻：偶數(shù)倍分頻相對簡單，比較容易理解。通
關(guān)鍵字：時(shí)序邏輯時(shí)鐘分頻 FPGA Lattice Diamond 小腳丫

Lattice MXO2: 時(shí)鐘分頻

時(shí)鐘分頻在之前的實(shí)驗(yàn)中我們已經(jīng)熟悉了小腳丫的各種外設(shè)，掌握了verilog的組合邏輯設(shè)計(jì)，接下來我們將學(xué)習(xí)時(shí)序邏輯的設(shè)計(jì)。硬件說明時(shí)鐘信號(hào)的處理是FPGA的特色之一，因此分頻器也是FPGA設(shè)計(jì)中使用頻率非常高的基本設(shè)計(jì)之一。一般在FPGA中都有集成的鎖相環(huán)可以實(shí)現(xiàn)各種時(shí)鐘的分頻和倍頻設(shè)計(jì)，但是通過語言設(shè)計(jì)進(jìn)行時(shí)鐘分頻是最基本的訓(xùn)練，在對時(shí)鐘要求不高的設(shè)計(jì)時(shí)也能節(jié)省鎖相環(huán)資源。在本實(shí)驗(yàn)中我們將實(shí)現(xiàn)任意整數(shù)的分頻器，分頻的時(shí)鐘保持50%占空比。1，偶數(shù)分頻：偶數(shù)倍分頻相對簡單，比較容易理解。通過計(jì)數(shù)器計(jì)數(shù)是完
關(guān)鍵字：時(shí)序邏輯時(shí)鐘分頻 FPGA Lattice Diamond 小腳丫