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基于FPGA的數(shù)字式心率計(jì)系統(tǒng)的設(shè)計(jì)實(shí)現(xiàn)

　　心率計(jì)是常用的醫(yī)學(xué)檢查設(shè)備，實(shí)時(shí)準(zhǔn)確的心率測(cè)量在病人監(jiān)控、臨床治療及體育競(jìng)賽等方面都有著廣泛的應(yīng)用。心率測(cè)量包括瞬時(shí)心率測(cè)量和平均心率測(cè)量。瞬時(shí)心率不僅能夠反映心率的快慢。同時(shí)能反映心率是否勻齊;平均心率雖只能反映心率的快慢，但記錄方便，因此這兩個(gè)參數(shù)在測(cè)量時(shí)都是必要的。　　測(cè)量心率有模擬和數(shù)字兩種方法。模擬方法是在給定的時(shí)間間隔內(nèi)計(jì)算R波(或脈搏波)的脈沖個(gè)數(shù)，然后將脈沖計(jì)數(shù)乘以一個(gè)適當(dāng)?shù)某?shù)測(cè)量心率的。這種方法的缺點(diǎn)是測(cè)量誤差較大、元件參數(shù)調(diào)試?yán)щy、可靠性差。數(shù)字方法是先測(cè)量相鄰R波之間的時(shí)間
關(guān)鍵字： FPGA 心率計(jì)

小梅哥和你一起深入學(xué)習(xí)FPGA之點(diǎn)亮LED燈（下）

　　七、測(cè)試平臺(tái)設(shè)計(jì) 　　本實(shí)驗(yàn)主要對(duì)LED的輸出和輸入與復(fù)位的關(guān)系進(jìn)行測(cè)試仿真，通過(guò)仿真，即可驗(yàn)證設(shè)計(jì)的正確性和合理性。相關(guān)testbench的代碼如下：　　以下是代碼片段：　　`timescale 1ns/1ns 　　module LED_Driver_tb; 　　reg Rst_n; 　　reg [3:0] Sig; 　　wire [3:0] Led; 　　LED_Driver 　　#( /*參數(shù)例化*/ 　　.Width (4) 　　) 　　LED_Driver_in
關(guān)鍵字： FPGA LED

小梅哥和你一起深入學(xué)習(xí)FPGA之點(diǎn)亮LED燈（上）

　　在之前更新的目錄里面，并沒(méi)有安排這個(gè)實(shí)驗(yàn)，第一個(gè)實(shí)驗(yàn)應(yīng)該是獨(dú)立按鍵的檢測(cè)與消抖?？墒?，當(dāng)小梅哥來(lái)做按鍵消抖的實(shí)驗(yàn)時(shí)，才發(fā)現(xiàn)沒(méi)有做基本的輸出設(shè)備，因此按鍵檢測(cè)的結(jié)果無(wú)法直觀的展示出來(lái)。也算是為后續(xù)實(shí)驗(yàn)做鋪墊吧，第一個(gè)實(shí)驗(yàn)就安排成了點(diǎn)亮LED燈。　　一、實(shí)驗(yàn)?zāi)康? 　　實(shí)現(xiàn)4個(gè)LED燈的亮滅控制　　二、實(shí)驗(yàn)原理　　LED燈的典型電路如下2-1所示，我們控制led燈的亮滅，實(shí)質(zhì)就是去控制FPGA的IO輸給LED負(fù)極一個(gè)低電平或者高電平。從圖中可知，我們給對(duì)應(yīng)的led負(fù)極上一個(gè)低電平，就會(huì)有對(duì)
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僅有16nm還不夠，Xilinx在下一代FPGA/SoC中加入多種猛料

　　2月底，Xilinx發(fā)布了下一代16nm產(chǎn)品特點(diǎn)的新聞：《Xilinx憑借新型存儲(chǔ)器、3D-on-3D 和多處理SoC技術(shù)在16nm繼續(xù)遙遙領(lǐng)先》(http://m.butianyuan.cn/article/270122.htm)，大意是說(shuō)，Xilinx新的16nm FPGA和SoC中，將會(huì)采用新型存儲(chǔ)器UltraRAM, 3D晶體管(FinFET)和3D封裝，Zynq會(huì)出多處理器產(chǎn)品MPSoC，因此繼28nm和20nm之后，繼續(xù)在行業(yè)中保持領(lǐng)先，打破了業(yè)內(nèi)這樣的規(guī)則：Xilinx和競(jìng)爭(zhēng)對(duì)手在工藝上
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電能質(zhì)量檢測(cè)與監(jiān)測(cè)分析終端設(shè)計(jì)匯總

　　電能質(zhì)量即電力系統(tǒng)中電能的質(zhì)量。理想的電能應(yīng)該是完美對(duì)稱(chēng)的正弦波。一些因素會(huì)使波形偏離對(duì)稱(chēng)正弦，由此便產(chǎn)生了電能質(zhì)量問(wèn)題。一方面我們研究存在哪些影響因素會(huì)導(dǎo)致電能質(zhì)量問(wèn)題，一方面我們研究這些因素會(huì)導(dǎo)致哪些方面的問(wèn)題，最后，我們要研究如何消除這些因素，從而最大程度上使電能接近正弦波。本文為您介紹電能質(zhì)量的檢測(cè)與分析儀器設(shè)計(jì)匯總。　　基于STM32和ATT7022C的電能質(zhì)量監(jiān)測(cè)終端的設(shè)計(jì) 　　本文以ARM STM32F103VE6和電表芯片ATT7022C為主構(gòu)建了電能質(zhì)量監(jiān)測(cè)終端,利用電表芯片A
關(guān)鍵字： ARM FPGA NiosⅡ

采用Nios的電能質(zhì)量監(jiān)測(cè)系統(tǒng)解決方案

　　在電力系統(tǒng)中，要實(shí)現(xiàn)對(duì)電能質(zhì)量各項(xiàng)參數(shù)的實(shí)時(shí)監(jiān)測(cè)和記錄，必須對(duì)電能進(jìn)行高速的采集和處理，尤其是針對(duì)電能質(zhì)量的各次諧波的分析和運(yùn)算，系統(tǒng)要完成大量運(yùn)算處理工作，同時(shí)系統(tǒng)還要實(shí)現(xiàn)和外部系統(tǒng)的通信、控制、人機(jī)接口等功能。而電能質(zhì)量監(jiān)測(cè)系統(tǒng)大多以微控制器或(與)DSP為核心的軟硬件平臺(tái)結(jié)構(gòu)以及相應(yīng)的設(shè)計(jì)開(kāi)發(fā)模式，存在著處理能力不足、可靠性差、更新?lián)Q代困難等弊端。本文將SoPC技術(shù)應(yīng)用到電力領(lǐng)域，在FPGA中嵌入了32位NiosⅡ軟核系統(tǒng)?？蓪?shí)現(xiàn)對(duì)電能信號(hào)的采集、處理、存儲(chǔ)與顯示等功能，實(shí)現(xiàn)了實(shí)時(shí)系統(tǒng)的要求。
關(guān)鍵字： FPGA NiosⅡ

電能質(zhì)量監(jiān)測(cè)系統(tǒng)信號(hào)采集模塊控制器IP核設(shè)計(jì)

　　隨著可編程邏輯器件的不斷進(jìn)步和發(fā)展，F(xiàn)PGA在嵌入式系統(tǒng)中發(fā)揮著越來(lái)越重要的作用。本文介紹的在電能質(zhì)量監(jiān)測(cè)系統(tǒng)中信號(hào)采集模塊控制器的 IP核，是采用硬件描述語(yǔ)言來(lái)實(shí)現(xiàn)的。首先它是以ADS8364芯片為控制對(duì)象，結(jié)合實(shí)際電路，將6通道同步采樣的16位數(shù)據(jù)存儲(chǔ)到FIFO控制器。當(dāng)FIFO 控制器存儲(chǔ)一個(gè)周期的數(shù)據(jù)后，產(chǎn)生一個(gè)中斷信號(hào)，由PowerPC對(duì)其進(jìn)行高速讀取。這樣能夠減輕CPU的負(fù)擔(dān)，不需要頻繁地對(duì)6通道的采樣數(shù)據(jù)進(jìn)行讀取，節(jié)省了CPU運(yùn)算資源。　　1 ADS8364芯片的原理與具體應(yīng)用　
關(guān)鍵字： FPGA 信號(hào)采集

Xilinx將推出16nm的FPGA和SoC，融合存儲(chǔ)器、3D-on-3D和多處理SoC技術(shù)

　　賽靈思公司 (Xilinx+)日前宣布，其16nm UltraScale+? 系列FPGA、3D IC和MPSoC憑借新型存儲(chǔ)器、3D-on-3D和多處理SoC(MPSoC)技術(shù)，再次實(shí)現(xiàn)了領(lǐng)先的價(jià)值優(yōu)勢(shì)。此外，為實(shí)現(xiàn)更高的性能和集成度，UltraScale+系列還采用了全新的互聯(lián)優(yōu)化技術(shù)——SmartConnect。這些新的器件進(jìn)一步擴(kuò)展了賽靈思的UltraScale產(chǎn)品系列 (現(xiàn)從20nm 跨越至 16nm FPGA、SoC 和3D IC器件)，同時(shí)利用臺(tái)積電公
關(guān)鍵字：賽靈思 FPGA SoC UltraScale 201503

ADI：用AD936x打通SDR之路

　　軟件定義無(wú)線電(SDR)提出已二三十年，限于高昂的成本和復(fù)雜的實(shí)現(xiàn)方案，一直以來(lái)是軍事等少數(shù)高端應(yīng)用的獨(dú)寵。近日，ADI渠道管理及新興市場(chǎng)事業(yè)部高級(jí)客戶(hù)應(yīng)用經(jīng)理章新明發(fā)表了“軟件定義無(wú)線電(SDR)的創(chuàng)新應(yīng)用”的演講，以ADI自2013年以來(lái)推出的AD936x系列射頻捷變頻收發(fā)器為例，稱(chēng)AD9361和AD9364上市以來(lái)供不應(yīng)求，并看好在無(wú)人飛行器、LTE通信基礎(chǔ)實(shí)施、以及防務(wù)電子等領(lǐng)域的應(yīng)用。集成式的RF收發(fā)器AD936x的優(yōu)勢(shì)在于為多種無(wú)線電方案提供統(tǒng)一的可再編程無(wú)線電平
關(guān)鍵字： ADI RF SDR 201503

京微雅格將在 2015慕尼黑上海電子展演示多領(lǐng)域FPGA應(yīng)用方案

?????? 京微雅格(北京)科技有限公司(以下簡(jiǎn)稱(chēng)“京微雅格”)宣布將參加 3月 17 日至 19 日在上海舉行的 2015慕尼黑上海電子展?；顒?dòng)期間，京微雅格將展示其FPGA產(chǎn)品在多個(gè)市場(chǎng)領(lǐng)域的應(yīng)用方案，包括消費(fèi)電子、智能家居、金融安全、機(jī)器人、物聯(lián)網(wǎng)、汽車(chē)電子等。京微雅格展位號(hào)為半導(dǎo)體E3館3646，誠(chéng)邀您蒞臨參觀。　　 ? 　　圖一：將在慕尼黑上海電子展期間現(xiàn)場(chǎng)展示的部分已量產(chǎn)芯片　　FP
關(guān)鍵字：京微雅格 FPGA

小梅哥和你一起深入學(xué)習(xí)FPGA之實(shí)驗(yàn)?zāi)夸?/a>

　　注：帶“ * ”的表示選做，實(shí)際中根據(jù)時(shí)間和精力決定　　基本外設(shè)的驅(qū)動(dòng)開(kāi)發(fā)：? 　　1. 獨(dú)立按鍵消抖檢測(cè)電路模塊; 　　2. 4*4矩陣鍵盤(pán)消抖檢測(cè)電路模塊; 　　3. 7段8位數(shù)碼管驅(qū)動(dòng)電路模塊;(直接FPGA驅(qū)動(dòng) 和外加74hc138譯碼器) 　　4. 二進(jìn)制轉(zhuǎn)BCD碼模塊設(shè)計(jì); 　　5. uart串口收發(fā)電路模塊;(verilog 和 VHDL) 　　6. IIC驅(qū)動(dòng)電路模塊;(暫時(shí)沒(méi)定，會(huì)給出個(gè)24L64的驅(qū)動(dòng)，也會(huì)開(kāi)發(fā)一個(gè)傳感器驅(qū)動(dòng)) 　　7.

關(guān)鍵字： FPGA 串口

小梅哥和你一起深入學(xué)習(xí)FPGA之規(guī)范約定

　　本規(guī)范主要是對(duì)設(shè)計(jì)流程、端口名稱(chēng)、組織結(jié)構(gòu)、文檔編排進(jìn)行約定。本約定作用僅僅是為了使后期代碼設(shè)計(jì)和文檔編寫(xiě)更加規(guī)范有序，方便自己和讀者閱讀，與公司的設(shè)計(jì)規(guī)范還差著十萬(wàn)八千里，因此，望大家萬(wàn)不可以小梅哥的規(guī)范作為標(biāo)準(zhǔn)。當(dāng)然，小梅哥在規(guī)范約定時(shí)，也會(huì)盡量參考華為verilog規(guī)范和至芯科技的文檔編寫(xiě)規(guī)范力爭(zhēng)做到簡(jiǎn)潔通俗。　　規(guī)范約定之設(shè)計(jì)文檔基本結(jié)構(gòu) 　　為了將設(shè)計(jì)能夠清晰明了的介紹給大家，讓大家一看就懂，文檔編寫(xiě)時(shí)會(huì)詳細(xì)包含以下內(nèi)容：　　一、實(shí)驗(yàn)?zāi)康? 　　二、實(shí)驗(yàn)原理　　三、硬件設(shè)
關(guān)鍵字： FPGA 狀態(tài)機(jī)

Qorvo將在2015世界移動(dòng)通信大會(huì)上展示快速擴(kuò)充的RF解決方案產(chǎn)品組合

　　移動(dòng)應(yīng)用、基礎(chǔ)設(shè)施與航空航天/國(guó)防應(yīng)用中RF解決方案的領(lǐng)先供應(yīng)商Qorvo, Inc.今日宣布，公司將在2015年3月2日至3月5日期間于西班牙巴塞羅那舉辦的2015世界移動(dòng)通信大會(huì)上展示其不斷擴(kuò)充的射頻(RF)解決方案產(chǎn)品組合，這些產(chǎn)品方案可用于智能手機(jī)、平板電腦和其它移動(dòng)數(shù)據(jù)設(shè)備。Qorvo業(yè)界領(lǐng)先的產(chǎn)品組合包括分立式和高度集成式濾波器、開(kāi)關(guān)、功率放大器、天線調(diào)諧器、阻抗調(diào)諧器、低噪聲放大器、電源管理集成電路及其它高性能4G LTE解決方案。　　Qorvo即將展示的這些創(chuàng)新型產(chǎn)品包括公司最近發(fā)
關(guān)鍵字： Qorvo RF

Qorvo將成為射頻解決方案領(lǐng)域的全新領(lǐng)導(dǎo)者

　　移動(dòng)應(yīng)用、基礎(chǔ)設(shè)施與航空航天、國(guó)防應(yīng)用中RF解決方案的領(lǐng)先供應(yīng)商Qorvo, Inc.今日宣布，RF Micro Devices, Inc.與TriQuint Semiconductor, Inc.這兩家公司現(xiàn)已完成對(duì)等合并，并已組建射頻解決方案領(lǐng)域的全新領(lǐng)導(dǎo)者Qorvo™ 。目前，Qorvo已經(jīng)開(kāi)始在納斯達(dá)克全球精選市場(chǎng)(NASDAQ Global Stock Market)掛牌交易。　　Qorvo總裁兼首席執(zhí)行官Bob Bruggeworth表示：“對(duì)我們的公司、員工、
關(guān)鍵字： Qorvo RF

【從零開(kāi)始走進(jìn)FPGA】基于PLD的矩陣鍵盤(pán)狀態(tài)機(jī)控制

　　講過(guò)了獨(dú)立按鍵檢測(cè)，理所當(dāng)然應(yīng)該講講FPGA中矩陣鍵盤(pán)的應(yīng)用了。這個(gè)思維和電路在FPGA中有所不同，在此，在此做詳細(xì)解釋?zhuān)珺ingo用自己設(shè)計(jì)的成熟的代碼作為案例，希望對(duì)你有用。　　一、FPGA矩陣鍵盤(pán)電路圖　　在FPGA中的電路，與單片機(jī)雷同，如下所示：　　 ? 　　在上電默認(rèn)情況下，L[3:0] =4''b1，因?yàn)樯侠?.3V，而默認(rèn)情況下H.[3:0]為低電平;一旦有某一個(gè)按鍵被按下，便是是的該路電路流向該按鍵的H，是的L檢測(cè)不到電流。因此可以通過(guò)對(duì)每一行H輸出的
關(guān)鍵字： FPGA PLD