rf-fpga 文章進(jìn)入rf-fpga技術(shù)社區(qū)

千兆高速采集系統(tǒng)的硬件電路設(shè)計(jì)

　　1 ADC08D1000的結(jié)構(gòu) 　　ADC08D1000是NS(National Semiconductor，國(guó)家半導(dǎo)體)公司于2005年推出的雙通道低功耗的高速8位A／D轉(zhuǎn)換器，其最高單通道采樣頻率達(dá)l.3 GHz，全功率帶寬(FPBW)為1．7 GHz，在500 MHz標(biāo)準(zhǔn)信號(hào)輸入的情況下可以獲得7．4位的有效采樣位數(shù)。整個(gè)A／D轉(zhuǎn)換器用單電源1．9V供電，內(nèi)帶高質(zhì)量參考源和高性能采樣保持電路，每個(gè)通道均為差分輸入，采樣范圍可選為650 mV或870 mV(峰一峰值)。在高速數(shù)／模轉(zhuǎn)換系統(tǒng)中，有
關(guān)鍵字：硬件電路 NS A／D轉(zhuǎn)換器 FPGA LVDS

外形似集成電路的完整 DC/DC 解決方案為基于 FPGA 的系統(tǒng)帶來(lái)切實(shí)益處

FPGA工藝尺寸的進(jìn)步和更加靈活的設(shè)計(jì)配置、以及基于FPGA的系統(tǒng)取得的進(jìn)步已經(jīng)使FPGA制造商充滿信心地進(jìn)入了以前由微處理器和ASIC供應(yīng)商壟斷的市場(chǎng)。最近，Xilinx的VirtexTM和Altera的Stratix產(chǎn)品系列分別推出了新器件，進(jìn)一步縮小了性能差距，再次提高了性能標(biāo)準(zhǔn)。盡管這些器件的通用和可配置性吸引了系統(tǒng)設(shè)計(jì)師，但是控制這些器件內(nèi)部工作方式的設(shè)計(jì)規(guī)則及其外部接口協(xié)議的復(fù)雜性導(dǎo)致需要廣泛的培訓(xùn)、基準(zhǔn)設(shè)計(jì)評(píng)估、設(shè)計(jì)仿真和驗(yàn)證。因此，F(xiàn)PGA供應(yīng)商提供了詳盡的硬件和固件支持，旨在幫助系統(tǒng)設(shè)計(jì)
關(guān)鍵字： DC/DC ，解決方案，F(xiàn)PGA

安富利電子元件部推出Virtex-5 FXT FPGA評(píng)估工具套件

　　安富利公司 (NYSE: AVT) 旗下安富利電子元件部宣布推出Xilinx® Virtex®-5 FXT FPGA 評(píng)估工具套件。該套件以Xilinx最新的Virtex-5 FXT 現(xiàn)場(chǎng)門陣列(FPGA)為基礎(chǔ)，還包括了一塊評(píng)估板、ISE® Design Suite 10.1 WebPACK™ 設(shè)計(jì)工具、評(píng)估版Embedded Development Kit (EDK)軟件、電源并能獲得參考設(shè)計(jì)和設(shè)計(jì)指南等資料。此套件成本低廉，是意圖研究Virtex-5 FXT平
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便攜式功耗管理的宇宙中心

　　便攜式產(chǎn)品對(duì)功率設(shè)計(jì)極為講究。低功耗技術(shù)往往是一家公司的核心競(jìng)爭(zhēng)力。在便攜式等市場(chǎng)上，客戶需要最優(yōu)的價(jià)格－效率－性能比。這意味著在體系架構(gòu)方面，選出最佳的電源轉(zhuǎn)換拓?fù)浣Y(jié)構(gòu)。　　那么，在功耗設(shè)計(jì)中，系統(tǒng)、軟、硬件管理誰(shuí)是宇宙的中心？在近日舊金山舉辦的Electronic Summit2008上，Intersil公司負(fù)責(zé)便攜式業(yè)務(wù)的高級(jí)產(chǎn)品市場(chǎng)行銷經(jīng)理Andrew Baker介紹了該公司的經(jīng)驗(yàn)。　　Intersil把各部分劃分為兩個(gè)部分：　　1，?系統(tǒng)及軟件性的功耗管理；　　2，
關(guān)鍵字：低功耗便攜式 RF 開(kāi)關(guān)穩(wěn)壓器 LDO

Darfon在無(wú)線鼠標(biāo)的超小型收發(fā)器中采用賽普拉斯PRoC LP可編程片上射頻系統(tǒng)

　　賽普拉斯宣布達(dá)方電子公司 (Darfon) 在其用于無(wú)線鼠標(biāo)的最新超小型收發(fā)器中采用了賽普拉斯的 PRoC? LP 可編程片上射頻系統(tǒng)。該小型收發(fā)器約為一枚一角硬幣大小，其采用全集成 CYRF69213 PRoC LP 器件來(lái)為Darfon的鼠標(biāo)提供高可靠性、低功耗無(wú)線連接。　　與大多數(shù)無(wú)線 USB 收發(fā)器不同的是，Darfon微型收發(fā)器主要面向筆記本電腦市場(chǎng)，其伸出電腦機(jī)身的長(zhǎng)度還不到 5 毫米，從而盡可能避免了意外接觸造成的損壞。PRoC LP 在同一封裝中集成了賽普拉斯的 2.4
關(guān)鍵字： Darfon 無(wú)線賽普拉斯射頻 RF USB

基于FPGA的高速流水線FFT算法實(shí)現(xiàn)

　　0 引言　　有限長(zhǎng)序列的DFT(離散傅里葉變換)特點(diǎn)是能夠?qū)㈩l域的數(shù)據(jù)離散化成有限長(zhǎng)的序列。但由于DYT本身運(yùn)算量相當(dāng)大，限制了它的實(shí)際應(yīng)用。FFT(快速傅里葉變換)算法是作為DFT的快速算法提出，它將長(zhǎng)序列的DFT分解為短序列的DFT，大大減少了運(yùn)算量，使得DFT算法在頻譜分析、濾波器設(shè)計(jì)等領(lǐng)域得到了廣泛的應(yīng)用。　　FPGA(現(xiàn)場(chǎng)可編程門陣列)是一種具有大規(guī)模可編程門陣列的器件，不僅具有專用集成電路(ASIC)快速的特點(diǎn)，更具有很好的系統(tǒng)實(shí)現(xiàn)的靈活性。FPGA可通過(guò)開(kāi)發(fā)工具實(shí)現(xiàn)在線編程。與C
關(guān)鍵字： FPGA FFT 集成電路 DFT

不可或缺的射頻測(cè)試

最近主要的半導(dǎo)體制造商承認(rèn)：研發(fā)和生產(chǎn)先進(jìn)的IC芯片非常需要晶圓級(jí)的射頻(RF)測(cè)試。在一定程度上，這公然...
關(guān)鍵字：晶圓漏電非線性高頻 RF 數(shù)字節(jié)點(diǎn)

Altera Stratix III FPGA的LVDS I/O支持SGMII

　　Altera公司今天宣布，Stratix® III FPGA在其LVDS I/O上支持串行千兆位介質(zhì)無(wú)關(guān)接口(SGMII)。Stratix III LVDS I/O的接口速率達(dá)到1.25 Gbps，滿足SGMII嚴(yán)格的抖動(dòng)性能要求，支持不含收發(fā)器的三速以太網(wǎng)(10/100/1000 Mbps)接口。Stratix III FPGA是業(yè)界首款在LVDS引腳上支持千兆以太網(wǎng)SGMII的可編程邏輯器件，降低了每個(gè)器件的成本和功耗，提供更多的接口。　　Stratix III FPGA的SGMII
關(guān)鍵字： Altera Stratix III FPGA SGMII 以太網(wǎng)

突發(fā)通信中Turbo碼的FPGA實(shí)現(xiàn)

　　Turbo碼一種低信噪比條件下也能達(dá)到優(yōu)異糾錯(cuò)性能的信道編碼。早期為了強(qiáng)調(diào)Turbo碼接近香農(nóng)限的優(yōu)異性能，研究的碼字度非常大[1～2]，存在譯碼復(fù)雜度大、譯碼時(shí)延長(zhǎng)等問(wèn)題。突發(fā)數(shù)據(jù)通信以傳輸中小長(zhǎng)度的數(shù)據(jù)報(bào)文業(yè)務(wù)為主，所以突發(fā)通信中的Turbo碼的碼長(zhǎng)也是中等長(zhǎng)度以下的。本文面向突發(fā)數(shù)據(jù)通信中的信道編碼應(yīng)用，研究了短幀長(zhǎng)Turbo碼編譯碼算法的FPGA實(shí)現(xiàn)。實(shí)現(xiàn)中采用了優(yōu)化的編譯碼算法，以降低譯碼復(fù)雜度和譯碼延時(shí)。最后仿真和測(cè)試了Turbo譯碼器的糾錯(cuò)性能和吞吐量。　　1 Turbo碼編碼器的F
關(guān)鍵字： Turbo FPGA RSC

安富利電子元件部推出低成本Spartan-3A FPGA評(píng)估工具套件

　　安富利公司 (NYSE: AVT) 旗下安富利電子元件部宣布推出價(jià)格僅為39美元Xilinx® Spartan®-3A 評(píng)估工具套件。這套件工具上裝有Xilinx的 Spartan-3A 400A 現(xiàn)場(chǎng)可編程門陣列 (FPGA)，為設(shè)計(jì)師評(píng)估或測(cè)試其針對(duì)低成本大批量應(yīng)用的設(shè)計(jì)提供了高性價(jià)比解決方案。　　設(shè)計(jì)師可以用Spartan-3A工具套件進(jìn)行FPGA原型設(shè)計(jì)、研究Xilinx MicroBlaze™軟處理器、嘗試各種不同的FPGA配置技術(shù)以及驗(yàn)證低成本的FPGA設(shè)計(jì)
關(guān)鍵字：安富利 Spartan-3A FPGA

基于FPGA的高速PID控制器設(shè)計(jì)與仿真

　　在CNC(電腦數(shù)控)加工、激光切割、自動(dòng)化磨輥弧焊系統(tǒng)、步進(jìn)／伺服電機(jī)控制及其他由電機(jī)控制的機(jī)械組裝定位運(yùn)動(dòng)控制系統(tǒng)中，PID控制器應(yīng)用得非常廣泛。其設(shè)計(jì)技術(shù)成熟，長(zhǎng)期以來(lái)形成了典型的結(jié)構(gòu)，參數(shù)整定方便，結(jié)構(gòu)更改靈活，能滿足一般控制的要求。　　此類運(yùn)動(dòng)控制系統(tǒng)的被控量常為速度、角度等模擬量，被控量與設(shè)定值之間的誤差值經(jīng)離散化處理后，可由數(shù)字PID控制器實(shí)現(xiàn)的控制算法加以運(yùn)算，最后再轉(zhuǎn)換為模擬量反饋給被控對(duì)象，這就是PID控制中常用的近似逼近原理。　　采用這種結(jié)構(gòu)設(shè)計(jì)的控制系統(tǒng)，其性能只能與原連
關(guān)鍵字： FPGA PID控制器 A／D變換 EDA

釋放未來(lái)物理硬件設(shè)計(jì)的無(wú)限潛力

　　能否創(chuàng)建真正具有競(jìng)爭(zhēng)力的產(chǎn)品在本質(zhì)上取決于設(shè)計(jì)是否有優(yōu)勢(shì)，能否在市場(chǎng)獲得認(rèn)可。過(guò)去，組件在電路板上排布與連接的方式具有很高的區(qū)分度。而今天，業(yè)界不斷的全球化和接口的標(biāo)準(zhǔn)化讓板級(jí)的區(qū)分更加困難也更加難以維持。　　隨著技術(shù)不斷進(jìn)步，電子產(chǎn)品也在不斷發(fā)展，當(dāng)今可以真正區(qū)分產(chǎn)品的通常是嵌入在該器件中的智能水平-這一趨勢(shì)從20年前經(jīng)濟(jì)的微處理器快速發(fā)展時(shí)就開(kāi)始顯現(xiàn)。向軟領(lǐng)域的發(fā)展意味著產(chǎn)品的真正價(jià)值主要由器件中的編程智能實(shí)現(xiàn)，而不是取決于其所屬的物理平臺(tái)屬性。　　對(duì)于電子產(chǎn)品開(kāi)發(fā)公司，這意味著花在板級(jí)實(shí)
關(guān)鍵字： FPGA PCB NanoBoard

JavaCard CPU的設(shè)計(jì)與FPGA實(shí)現(xiàn)

　　1 JavaCard簡(jiǎn)介　　智能卡是指集成了CPU、ROM、RAM、COS(芯片操作系統(tǒng))和EEPROM，能儲(chǔ)存信息和圖像，具備讀/寫(xiě)能力，信息能被加密保護(hù)的便攜卡。智能卡的最基本標(biāo)準(zhǔn)是 ISO/IEC7816。智能卡在銀行、電信等行業(yè)得到廣泛應(yīng)用，但在發(fā)展過(guò)程中也遇到很多問(wèn)題，主要有：各廠商指令集不統(tǒng)一；編程接口APIs太復(fù)雜；開(kāi)發(fā)環(huán)境不通用，新卡開(kāi)發(fā)都要熟悉開(kāi)發(fā)環(huán)境；系統(tǒng)不兼容，?？▽Ｓ?。由于開(kāi)發(fā)門檻過(guò)高，影響了智能卡的發(fā)展。市場(chǎng)對(duì)智能卡的發(fā)展提出了新的要求，Sun公司提出了Java Card
關(guān)鍵字： JavaCard CPU FPGA 智能卡

如何用DSP和FPGA構(gòu)建多普勒測(cè)量系統(tǒng)

隨著FPGA性能和容量的改進(jìn)，使用FPGA執(zhí)行DSP功能的做法變得越來(lái)越普遍。
關(guān)鍵字： FPGA DSP 多普勒測(cè)量系統(tǒng)

利用FPGA協(xié)處理提升無(wú)線子系統(tǒng)的性能

　　您可以顯著提高無(wú)線系統(tǒng)中信號(hào)處理功能的性能。怎樣提高呢？有效方法是利用FPGA結(jié)構(gòu)的靈活性和目前受益于并行處理的FPGA架構(gòu)中的嵌入式DSP模塊。　　常見(jiàn)于無(wú)線應(yīng)用中這類處理包括有限沖激響應(yīng)(FIR)濾波、快速傅里葉變換(FFT)、數(shù)字上下變頻和前向誤差校正(FEC)。Xilinx? Virtex-4和Virtex-5架構(gòu)提供多達(dá)512個(gè)并行嵌入式DSP乘法器，這些乘法器的工作頻率高于500MHz，最高可提供256 GMAC的DSP性能。　　將需要高速并行處理的工作卸載給FPGA，而將需要高速
關(guān)鍵字：信號(hào)處理 FPGA DSP