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一種并行存儲器系統(tǒng)的FPGA實現(xiàn)

  • 圍繞小衛(wèi)星體積小、重量輕和價格低廉的特點，一個多CPU共享內(nèi)存的系統(tǒng)（CPU仍然采用有相應(yīng)宇航級器件的8086）將是比較合適的選擇。同時為了提高共享內(nèi)存的數(shù)據(jù)通信帶寬，使其不成為整個系統(tǒng)的瓶頸，本文提出了一個用ASIC設(shè)計一個共享總線開關(guān)網(wǎng)絡(luò)（簡稱SBSN，下同），組合成Omega網(wǎng)絡(luò)的方案，以消除對某一組內(nèi)存的總線競爭，實現(xiàn)多CPU對共享分組存儲系統(tǒng)的低位交叉并行訪問。
  • 關(guān)鍵字： 并行存儲器  多CPU共享內(nèi)存  FPGA  

一個進位保留加法陣列的HDL代碼生成器

  • 多加數(shù)的加法器是FPGA的一個比較常見的應(yīng)用。仿真對比了其三種實現(xiàn)方案的性能和所消耗資源，得出進位保留加法陣列是首選方案。針對進位保留加法陣列實現(xiàn)的復(fù)雜性給出了一個加法陣列的HDL代碼生成器，極大地簡化了加法陣列的設(shè)計工作。
  • 關(guān)鍵字： HDL代碼生成器  加法器  FPGA  

基于FPGA的IDE硬盤數(shù)據(jù)AES加解密研究與實現(xiàn)

  • 提出了基于FPGA對IDE硬盤數(shù)據(jù)進行AES加解密的方法。對算法進行了改進和優(yōu)化，以降低加解密過程對IDE硬盤數(shù)據(jù)傳輸速度的影響。
  • 關(guān)鍵字： AES加解密  IDE  FPGA  

面積優(yōu)先的分組密碼算法SMS4 IP核設(shè)計

  • 對新分組密碼算法SMS4進行了FPGA實現(xiàn)。所設(shè)計的SMS4算法的IP核主要包括具有加解密功能的非流水線式數(shù)據(jù)通路和實時產(chǎn)生子密鑰的密鑰擴展模塊，并且支持電子密碼本(ECB)和分組鏈接(CBC)兩種工作模式。提出了一種不含密鑰初始化的運行模式，使解密吞吐率提高近一倍。
  • 關(guān)鍵字： 分組密碼  IP核  FPGA  

基于FPGA的全數(shù)字鎖相環(huán)路的設(shè)計

  • 介紹了應(yīng)用VHDL技術(shù)設(shè)計嵌入式全數(shù)字鎖相環(huán)路的方法。詳細(xì)敘述了其工作原理和設(shè)計思想，并用可編程邏輯器件FPGA予以實現(xiàn)。
  • 關(guān)鍵字： VHDL  數(shù)字鎖相環(huán)  FPGA  

基于FPGA和TMS320DM642的CCD圖像采集和處理系統(tǒng)硬件設(shè)計

  • 為能高速、有效、實時采集CCD視頻圖像，提出了一種實時視頻圖像采集和處理系統(tǒng)設(shè)計方案。重點介紹其硬件設(shè)計原理、關(guān)鍵電路的設(shè)計，其主要功能是從CCD攝像頭輸出的模擬視頻信號中提取實時圖像，數(shù)字化后送入處理器作后期圖像處理和分析。
  • 關(guān)鍵字： CCD視頻  DM642  FPGA  圖像采集  

利用FPGA技術(shù)實現(xiàn)數(shù)字通信中的交織器和解交織器

  • 介紹用FPGA實現(xiàn)數(shù)字通信中的交、解交織器的一種比較通用的方案，詳細(xì)說明了設(shè)計中的一些問題及解決辦法。還介紹了一種實現(xiàn)FPGA中信號延時的方法。
  • 關(guān)鍵字： 數(shù)字通信  交織器  FPGA  信號延時  

基于FPGA的小型星載非制冷紅外成像系統(tǒng)設(shè)計與實現(xiàn)

  • 根據(jù)內(nèi)編隊重力場衛(wèi)星紅外成像工作環(huán)境的溫度要求，選取了非制冷長波紅外焦平面陣列探測器——UL 03 16 2，并在此基礎(chǔ)上進行了系統(tǒng)的軟硬件設(shè)計。
  • 關(guān)鍵字： 非制冷紅外成像  MircoBlaze  FPGA  

基于FPGA的高速并行Viterbi譯碼器的設(shè)計與實現(xiàn)

  • 針對319卷積編碼，提出一種Viterbi譯碼器的FPGA實現(xiàn)方案。該方案兼顧了資源消耗和譯碼效率，通過有效的時鐘和存儲介質(zhì)復(fù)用，實現(xiàn)了高速并行的譯碼功能，并利用Verilog語言在Xilinx ISE 6．2中進行了建模仿真和綜合實現(xiàn)。
  • 關(guān)鍵字： 卷積編碼  Viterbi譯碼器  FPGA  

FPGA加速三維CT圖像重建

  • 針對三維圖像重建的經(jīng)典算法(FDK算法)在FPGA上的加速，提出了并行無等待流水線的實現(xiàn)方法。實驗結(jié)果表明，該方法獲得了較高的加速比。
  • 關(guān)鍵字： 三維圖像重建  FDK算法  FPGA  

一種改進Turbo碼譯碼器的FPGA設(shè)計與實現(xiàn)

  • 提出了一種基于MAX-Log-MAP算法的更有效減小譯碼延時的方法，通過并行計算前向狀態(tài)度量和后向狀態(tài)度量，將半次迭代譯碼延時縮短一半，而譯碼性能沒有損失，同時也減小了硬件實現(xiàn)中的時序控制復(fù)雜度。
  • 關(guān)鍵字： Turbo碼  迭代譯碼  FPGA  

基于FPGA的立體視頻轉(zhuǎn)換系統(tǒng)

  • 給出了以FPGA為核心、針對自由立體顯示器的立體視頻格式轉(zhuǎn)換系統(tǒng)的設(shè)計與實現(xiàn)方法。詳細(xì)介紹了系統(tǒng)的硬件構(gòu)成和FPGA邏輯設(shè)計，包括DVI控制、視頻格式轉(zhuǎn)換以及數(shù)據(jù)緩沖系統(tǒng)等。
  • 關(guān)鍵字： 視頻格式轉(zhuǎn)換  數(shù)據(jù)緩沖系統(tǒng)  FPGA  

用FPGA實現(xiàn)優(yōu)化的指紋識別預(yù)處理算法

  • 在選取較優(yōu)化的指紋識別預(yù)處理算法的基礎(chǔ)上，根據(jù)算法的結(jié)構(gòu)選取具有并行處理、低功耗、速度快等特點的FPGA作為實現(xiàn)算法的基本器件。由于用FPGA實現(xiàn)復(fù)雜算法較傳統(tǒng)器件從思考角度和實現(xiàn)方向上都有很大區(qū)別，所以本次設(shè)計從新的方向來完成傳統(tǒng)的指紋處理的設(shè)計。
  • 關(guān)鍵字： 指紋識別  預(yù)處理  FPGA  

基于FPGA的FIR濾波器的實現(xiàn)

  • 提出了一種采用現(xiàn)場可編程門陣列器件FPGA并利用窗函數(shù)法實現(xiàn)線性FIR數(shù)字濾波器硬件電路的方案，并以一個十六階低通FIR數(shù)字濾波器電路的實現(xiàn)為例說明了利用Xilinx公司XC4000系列芯片的設(shè)計過程。設(shè)計的電路通過軟件程序進行了驗證和硬件仿真，結(jié)果表明電路工作正確可靠，能滿足設(shè)計要求。
  • 關(guān)鍵字： FIR濾波器  窗函數(shù)  FPGA  

IIR數(shù)字濾波器的FPGA仿真與實現(xiàn)

  • 采用自頂向下的模塊化設(shè)計思想，介紹了一種采用級聯(lián)結(jié)構(gòu)在FPGA上實現(xiàn)IIR數(shù)字濾波器的設(shè)計方案。設(shè)計IIR數(shù)字濾波器的二階節(jié)，將二階節(jié)IIR數(shù)字濾波器級聯(lián)實現(xiàn)高階IIR數(shù)字濾波器，從而實現(xiàn)通過修改外圍參數(shù)來改變?yōu)V波器的頻率響應(yīng),根據(jù)不同的要求在不同規(guī)模的FPGA上加以實現(xiàn)。
  • 關(guān)鍵字： IIR數(shù)字濾波器  級聯(lián)結(jié)構(gòu)  FPGA  
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