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14位125MSPS四通道ADC電路圖(通過后端數(shù)字求和增強(qiáng)SNR性能)
- 14位125MSPS四通道ADC電路圖(通過后端數(shù)字求和增強(qiáng)SNR性能)-所示電路是14位、125 MSPS四通道ADC系統(tǒng)的簡化圖,該電路使用后端數(shù)字求和將信噪比(SNR)從單通道ADC的 74 dBFS提升到四通道ADC的78.5 dBFS。這項(xiàng)技術(shù)特別適合要求高SNR(如超聲和雷達(dá))的應(yīng)用,并且利用了現(xiàn)代高性能、低功耗、四通道流水線式ADC。##表2總結(jié)了系統(tǒng)的測量性能,其中?3 dB帶寬為67 MHz。網(wǎng)絡(luò)的總插入損耗約為3dB,因此需要+13dBm的輸入驅(qū)動能力,以便為ADC的輸入提供滿量程2V
- 關(guān)鍵字: ADC ADI SNR
模數(shù)轉(zhuǎn)換器中的噪聲系數(shù)
- 模數(shù)轉(zhuǎn)換器中的噪聲系數(shù)-
- 關(guān)鍵字: ADI ADC 數(shù)模轉(zhuǎn)換
交錯式ADC的基礎(chǔ)知識
- 交錯式ADC的基礎(chǔ)知識-交錯式ADC具有十分廣闊的應(yīng)用空間。在通信基礎(chǔ)設(shè)施中,存在著一種推動因素,使ADC的采樣速率不斷提高,以便在諸如DPD(數(shù)字預(yù)失真)等線性化技術(shù)中支持多頻段、多載波無線電,同時滿足更寬的帶寬要求。
- 關(guān)鍵字: ADC
逐次逼近型ADC:確保首次轉(zhuǎn)換有效
- 逐次逼近型ADC:確保首次轉(zhuǎn)換有效-最高18位分辨率、10 MSPS 采樣速率的逐次逼近型模數(shù)轉(zhuǎn)換器(ADC)可以滿足許多數(shù)據(jù)采集應(yīng)用的需求,包括便攜式、工業(yè)、醫(yī)療和通信應(yīng)用。本文介紹如何初始化逐次逼近型 ADC 以實(shí)現(xiàn)有效轉(zhuǎn)換。
- 關(guān)鍵字: SAR 模數(shù)轉(zhuǎn)換器 逐次逼近型 ADC
計算ADC噪聲系數(shù)需知
- 計算ADC噪聲系數(shù)需知- 當(dāng)RF工程師首次計算哪怕是最好的低噪聲高速ADC的噪聲系數(shù)時,結(jié)果也可能相對高于典型RF增益模塊、低噪聲放大器等器件的噪聲系數(shù)。為了正確解讀結(jié)果,需要了解ADC在信號鏈中的位置。因此,當(dāng)處理ADC的噪聲系數(shù)時,務(wù)必小心謹(jǐn)慎。
- 關(guān)鍵字: ADC 噪聲系數(shù) RF系統(tǒng)設(shè)計 級聯(lián)噪聲系數(shù)
精密DAC連續(xù)更新需考慮的二階效應(yīng)
- 簡介 精密模數(shù)轉(zhuǎn)換器(ADC)的每秒采樣數(shù)具有明確定義且經(jīng)過測試,精密數(shù)模轉(zhuǎn)換器(DAC)則不然,其數(shù)據(jù)手冊中并未對此加以定義,因?yàn)镈AC的每秒采樣數(shù)取決于許多因素?! 《鄶?shù)情況下,DAC數(shù)字接口支持高達(dá)50 MHz的時鐘速率,假設(shè)輸入移位寄存器為24位,則每秒可以執(zhí)行2,000,000次寫操作。然而,此數(shù)值僅表示數(shù)字接口接受新DAC碼的能力,沒有考慮數(shù)字處理延遲、時延以及模擬模塊定時?! ∪绻鸇AC無任何內(nèi)部校準(zhǔn)程序,則延遲可以忽略,通常在數(shù)ns左右。如果DAC包含校準(zhǔn)例行程序,則延遲可
- 關(guān)鍵字: DAC ADC
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