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Altium推出采用Altera Cyclone III FPGA 的NanoBoard 3000

　　繼去年 9 月發(fā)布基于 NanoBoard 3000 的快速原型設(shè)計全新方案后，Altium日前又宣布推出采用 Altera Cyclone III® FPGA 的最新 NanoBoard 3000，從而進一步擴展了這一理念。　　新的開發(fā)板為電子設(shè)計人員繼續(xù)提供相同的軟硬件以及 NanoBoard 3000 可以直接使用的免專利費 IP，所不同的是，在其內(nèi)核中提供了具有 Altera 高性價比 Cyclone III® FPGA 電源。　　電子設(shè)計人員采用 NanoBoard
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低功耗FPGA電子系統(tǒng)優(yōu)化方法

首先與實測系統(tǒng)功耗進行對比，驗證了Xilinx公司ISE軟件包中FPGA功耗估算工具XPower的準(zhǔn)確性。然后對FPGA設(shè)計中影響系統(tǒng)功耗的幾個相互關(guān)聯(lián)的參數(shù)進行取樣，通過軟件估算不同樣點下的系統(tǒng)功耗，找到功耗最低的取樣點，得到最佳設(shè)計參數(shù)，從而達到優(yōu)化系統(tǒng)設(shè)計的目的。實驗中通過這種方法，在一個FPGA讀寫SRAM的系統(tǒng)中，在單位時間讀寫操作數(shù)固定的條件下，選取了讀寫頻率與讀寫時間占空比這兩個參數(shù)來優(yōu)化系統(tǒng)功耗。最終測試數(shù)據(jù)證明了該方法的正確性。
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基于MPC8260處理器和FPGA的DMA接口設(shè)計

引言在基于軟件無線電的某無線通信信號偵收平臺的設(shè)計中，天線接收到的信號經(jīng)過變頻器處理和A/D變換...
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基于JTAG邊界掃描方式的重構(gòu)控制器的設(shè)計

為充分利用硬件資源，滿足不同的應(yīng)用需求,本文提出了一種基于JTAG邊界掃描模式配置的重構(gòu)控制器，詳細介紹控制器的硬件實現(xiàn)以及配置流程，該控制器通過模擬JTAG接口時序及TAP狀態(tài)機的功能，實現(xiàn)在系統(tǒng)配置目標(biāo)可編程器件。
關(guān)鍵字： FPGA TAP狀態(tài)機 JTAG邊界掃描重構(gòu) 201001

FPGA的甜蜜時光

　　隨著2010年的來臨，當(dāng)今的全球電子公司紛紛做出明智而審慎的研發(fā)投資決定，以便借助創(chuàng)新的新產(chǎn)品，快速抓住新的市場機遇。FPGA越來越多地成為這些公司成功的關(guān)鍵。除了少數(shù)可超大批量生產(chǎn)的商品外，應(yīng)用ASIC的高成本和高風(fēng)險無法讓絕大多數(shù)的商品贏利;現(xiàn)在面臨著加速替代ASIC所帶來的機遇，這主要體現(xiàn)在以下不同方面：芯片體系結(jié)構(gòu)，也就是能夠推出某種架構(gòu)和相關(guān)的I/O，而且，密度和性能還能夠達到一定水平，從而可以替代ASIC的功能。軟件在加速替代ASIC過程中也扮演了重要角色。高效的軟件和設(shè)計工具大大提高了
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臺積電年中將為Altera試產(chǎn)28nm制程FPGA芯片

　　據(jù)業(yè)者透露，臺積電公司將于今年中期開始為Altera公司生產(chǎn)28nm制程FPGA芯片產(chǎn)品。這種FPGA芯片將集成有28Gbps收發(fā)器，產(chǎn)品面向云計算，在線存儲以及移動視頻等應(yīng)用，Altera公司兩年前曾推出該系列產(chǎn)品的 40nm制程版本。臺積電還宣布其28nm制程將為全代制程(full node:即制程升級時需要對芯片電路進行重新設(shè)計),而且年內(nèi)其28nm制程還將具備可按客戶的需求制作出HKMG(High-K絕緣層+金屬柵極)或SiON(SiON絕緣層+硅柵極)這兩種不同柵極結(jié)構(gòu)的能力. 　　臺積電
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基于FPGA和MB86S02的數(shù)字圖像處理系統(tǒng)設(shè)計

介紹了基于SOPC技術(shù)的嵌入式數(shù)字圖像處理系統(tǒng)的設(shè)計方法，該系統(tǒng)以Alteral公司的Nios嵌入式軟件處理器為核心來分別對圖像的采集、存儲，圖像處理，顯示等功能模塊進型結(jié)構(gòu)設(shè)計，最后把處理數(shù)據(jù)通過網(wǎng)絡(luò)發(fā)送到接收端，從而完成了利用嵌入式系統(tǒng)和Internet技術(shù)的信息溝通。
關(guān)鍵字：處理理系設(shè)計圖像數(shù)字 FPGA MB86S02 基于

高速流水線浮點加法器的FPGA實現(xiàn)

本工程設(shè)計完全符合IP核設(shè)計的規(guī)范流程，而且完成了Verilog HDL建模、功能仿真、綜合、時序仿真等IP核設(shè)計的整個過程，電路功能正確。實際上，本系統(tǒng)在布局布線后，其系統(tǒng)的最高時鐘頻率可達80MHz。雖然使用浮點數(shù)會導(dǎo)致舍入誤差，但這種誤差很小，可以忽略。實踐證明，本工程利用流水線結(jié)構(gòu)，方便地實現(xiàn)了高速、連續(xù)、大數(shù)據(jù)量浮點數(shù)的加法運算，而且設(shè)計結(jié)構(gòu)合理，性能優(yōu)異，可以應(yīng)用在高速信號處理系統(tǒng)中。
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理解FPGA 中的壓穩(wěn)態(tài)

理解FPGA 中的壓穩(wěn)態(tài) 本白皮書介紹FPGA 中的壓穩(wěn)態(tài)，為什么會出現(xiàn)這一現(xiàn)象，它是怎樣導(dǎo)致設(shè)計失敗的。介紹怎樣計算壓穩(wěn)態(tài)MTBF，重點是對結(jié)果造成影響的各種器件和設(shè)計參數(shù)。
引言
當(dāng)信號在不相關(guān)或者異步時鐘域
關(guān)鍵字： FPGA 壓穩(wěn)態(tài)

采用帶有收發(fā)器的全系列40-nm FPGA 和ASIC 實現(xiàn)創(chuàng)

人們對寬帶服務(wù)的帶寬要求越來越高，促使芯片供應(yīng)商使用更多的高速串行收發(fā)器。因此，下一代應(yīng)用采用了多種數(shù)據(jù)速率，從幾Mbps 到數(shù)百Gbps，在一種設(shè)備中集成了多種協(xié)議和服務(wù)。以太網(wǎng)等迅速發(fā)展的標(biāo)準(zhǔn)以及對提高
關(guān)鍵字： FPGA ASIC 40 nm

基于FPGA的掃頻信號源的研究與設(shè)計

介紹掃頻電路和DDS技術(shù)的原理，利用FPGA設(shè)計一個以DDS技術(shù)為基礎(chǔ)的掃頻信號源，給出用Verilog語言編程的實現(xiàn)方案和實現(xiàn)電路。并通過采用流水線技術(shù)提高了相位累加器的運算速度，通過改進ROM壓縮算法以減小存儲器的容量，完成了對整個系統(tǒng)的優(yōu)化設(shè)計。運用QuartusⅡ軟件仿真驗證了程序設(shè)計的正確性，最終在硬件電路上實現(xiàn)了該掃頻信號源。
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Altera 發(fā)布28-nm FPGA技術(shù)創(chuàng)新

　　Altera公司今天宣布了在即將推出的28nm FPGA中采用的創(chuàng)新技術(shù)：嵌入式HardCopy®模塊、部分重新配置新方法以及嵌入式28-Gbps收發(fā)器，這些技術(shù)將極大的提高下一代Altera® FPGA的密度和I/O性能，并進一步鞏固相對于ASIC和ASSP的競爭優(yōu)勢。　　快速增長的寬帶應(yīng)用如高清晰(HD)視頻、云計算、網(wǎng)絡(luò)數(shù)據(jù)存儲和移動視頻等對基礎(chǔ)設(shè)備和最終用戶設(shè)備開發(fā)人員提出了新挑戰(zhàn)。他們怎樣才能夠迅速提高系統(tǒng)帶寬，同時滿足嚴(yán)格的功耗和成本要求呢?Altera開發(fā)了最新的創(chuàng)新
關(guān)鍵字： Altera 28nm FPGA

基于DSP和FPGA的通用圖像處理平臺設(shè)計

關(guān)鍵字： DSP FPGA 圖像處理

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xilinx fpga介紹

　　Xilinx FPGA 　　Xilinx FPGA主要分為兩大類，一種側(cè)重低成本應(yīng)用，容量中等，性能可以滿足一般的邏輯設(shè)計要求，如Spartan系列；還有一種側(cè)重于高性能應(yīng)用，容量大，性能能滿足各類高端應(yīng)用，如Virtex系列，用戶可以根據(jù)自己實際應(yīng)用要求進行選擇。在性能可以滿足的情況下，優(yōu)先選擇低成本器件。　　Xilinx FPGA可編程邏輯解決方案縮短了電子設(shè)備制造商開發(fā)產(chǎn)品的時間 [ 查看詳細 ]