xilinx fpga 文章進入xilinx fpga技術(shù)社區(qū)

使用ISE設(shè)計工具優(yōu)化FPGA的功耗

　　自從Xilinx公司推出FPGA二十多年來，研發(fā)工作大大提高了FPGA的速度和面積效率，縮小了FPGA與ASIC之間的差距，使FPGA成為實現(xiàn)數(shù)字電路的優(yōu)選平臺。今天，功耗日益成為FPGA供應(yīng)商及其客戶關(guān)注的問題。　　降低FPGA功耗是降低封裝和散熱成本、提高器件可靠性以及打開移動電子設(shè)備等新興市場之門的關(guān)鍵。　　Xilinx在提供低功耗FPGA解決方案方面較有經(jīng)驗。本文說明如何應(yīng)用計算機輔助設(shè)計(CAD)技術(shù)，如Xilinx ISE(集成軟件環(huán)境)9.2i版本軟件使功能有效降低。　　CM
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Actel推動最低功耗FPGA進入便攜式顯示屏領(lǐng)域

　　Actel公司宣布繼續(xù)專注于新興的高增長便攜式應(yīng)用市場，并推出專為液晶顯示 (LCD) 控制應(yīng)用設(shè)計的靈活的低功耗方案。新推出的IGLOO視頻演示板、帶有LCD面板的LCD適配器板、IGLOO視頻演示工具 (IVDK) 以及顯示相關(guān)的參考設(shè)計，都充分利用了該公司領(lǐng)先業(yè)界的5µW Actel IGLOO FPGA 的優(yōu)勢。Actel預(yù)期這三款產(chǎn)品將會吸引便攜及手持式消費電子、工業(yè)、醫(yī)療、汽車及軍用設(shè)備等對功耗敏感的產(chǎn)品設(shè)計人員，用于其中小型 LCD 顯示設(shè)備中。　　隨著個人媒體播放器、M
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做FPGA設(shè)計時需注意的一些關(guān)鍵問題

不管你是一名邏輯設(shè)計師、硬件工程師或系統(tǒng)工程師，甚或擁有所有這些頭銜，只要你在任何一種高速和多協(xié)議的復(fù)雜系統(tǒng)中使用了FPGA，你就很可能需要努力解決好器件配置、電源管理、IP集成、信號完整性和其他的一些關(guān)鍵設(shè)計問題。不過，你不必獨自面對這些挑戰(zhàn)，因為在當(dāng)前業(yè)內(nèi)領(lǐng)先的FPGA公司里工作的應(yīng)用工程師每天都會面對這些問題，而且他們已經(jīng)提出了一些將令你的設(shè)計工作變得更輕松的設(shè)計指導(dǎo)原則和解決方案。 I/O信號分配可提供最多的多功能引腳、I/O標(biāo)準(zhǔn)、端接方案和差分對的FPGA在信號分配方面也具有最復(fù)
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Xilinx和Brilliant電信推出基于FPGA的電信級時序（Timing）解決方案

　　賽靈思公司和Brilliant 電信公司日前宣布：針對下一代有線和無線網(wǎng)絡(luò)推出業(yè)界第一個基于FPGA的電信級時序(Timing)解決方案。這一聯(lián)合開發(fā)的解決方案為下一代通信網(wǎng)絡(luò)設(shè)計人員提供了第一個嵌入式可編程解決方案，該方案具有無與倫比的靈活性、現(xiàn)場可升級能力和定制化能力。通過將時序功能集成到賽靈思FPGA器件中，這一解決方案可顯著降低成本。在賽靈思Virtex™ 或 Spartan™ FPGA中實現(xiàn)的這一解決方案以兩款知識產(chǎn)權(quán)(IP)內(nèi)核—NGNTime 和 FemtoTim
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一種基于FPGA的準(zhǔn)單輸入調(diào)變序列生成器設(shè)計

　　1.引言　　隨著集成電路復(fù)雜度越來越高，測試開銷在電路和系統(tǒng)總開銷中所占的比例不斷上升，測試方法的研究顯得非常突出。目前在測試源的劃分上可以采用內(nèi)建自測試或片外測試。內(nèi)建自測試把測試源和被測電路都集成在芯片的內(nèi)部，對于目前SOC級的芯片測試如果采用內(nèi)建自測試則付出的硬件面積開銷則是很大的，同時也增加了芯片設(shè)計的難度：因此片外測試便成為目前被普遍看好的方法。由于FPGA具有可重構(gòu)的靈活性，利用FPGA來作為測試源實現(xiàn)片外測試就是一種非常有效的手段。　　由于偽隨機模式測試只需要有限個數(shù)的輸入向量便
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ARM7與FPGA相結(jié)合在工業(yè)控制和故障檢測中的應(yīng)用(圖)

ARM7與FPGA相結(jié)合在工業(yè)控制和故障檢測中的應(yīng)用(圖),
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FPGA新手入門

FPGA簡介 FPGA是英文Field Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在可編程陣列邏輯PAL(Programmable Array Logic)、門陣列邏輯GAL(Gate Array Logic)、可編程邏輯器件PLD(Programmable Logic Device)等可編程器件的基礎(chǔ)什么是FPGA上進一步發(fā)展的產(chǎn)
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基于FPGA的串行Flash擴展實現(xiàn)

　　1 引言　　FPGA憑借其方便靈活、可重復(fù)編程等優(yōu)點而日益被廣泛應(yīng)用;閃速存儲器(Flash Memory)以其集成度高、成本低、使用方便等優(yōu)點，在眾多領(lǐng)域中也獲得了廣泛應(yīng)用。在現(xiàn)代數(shù)字電路設(shè)計中。經(jīng)常需要保存大量數(shù)據(jù)，而Flash存儲速度快、體積小、功耗低且價格低廉，可在線電擦寫，信息在掉電后不會丟失，因此成為設(shè)計人員的首選。　　2 M25P80的介紹　　Flash是一種具有電可擦除的可編程ROM，可以分為兩大類：并行Flash和串行Flash。并行Flash存儲量大，速度快;而串行Fl
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地面數(shù)字電視符號與載波同步的FPGA實現(xiàn)

　　1 引言　　中國于2006年8月頒布了數(shù)字電視的地面廣播標(biāo)準(zhǔn)GB20600-2006，成為繼美國ATSC、歐洲D(zhuǎn)VB-T、日本ISDB-T之后又一重要的地面數(shù)字電視廣播的國家標(biāo)準(zhǔn)。GB20600-2006中對中國數(shù)字電視地面?zhèn)鬏?DigitalTerrestrial Television Broadcasting，DTTB)系統(tǒng)傳輸?shù)膸Y(jié)構(gòu)、信道編碼和調(diào)制作了具體的規(guī)定。其中幀結(jié)構(gòu)的基本單元——信號幀采用了循環(huán)擴展的時域幀頭結(jié)構(gòu)，即在每3780個符號的幀體前加入一定長度的經(jīng)循環(huán)擴展后的偽隨機序列作
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Xilinx推出針對Intel前端總線（FSB）的FPGA加速解決方案

　　賽靈思公司宣布開始正式發(fā)放高性能計算行業(yè)首款針對Intel前端總線(FSB)的FPGA加速解決方案商業(yè)許可?；诟咝阅?5nm Virtex™-5 平臺 FPGA 和Intel® QuickAssist技術(shù)，賽靈思公司的加速計算平臺(Accelerated Computing Platform, ACP)M1許可包支持實現(xiàn)全速1066MHz FSB性能。ACP M1許可包目前已開始向系統(tǒng)集成商提供，支持他們進行解決方案的開發(fā)，以提高基于Intel處理器的服務(wù)器平臺的性能，并保證把功
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基于FPGA的李沙育圖形在手持式示波表中實現(xiàn)

　　1.引言　　示波器測量頻率和相位的方法很多， “李沙育圖形法”就是其中用得最多的一種。“李沙育圖形法”又稱波形合成法，就是將被測頻率的信號和頻率已知的標(biāo)準(zhǔn)信號分別加至示波器的Y軸輸入端和x軸輸入端，在示波器顯示屏上將出現(xiàn)一個合成圖形，這個圖形就是李沙育圖形。李沙育圖形隨兩個輸入信號的頻率、相位、幅度不同，所呈現(xiàn)的波形也不同。　　早期的模擬示波器顯示李沙育圖形的原理是將電信號轉(zhuǎn)換為光信號，核心部分是陰極射線示波管(CRT)。將輸入信號加到示波管內(nèi)部的偏轉(zhuǎn)系統(tǒng)，高速電子經(jīng)聚焦、加速和偏轉(zhuǎn)后，打到熒
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WTB網(wǎng)絡(luò)HDLC在FPGA中的實現(xiàn)

　　1 引言　　TCN(Train Communication Network)總體結(jié)構(gòu)是由WTB(絞線式列車總線)和MVB(多功能車輛總線)組成，符合IEC61375-1標(biāo)準(zhǔn)。本文主要圍繞WTB鏈路控制的幀格式進行研究。鑒于IEC61375-1標(biāo)準(zhǔn)中規(guī)定的WTB幀數(shù)據(jù)格式與IS03309中定義的HDLC(High Level Data Link Control)格式一致，基帶Manchester-Biphase-L技術(shù)編解碼器現(xiàn)則圍繞HDLC展開。　　隨著深亞微米工藝技術(shù)的發(fā)展，F(xiàn)PGA(Fie
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基于FPGA的可配置通信平臺設(shè)計

本文設(shè)計了一種基于FPGA的、通用可配置的通信開發(fā)與測試平臺。針對不同信道編碼和調(diào)制方式的組合，通過采用實時軟硬件重構(gòu)技術(shù)，該平臺可以在短期內(nèi)完成相應(yīng)通信系統(tǒng)的構(gòu)建、驗證和配置。
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異步通信起始位正確檢測的VHDL實現(xiàn)

　　摘要：基于FPGA/CPLD的UART設(shè)計眾多，本文分析了3倍頻采樣方法存在的不足，同時分析了16倍頻采樣對起始位檢測的可靠性，并給出相關(guān)的VHDL硬件描述語言程序代碼。　　關(guān)健詞：異步數(shù)據(jù);UART;FPGA/CPLD;VHDL 　　概述　　隨著電子設(shè)計自動化(EDA)技術(shù)的發(fā)展，可編程邏輯器件FPGA/CPLD已經(jīng)在許多方面得到了廣泛應(yīng)用，而UART(通用異步收發(fā)器) 是在數(shù)字通信和控制系統(tǒng)中廣泛使用的串行數(shù)據(jù)傳輸協(xié)議。因此越來越多用戶根據(jù)自己的需要，以EDA技術(shù)作為開發(fā)手段，用一塊
關(guān)鍵字： 0711_A 雜志_設(shè)計天地嵌入式系統(tǒng) 單片機異步數(shù)據(jù) UART FPGA/CPLD VHDL MCU和嵌入式微處理器

基于FPGA和ARM的圖像采集傳輸系統(tǒng)

　　引言　　圖像處理技術(shù)的快速發(fā)展，使得圖像采集處理系統(tǒng)在提高農(nóng)業(yè)生產(chǎn)自動化程度中的應(yīng)用越來越廣泛。目前的圖像采集系統(tǒng)有的基于CCD攝像機、圖像采集卡和計算機，有的基于CCD攝像機、解碼器、FPGA和DSP，而有的基于CMOS圖像傳感器芯片、FPGA和DSP，它們在實時性，靈活性，可維護性方面各有優(yōu)缺點。而在農(nóng)業(yè)生產(chǎn)中，以基于CCD攝像機、圖像采集卡和計算機的系統(tǒng)居多。本文結(jié)合實際系統(tǒng)中的前端圖像處理和圖像數(shù)據(jù)傳輸需要.充分利用ARM的靈活性和FPGA的并行性特點，設(shè)計了一種基于ARM+FPGA的圖像
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xilinx fpga介紹

　　Xilinx FPGA 　　Xilinx FPGA主要分為兩大類，一種側(cè)重低成本應(yīng)用，容量中等，性能可以滿足一般的邏輯設(shè)計要求，如Spartan系列；還有一種側(cè)重于高性能應(yīng)用，容量大，性能能滿足各類高端應(yīng)用，如Virtex系列，用戶可以根據(jù)自己實際應(yīng)用要求進行選擇。在性能可以滿足的情況下，優(yōu)先選擇低成本器件。　　Xilinx FPGA可編程邏輯解決方案縮短了電子設(shè)備制造商開發(fā)產(chǎn)品的時間 [ 查看詳細 ]