ADC外圍電路的設(shè)計
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3 電源和接地的設(shè)計
在ADC電路中既含有模擬信號，又含有數(shù)字信號，而模擬信號部分是精密的信號處理電路，例如分辨率為10位5V量程的ADC，所對應(yīng)1LSB的模擬電壓為4．88mV。數(shù)字電路部分是與其他邏輯電路連接在一起的，工作信號為脈沖信號，信號的幅度大，頻譜寬。對于模擬信號來說，數(shù)字信號是一個干擾源，地線噪聲可達(dá)幾十毫伏，甚至幾百毫伏。如果存在接地不良，布線不當(dāng)?shù)纫蛩兀敲磾?shù)字噪聲將嚴(yán)重影響模擬信號部分的精度，甚至無法工作，所以對于高速ADC或高分辨率的轉(zhuǎn)換系統(tǒng)要特別重視印制電路板的布線以及電源的去耦問題。為了減小地線噪聲干擾可以采取下列措施：
3．1 參考點的設(shè)計
AGND與DGND分開，建立模擬參考點，把所有的模擬部分都接到這個參考點上。此外還應(yīng)注意合理布局，盡量縮短地線的長度，加大地線的橫截面積等。
3．2 AGND和DGND連接的設(shè)計
AGND接模擬參考點，DGND接數(shù)字電路，并與數(shù)字電源地相連接，并且AGND和DGND只在靠近ADC的引腳一處進(jìn)行連接。
3．3 電源接線的設(shè)計
多數(shù)ADC使用的不止是一種電源，通常5 V電源供數(shù)字部分使用，15 V電源供模擬部分使用。這兩組電源要分別接到AGND和DGND上，同時注意這兩組電源的變壓器繞組之間應(yīng)具有良好的絕緣和良好的靜電隔離。
3．4 電源去耦的設(shè)計
ADC的電源要加去耦電容，并且安裝時電容要盡量靠近ADC的電源。一般情況下，電容可用1～10μF鉭電容與0．01～0．1μF高頻瓷介電容并聯(lián)。
3．5 高低噪聲電路接地的設(shè)計
數(shù)字電路中的高頻信號電路和大電流電路屬于高噪聲電路，而ADC接口中的數(shù)字信號則屬于低噪聲電路，因此兩者應(yīng)各有接地參考點。前面是地線連接時需要考慮的問題，但是在實際中各電路結(jié)構(gòu)和參數(shù)的差別很大，所以一般不能采取同一模式。對于一些ADC芯片說明書中已經(jīng)給出了電源和地線以及芯片評估板的印制電路布線圖，使用時要按照說明書去連接，這樣才能達(dá)到系統(tǒng)的預(yù)期指標(biāo)。
4 信號隔離的設(shè)計
從上面的分析可知，合理的布線和接地可以有效地抑制噪聲干擾，但由于模擬信號和數(shù)字信號仍存在共地，所以要徹底消除數(shù)字噪聲對模擬信號的影響是不可能的。此外，模擬信號在傳輸線上也容易受到干擾，這些干擾不僅對模擬信號有影響，對數(shù)字電路影響更大，嚴(yán)重時會產(chǎn)生運行錯誤。因此采取隔離措施可以進(jìn)一步抑制干擾，常用的隔離元件是光電耦合器。根據(jù)隔離位置的不同，可分為2種隔離方式：一種是隔離模擬信號端；另一種是隔離數(shù)字信號端。由于數(shù)字信號的工作頻率較高，所以必須采用高速光電耦合器或采取加速措施，并且在微處理器中加人等待周期或增加信號鎖存器等，以協(xié)調(diào)光電耦合器引來的延遲時間，這將帶來接口電路的復(fù)雜性和降低系統(tǒng)響應(yīng)速度的負(fù)面影響。在實際應(yīng)用中，由于對不同系統(tǒng)的技術(shù)要求各有不同，所以ADC外圍電路的設(shè)計也要根據(jù)具體情況采用不同的方法。本文引用地址：http://m.butianyuan.cn/article/179899.htm
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