一種用VHDL設(shè)計(jì)實(shí)現(xiàn)的有線電視機(jī)頂盒信源發(fā)生

　　　VHDL是隨著可編輯邏輯器件（PLD）的發(fā)展而發(fā)展起來(lái)的一種硬件描述語(yǔ)言。它是1980年美國(guó)國(guó)防部VHSIC（超高速集成電路）計(jì)劃的一部分，并于1986年和1987年分別成為美國(guó)國(guó)防部和IEEE的工業(yè)標(biāo)準(zhǔn)。作為一種硬件設(shè)計(jì)時(shí)采用的標(biāo)準(zhǔn)語(yǔ)言，VHDL具有極強(qiáng)的描述能力，能支持系統(tǒng)行為級(jí)、寄存器傳輸級(jí)和門(mén)級(jí)三個(gè)不同層次的設(shè)計(jì)，這樣設(shè)計(jì)師將在TOP－DOWN設(shè)計(jì)的全過(guò)程中均可方便地使用同一種語(yǔ)言。而且，VHDL設(shè)計(jì)是一種“概念驅(qū)動(dòng)式”的高層設(shè)計(jì)技術(shù)，設(shè)計(jì)人員毋需通過(guò)門(mén)級(jí)原理圖描述電路，而是針對(duì)目標(biāo)進(jìn)行功能描述，由于擺脫了電路細(xì)節(jié)的束縛，設(shè)計(jì)人員可以專心于設(shè)計(jì)方案和構(gòu)思上，因此設(shè)計(jì)工作省時(shí)省力，加快了設(shè)計(jì)周期，并且工藝轉(zhuǎn)換變得輕松。VHDL設(shè)計(jì)技術(shù)對(duì)可編程專用集成電路（ASIC）的發(fā)展起著極為重要的作用。

　　自從微軟提出“維納斯”計(jì)劃后，機(jī)頂盒便成為信息產(chǎn)業(yè)追逐的主要目標(biāo)，也是信息家電中的主流產(chǎn)品。各國(guó)都在加緊對(duì)機(jī)頂盒的開(kāi)發(fā)，我國(guó)也提出了相應(yīng)的“女?huà)z”計(jì)劃，全國(guó)許多科研單位與生產(chǎn)廠家都在進(jìn)行這方面的研究。由于我國(guó)有線電視資源豐富，市場(chǎng)前景很大，因而對(duì)有線電視機(jī)頂盒的研究也就格外引人注目。然而，由于我國(guó)還未完全開(kāi)展數(shù)字電視業(yè)務(wù)，因而在機(jī)頂盒的調(diào)試過(guò)程中，要找到合適的信號(hào)源是很不容易的，不得不采用通過(guò)計(jì)算機(jī)輸出標(biāo)準(zhǔn)視頻碼流的方式來(lái)實(shí)現(xiàn)?？纱蠖鄶?shù)計(jì)算機(jī)EISA總線并行輸出的數(shù)據(jù)速率都難以滿足實(shí)際工作的需要。雖然EISA總線可以一次輸出16位并行數(shù)據(jù)，但這對(duì)于一次只能處理8位并行數(shù)據(jù)的器件來(lái)說(shuō)，仍需要一個(gè)轉(zhuǎn)換過(guò)程。本文介紹了一種數(shù)據(jù)格式轉(zhuǎn)換的設(shè)計(jì)方案。該方案采用VHDL對(duì)一塊CPLD芯片進(jìn)行編程，使其實(shí)現(xiàn)從16位并行數(shù)據(jù)到8位并行數(shù)據(jù)的轉(zhuǎn)換，并將EISA口的數(shù)據(jù)輸出速率提高一倍，達(dá)到信源要求。