使用ADSP-CM408F ADC控制器的電機(jī)控制反饋采樣時(shí)序

　　該情況的一個(gè)示例如圖4所示。該圖顯示了典型電流波形和相關(guān)的各種零電平、峰值電平以及標(biāo)稱電平，圖4顯示的電流電平將轉(zhuǎn)換為通過(guò)信號(hào)測(cè)量系統(tǒng)傳播(如圖5所示)的比例量(參見(jiàn)表1)。

　　圖4. 電流反饋信號(hào)幅度

　　表1. 電流反饋信號(hào)幅度

　　本示例采用連接LEM?,的CAS 6-NP霍爾效應(yīng)傳感器，其初級(jí)匝數(shù)為3，具有0 V至5 V輸出，后接增益為0.5的信號(hào)調(diào)理電路。

　　圖5. 電流反饋路徑的調(diào)整關(guān)系

　　ADC操作時(shí)序

　　ADCC控制器觸發(fā)采樣事件后，ADC操作本身具有一個(gè)轉(zhuǎn)換時(shí)間延遲。圖9顯示單次ADC事件與每個(gè)ADC接口相關(guān)聯(lián)，且使能兩次事件同步采樣的情況。

　　有三個(gè)獨(dú)立的轉(zhuǎn)換周期與ADC操作有關(guān)。

　　1. 寫(xiě)入8位控制字，選擇ADC讀取通道(ADCC_EVTCTL.CTLWD)。

　　2. 置位轉(zhuǎn)換脈沖，使能ADC采樣和轉(zhuǎn)換。

　　3. 讓16位ADC數(shù)據(jù)回流至ADCC。

　　ADCC提供這3個(gè)事件相位的片選和選通時(shí)鐘信號(hào)。ADCC與ADC的接口為串行接口，采用雙通道位操作。因此，每個(gè)CS脈沖期間提供的最小時(shí)鐘周期數(shù)(ADCC時(shí)序控制寄存器的NCK段)為8。其他重要的設(shè)置有：ADC時(shí)鐘頻率、轉(zhuǎn)換周期片選信號(hào)之間的最小延遲(tCSCS)(ACLK周期內(nèi))，以及CS邊沿和ACLK邊沿之間的最小延遲(tCSCK和tCKCS)。因此，單個(gè)同步采樣信號(hào)對(duì)的ADC轉(zhuǎn)換周期時(shí)間tCONV_ADC可表示為：

　　其中，fACLK表示ADCC時(shí)鐘頻率。

　　ADCC時(shí)鐘由處理器系統(tǒng)時(shí)鐘(fSYSCLK)通過(guò)ACKDIV分頻(在時(shí)序控制寄存器ADCC_TCA中)在內(nèi)部產(chǎn)生，計(jì)算如下：

　　其結(jié)果是系統(tǒng)時(shí)鐘來(lái)源于處理器內(nèi)核時(shí)鐘(fCORECLK)。當(dāng)fCORECLK為fSYSCLK的整數(shù)倍時(shí)，獲得最佳系統(tǒng)性能。完成ADC轉(zhuǎn)換后，額外延遲是因?yàn)锳DC數(shù)據(jù)通過(guò)DMA傳輸至數(shù)據(jù)存儲(chǔ)器，并最終由中斷請(qǐng)求服務(wù)將數(shù)據(jù)幀準(zhǔn)備就緒，供主應(yīng)用程序使用。因此，在應(yīng)用中，從觸發(fā)(例如，PWM SYNC脈沖)到數(shù)據(jù)可用的總時(shí)間為：

　　tCONV_TOTAL = tCONV_ADC + tDMA + tIRQ

　　其中：

　　tDMA是DMA傳輸?shù)钠骄鶗r(shí)間。

　　tIRQ是中斷請(qǐng)求服務(wù)的平均時(shí)間。

　　圖9. 單次事件同步采樣的轉(zhuǎn)換時(shí)間

　　典型時(shí)序設(shè)置見(jiàn)表2。表中還列出了對(duì)時(shí)序的一些約束條件。獲得正確ADC性能的絕對(duì)約束條件是，允許的ADC采樣和轉(zhuǎn)換周期(tCONV_ADC/3)必須至少為380 ns。單個(gè)同步采樣事件的時(shí)序結(jié)果如圖10所示，該結(jié)果與電機(jī)繞組電流的采樣有關(guān)(注意，該圖為了突出示例而略為夸大)。

　　圖10. 采樣延遲時(shí)間

　　采用這些設(shè)置時(shí)，在所需的電流波形采樣點(diǎn)與實(shí)際采樣點(diǎn)之間存在450 ns失調(diào)。該值等于一個(gè)片選脈寬(200 ns + 25 ns + 0 ns)加兩次片選之間的脈寬(225 ns)。 該結(jié)果造成平均電機(jī)繞組電流和實(shí)際采樣電流之間的ΔiSAMP產(chǎn)生差異，在時(shí)序調(diào)度中需加以考慮，雖然在1 kHz的典型電流控制環(huán)路帶寬環(huán)境中，這表示不超過(guò)0.2°的相移。此外，對(duì)于10 kHz的典型PWM頻率，ADC數(shù)據(jù)從產(chǎn)生PWM SYNC脈沖(表2中的設(shè)置)起，在不足2%的可用PWM周期時(shí)間內(nèi)可供應(yīng)用程序使用。如果在事件發(fā)生時(shí)ADC處于空閑狀態(tài)，則4至5個(gè)SYSCLK周期的額外延遲將存在于事件激活的時(shí)刻與ADC開(kāi)始工作的時(shí)刻之間。

　　圖11. 采樣時(shí)刻調(diào)整的實(shí)現(xiàn)

　　表2. 典型ADC設(shè)置的時(shí)序設(shè)定