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一種混合結構高速LDPC編碼器的FPGA實現

作者：時間：2017-06-05 來源：網絡

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分析了準循環(huán)低密度奇偶校驗碼生成矩陣的結構特點,討論了硬件可實現的三種常見編碼器結構,提出了一種混合結構的FPGA實現方法。通過利用循環(huán)矩陣的結構特性,增加少量硬件開銷,就可以實現編碼器高速編碼,滿足高速通信需求,吞吐量達1.36Gb/s。

一種混合結構高速LDPC編碼器的FPGA實現.pd

本文引用地址：http://m.butianyuan.cn/article/201706/348889.htm

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關鍵詞： 奇偶校驗碼 循環(huán)矩陣 FPGA

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