OTN幀頭定位電路優(yōu)化研究

作者：王建鋒蔣林時間：2013-12-26 來源：電子產品世界

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編者按：在OTN幀結構中，Serdes在從高速的串行數(shù)據(jù)中恢復出數(shù)據(jù)后，數(shù)據(jù)只是按順序以64bit為寬度重新放置，并沒有按字節(jié)對齊，所以后續(xù)電路無法直接使用這樣的數(shù)據(jù)。需要幀頭定位電路找到幀頭后，把所有的數(shù)據(jù)按字節(jié)對齊。但是將OTN數(shù)據(jù)轉換為并行的數(shù)據(jù)后，存在著數(shù)據(jù)速率高，位寬大的問題。在ASIC或FPGA中，大量的大位寬的數(shù)據(jù)，是不容易運行在較高的速率下的。所以需要對幀定位電路進行簡化，以使得電路在大位寬時，仍然能夠進行高速運行。研究了OTN數(shù)據(jù)的幀結構后，提出了一種適合于高速率的、大位寬的處理電路。

　　引言

本文引用地址：http://m.butianyuan.cn/article/203219.htm

　　在ITU-T G.709協(xié)議中，ITU-T規(guī)定了OTN的網絡幀結構。OTN使用了和SDH類似的幀結構，幀定位信號(Frame Alignment Signal)也是相同的。但是由于OTN的信號速率非常高，如OTU2的速率達到10Gbps以上，OTU3速率達到43Gbps以上，不能直接使用SDH的幀定位電路。以OTU2為例，在Serdes將串行信號變?yōu)椴⑿行盘柡?，如果還按照8bit的數(shù)據(jù)寬度，則信號速率需要達到1.25Gbps左右，這無論對于FPGA處理還是ASIC，速率都是過高而不能處理的，所以需要將數(shù)據(jù)寬度進一步加大，以降低信號速率。在本項目中，使用了64位的數(shù)據(jù)寬度，這時的信號速率為167Mbps。對于這樣高速而且寬位數(shù)的數(shù)據(jù)處理，如果還按照傳統(tǒng)的幀頭定位電路來處理，電路的速度上不去，會導致電路處理不能達到要求，所以需要簡化幀頭定位電路，以達到高速率、高位寬的信號處理要求。

　　傳統(tǒng)的幀定位處理方法

　　OTN幀結構

　　在ITU-T的G.709協(xié)議中，ITU-T規(guī)定了OTN的幀結構，如圖1所示。