硬件設(shè)計(jì)中的30個(gè)錯(cuò)誤想法與原因分析

　　現(xiàn)象二：這些總線信號(hào)都用電阻拉一下，感覺(jué)放心些

　　點(diǎn) 評(píng)：信號(hào)需要上下拉的原因很多，但也不是個(gè)個(gè)都要拉。上下拉電阻拉一個(gè)單純的輸入信號(hào)，電流也就幾十微安以下，但拉一個(gè)被驅(qū)動(dòng)了的信號(hào)，其電流將達(dá)毫安 級(jí)，現(xiàn)在的系統(tǒng)常常是地址數(shù)據(jù)各32位，可能還有244/245隔離后的總線及其它信號(hào)，都上拉的話，幾瓦的功耗就耗在這些電阻上了(不要用8毛錢一度電 的觀念來(lái)對(duì)待這幾瓦的功耗)。

　　現(xiàn)象三：CPU和FPGA的這些不用的I/O口怎么處理呢?先讓它空著吧，以后再說(shuō)

　　點(diǎn)評(píng)：不用的I/O口如果懸空的話，受外界的一點(diǎn)點(diǎn)干擾就可能成為反復(fù)振蕩的輸入信號(hào)了，而MOS器件的功耗基本取決于門電路的翻轉(zhuǎn)次數(shù)。如果把它上拉的話，每個(gè)引腳也會(huì)有微安級(jí)的電流，所以最好的辦法是設(shè)成輸出(當(dāng)然外面不能接其它有驅(qū)動(dòng)的信號(hào))

　　現(xiàn)象四：這款FPGA還剩這么多門用不完，可盡情發(fā)揮吧

　　點(diǎn)評(píng)：FGPA的功耗與被使用的觸發(fā)器數(shù)量及其翻轉(zhuǎn)次數(shù)成正比，所以同一型號(hào)的FPGA在不同電路不同時(shí)刻的功耗可能相差100倍。盡量減少高速翻轉(zhuǎn)的觸發(fā)器數(shù)量是降低FPGA功耗的根本方法。