基于FPGA的LED大屏幕控制系統(tǒng)的設(shè)計實現(xiàn)

　　(2)亮度調(diào)節(jié)

　　本文在現(xiàn)有脈寬調(diào)制亮度調(diào)節(jié)技術(shù)[5]上提出了改進的亮度調(diào)節(jié)方案。本系統(tǒng)選用120 MHz的時鐘作為脈寬計數(shù)器的驅(qū)動時鐘，所以可以產(chǎn)生至少9 ns寬的脈沖。根據(jù)LED屏幕的驅(qū)動理論，選用9 ns作為最低亮度的最低灰度級的脈沖寬度，選用12灰度級時最高灰度級的脈沖寬度為9×211 ns。設(shè)豎直串行需要移2 560個數(shù)據(jù)，本系統(tǒng)選用12 MHz的屏幕數(shù)據(jù)移位時鐘，則2 560個數(shù)據(jù)移入屏幕需要213 μs，在灰度級脈沖寬度時間小于213 μs時，就需要等待數(shù)據(jù)移入屏幕，而在灰度級脈沖寬度時間大于213 μs時，數(shù)據(jù)移位則需要等待脈沖寬度計數(shù)完成。調(diào)節(jié)亮度是對每一個灰度級的脈沖寬度乘上一個相同的系數(shù)。以64級亮度控制為例，最高亮度時最低灰度級的脈沖寬度為9×64 ns，最高灰度級的脈沖寬度為9×211×64 ns。采用脈沖寬度調(diào)制方式實現(xiàn)灰度控制，則掃描完一幀圖像所需要時間由式(7)計算得出：

　　213 μs×9+294.912μs+0.589 824 ms+1.1796 48 ms=3.981 384 ms (7)

　　本系統(tǒng)接收的視頻源的刷新率為60 Hz，為了避免幀間圖像撕裂的現(xiàn)象出現(xiàn)，LED顯示屏的刷新率是視頻源刷新率的整數(shù)倍。視頻源的換幀時間為16.6 ms，LED顯示可以在這個時間內(nèi)讀取同一幀數(shù)據(jù)進行屏幕刷新，根據(jù)上面的計算結(jié)果有 3.981 384×416.6 ms，即可得出LED顯示屏的刷新率為60 Hz×4=240 Hz。

　　本文基于Altera的低成本Cyclone II 系列FPGA EP2CQ208C設(shè)計了一種高性能、低成本的LED大屏幕控制系統(tǒng)。通過改進SDRAM乒乓式緩存方案既節(jié)省了FPGA的IO口，又提高了系統(tǒng)的靈活性。設(shè)計了一種基于FPGA的片內(nèi)RAM和PC機軟件的反γ校正與灰度級設(shè)置方案，同時設(shè)計了在FPGA中實現(xiàn)的圖像對比度、亮度調(diào)節(jié)模塊。本系統(tǒng)最大可驅(qū)動1 280×1 024分辨率LED屏幕，刷新率不低于240 Hz，且灰度級、反γ校正系數(shù)、亮度、對比度等均可通過PC機軟件靈活調(diào)節(jié)。為了實現(xiàn)屏幕驅(qū)動面積、LED屏幕刷新率的靈活設(shè)置，今后的工作將深入討論這幾方面之間的關(guān)系以及各種設(shè)置在FPGA中的實現(xiàn)。

　　參考文獻

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