基于FPGA的快速9／7整形離散小波變換系統(tǒng)
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在Xilinx提供的ISE7．1仿真軟件下搭建測試平臺，對設(shè)計(jì)系統(tǒng)進(jìn)行綜合，結(jié)果如圖9所示。
設(shè)計(jì)系統(tǒng)時(shí)鐘頻率可達(dá)到54 MHz，滿足對圖像數(shù)據(jù)的實(shí)時(shí)處理要求。
4 結(jié)束語
本文主要討論了基于FPGA的快速9／7整形離散小波變換系統(tǒng)設(shè)計(jì)，該結(jié)構(gòu)采用內(nèi)部RAM的循環(huán)覆蓋的存儲方式，使對存儲器的需求量減小，從而減小了硬件功耗，同時(shí)采用基于行的列變換方式，提高了的系統(tǒng)運(yùn)行，可實(shí)現(xiàn)對遙感傳輸圖像的快速實(shí)時(shí)處理。
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