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Cadence和MIPS合作瞄準(zhǔn)32位核心芯片

作者：eaw 時(shí)間：2005-05-08 來源：eaw

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Cadence公司和MIPS公司宣布為 MIPS32 24K芯片的用戶提供優(yōu)化的MIPS-Cadence Encounter 參考方法。這種經(jīng)過優(yōu)化的數(shù)字IC設(shè)計(jì)平臺(tái)將SoC Encounter RTL-to-GDSII和Encounter RTL Compiler 綜合器相結(jié)合，支持0.13mm級(jí)的芯片設(shè)計(jì)。www.mips.com

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