FPGA在彈上信息處理機(jī)中的應(yīng)用
作者：方超 龔龍慶 田衛(wèi) 西安驪山微山電子公司
時(shí)間：2009-04-14
來源：電子產(chǎn)品世界
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(6)發(fā)送
本文引用地址：http://m.butianyuan.cn/article/93424.htm數(shù)據(jù)融合表的發(fā)送則由“發(fā)送狀態(tài)機(jī)(SendSTM) IP”完成。它以數(shù)據(jù)融合表FIFO、2.56M發(fā)送時(shí)鐘為輸入，一旦啟動(dòng)就不再停止。發(fā)送狀態(tài)機(jī)首先查詢數(shù)據(jù)融合表FIFO, 若FIFO為空，則等待;若FIFO不空，則以2.56M/8的固定時(shí)鐘頻率持續(xù)讀取數(shù)據(jù)融合表FIFO的數(shù)據(jù)，再送入“15段加擾器”進(jìn)行加擾，加擾后的數(shù)據(jù)和時(shí)鐘經(jīng)RS-422驅(qū)動(dòng)電路轉(zhuǎn)化為RS-422差分形式發(fā)送給加密器，即2.56M輸出。
(7)1.28M同步輸入串口故障檢測(cè)
FPGA中的故障檢測(cè)單元(FDU)負(fù)責(zé)檢測(cè)1.28M同步輸入串口的輸入信號(hào)是否正常。當(dāng)故障檢測(cè)單元FDU發(fā)現(xiàn)1.28M同步輸入串口產(chǎn)生的SwitchBuf信號(hào)的周期和晶振產(chǎn)生的20ms時(shí)鐘周期誤差超過△T(如±2ms)，則認(rèn)為1.28M同步輸入串口故障，立即將SwitchBuf信號(hào)切換到由晶振分頻產(chǎn)生的20ms時(shí)鐘上。
系統(tǒng)仿真
以下為相關(guān)軟件對(duì)系統(tǒng)主要功能進(jìn)行的仿真：
圖4 ISE編譯后得出的FPGA資源利用情況
圖5 數(shù)據(jù)融合表的仿真結(jié)果
評(píng)論