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基于FPGA的FIR數(shù)字濾波器設(shè)計方案（二）

  • 模型搭建好之后，需要確定16階FIR數(shù)字濾波器的系數(shù)，在這使用Matlab中的FDATool濾波器設(shè)計工具來確定。確定好濾 ...
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基于FPGA的FIR數(shù)字濾波器設(shè)計方案(一)

  • 在Matlab/Simulink環(huán)境下，采用DSP Builder模塊搭建FIR模型，根據(jù)FDATool工具對FIR濾波器進行了設(shè)計，然后進行系 ...
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最新FPGA所需求的電源IC

  • 近年來，電子設(shè)備(應(yīng)用)的多樣化與高性能化以驚人的速度不斷發(fā)展。可以說，這種趨勢使各產(chǎn)品的開發(fā)周期縮短，并給...
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基于ARM+FPGA的1394總線在TFT-LCD檢測系統(tǒng)中的應(yīng)用

  • IEEE1394是最初由Apple公司提出的高速串行總線，1995年IEEE(電氣和電子工程師協(xié)會)將其認可為IEEE1394－1995規(guī) ...
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Altera推出首款基于FPGA的智能交通視頻分析解決方案

  • Altera公司 (NASDAQ: ALTR) 日前在2013年中國國際公共安全博覽會 (安博會) 上宣布，北京動視元科技有限公司(簡稱：動視元)采用Altera基于FPGA的最新視頻分析成功推出首個基于FPGA的智能交通視頻分析解決方案——動視元至睿系列交通狀況視頻分析儀。
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PSoC 5LP：帶CPLD的可靠ARM嵌入式處理器

  • 您是不是需要復(fù)雜可編程邏輯器件(CPLD)但又不愿放棄固件?或者說您希望最好在單個芯片中同時集成微控制器和CPLD?PSoC? 5LP是賽普拉斯半導(dǎo)體公司的最新片上可編程系統(tǒng)，當它用作CPU時，它就是一款32位的67 MHz ARM Cortex-M3處理器，而用作CPLD時，其可編程邏輯提供的基于LUT的FPGA門，相當于20,000多個門。
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十一條金律！搞定DC/DC電源轉(zhuǎn)換方案設(shè)計

  • 搞嵌入式的工程師們往往把單片機、ARM、DSP、FPGA搞的得心應(yīng)手，而一旦進行系統(tǒng)設(shè)計，到了給電源系統(tǒng)供電，雖然也能讓其精心設(shè)計的程序運行起來，但對于新手來說，有時可能效率低下，往往還有供電電流不足或過大引起這樣那樣的問題，本文十大金律輕松搞定DCDC電源轉(zhuǎn)換電路設(shè)計。
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FPGA攻略之Testbench篇

  • Testbench，就是測試平臺的意思，具體概念就多不介紹了，相信略懂FPGA的人都知道，編寫Testbench的主要目的是為了對使用硬件描述語言(HDL)設(shè)計的電路進行仿真驗證，測試設(shè)計電路的功能、部分性能是否與預(yù)期的目標相符。
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萊迪思推出新的超低密度FPGA

  • 2013年10月22日，萊迪思半導(dǎo)體公司(NASDAQ: LSCC)宣布推出新的超低密度iCE40? FPGA，提供世界上最靈活的單芯片傳感器解決方案，使得新一代環(huán)境感知、超低功耗的移動設(shè)備成為現(xiàn)實。iCE40 FPGA系列新增加的器件使客戶能夠在一個更小的空間內(nèi)集成更多的功能。
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美高森美宣布提供低成本IGLOO?2 FPGA評測工具套件

  • 致力于提供幫助功率管理、安全、可靠與高性能半導(dǎo)體技術(shù)產(chǎn)品的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation，紐約納斯達克交易所代號：MSCC) 宣布提供低成本IGLOO?2 FPGA評測工具套件，為客戶提供PCI? Express (PCIe)兼容外形尺寸評測平臺。
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基于FPGA和虛擬儀器的DDS信號發(fā)生器設(shè)計

  • 將虛擬儀器技術(shù)同F(xiàn)PGA技術(shù)結(jié)合，設(shè)計了一個頻率可控的DDS任意波形信號發(fā)生器。在闡述直接數(shù)字頻率合成技術(shù)的工作原理、電路構(gòu)成的基礎(chǔ)上，分別介紹了上位機虛擬儀器監(jiān)控面板的功能和結(jié)構(gòu)，以及實現(xiàn)DDS功能的下位機FPGA器件各模塊化電路的作用。經(jīng)過設(shè)計和電路測試，輸出波形達到了技術(shù)要求，工作穩(wěn)定可靠。
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基于FPGA和BU-65170的1553B遠程終端設(shè)計與實現(xiàn)

  • 為了滿足載荷與衛(wèi)星進行可靠通信的目的，設(shè)計并實現(xiàn)了基于FPGA和BU-65170協(xié)議芯片的1553B遠程終端。自行設(shè)計了用于控制BU-65170的主控制狀態(tài)機，采用16位零等待緩沖接口模式，使用單消息和雙緩沖模式進行消息傳輸。創(chuàng)新性地引入RS 422總線與1553B總線進行通信，方便測試過程，結(jié)果直觀可見。采用專用測試板卡Alta ECD54-1553對系統(tǒng)進行測試，獲得預(yù)期的可靠結(jié)果。FPGA取代傳統(tǒng)CPU來控制1553B通信并集成數(shù)據(jù)傳輸功能，采用Verilog HDL硬件描述語言有利于軟件移植，縮短
  • 關(guān)鍵字： 終端  設(shè)計  實現(xiàn)  遠程  1553B  FPGA  BU-65170  基于  

基于FPGA的FIR數(shù)字濾波器設(shè)計與實現(xiàn)

  • 簡要介紹了FIR數(shù)字濾波器的結(jié)構(gòu)特點和基本原理，提出基于FPGA和DSP Builder的FIR數(shù)字濾波器的基本設(shè)計流程和實現(xiàn)方案。在Mat lab／Simulink環(huán)境下，采用DSP Builder模塊搭建FIR模型，根據(jù)FDATool工具對FIR濾波器進行了設(shè)計，然后進行系統(tǒng)級仿真和ModelSim功能仿真，其仿真結(jié)果表明其數(shù)字濾波器的濾波效果良好。通過SignalCompiler把模型轉(zhuǎn)換成VHDL語言加入到FPGA的硬件設(shè)計中，從QuartusⅡ軟件中的虛擬邏輯分析工具SignalTapⅡ中得到數(shù)
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基于FPGA實現(xiàn)異步串行通信

  • 為了適應(yīng)全數(shù)字化自動控制更加廣泛的應(yīng)用，采用現(xiàn)場可編程門陣列(FPGA)對異步串行通信控制器(UART)進行多模塊的系統(tǒng)設(shè)計的方法，使串口通信的集成度更高。對UART系統(tǒng)結(jié)構(gòu)進行了模塊化分解，可分為三個模塊：FPGA波特率發(fā)生器控制模塊、FPGA數(shù)據(jù)發(fā)送模塊及數(shù)據(jù)接收模塊。采用Venlog語言描述硬件功能，利用Xilinx公司的FPGA芯片，在Xilinx ISE Design Suite 13. 4環(huán)境下進行設(shè)計、編譯、綜合、下載。采用第三方仿真工具ModelSim進行模擬仿真。
  • 關(guān)鍵字： 串行  通信  異步  實現(xiàn)  FPGA  基于  

基于FPGA的實時視頻圖像采集與顯示系統(tǒng)的設(shè)計與實

  • 主要針對目前視頻圖像處理發(fā)展的現(xiàn)狀，結(jié)合FPGA技術(shù)，設(shè)計了一個基于FPGA的實時視頻圖像采集與顯示系統(tǒng)。系統(tǒng)采用FPGA作為主控芯片，搭栽專用的編碼解碼芯片進行圖像的采集與顯示，主要包括解碼芯片的初始化、編碼芯片的初始化、FPGA圖像采集、PLL設(shè)置等幾個功能模塊。采用FPGA的標準設(shè)計流程及一些常用技巧來對整個系統(tǒng)進行編程。重點在于利用FPFA開發(fā)平臺對普通相機輸出的圖像進行采集與顯示，最終能在連接的RCA端口顯示屏顯示。
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