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基于FPGA的二次群數(shù)字信號分接部分功能實現(xiàn)

  • 基于FPGA的二次群數(shù)字信號分接部分功能實現(xiàn),1.引言　　為了提高傳輸速率，擴(kuò)大通信容量，減少信道數(shù)量，通常把多路信號復(fù)用成一路信號進(jìn)行傳輸。在多種復(fù)用方式中，時分復(fù)用是一種常用的方式。時分復(fù)用是多路信號按照時間間隔共享一路信道進(jìn)行傳輸。復(fù)接是把多
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基于FPGA直接序列擴(kuò)頻系統(tǒng)的設(shè)計

  • 摘要 針對一般無線通信系統(tǒng)抗干擾、抗噪聲以及抗多徑性能力差的缺點，提出了一種基于FPGA的直接序列擴(kuò)頻系統(tǒng)設(shè)計。該設(shè)計采用63位的pn碼作為擴(kuò)頻調(diào)制的碼序列，在發(fā)送端，對信息碼進(jìn)行擴(kuò)頻調(diào)制；在接收端，對收到的擴(kuò)
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運用SAD算法降低FPGA資源利用率

  • 介紹如何從比RTL更高層次的抽象層分析資源共享，讓資源占用率比依賴RTL設(shè)計中的互斥任務(wù)的方法更低。
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基于FPGA的高速串行傳輸系統(tǒng)的設(shè)計與實現(xiàn)

  • 摘要：作為高傳輸速率和低設(shè)計成本的傳輸技術(shù)，串行傳輸技術(shù)被廣泛應(yīng)用于高速通信領(lǐng)域，并已成為業(yè)界首選。在此基于對高速串行傳輸系統(tǒng)的分析，對實例進(jìn)行了總體設(shè)計驗證，最終達(dá)到高速傳輸?shù)哪康摹?br />關(guān)鍵詞：FPGA；
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基于FPGA的通用異步收發(fā)器設(shè)計

  • 摘要：采用Verilog HDL語言作為硬件功能的描述，運用模塊化設(shè)計方法分別設(shè)計了通用異步收發(fā)器(UART)的發(fā)送模塊、接收模塊和波特率發(fā)生器，并結(jié)合現(xiàn)場可編程門陣列(FPGA)的特點，實現(xiàn)了一個可移植的UART模塊。該設(shè)計不
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基于FPGA多通道同步數(shù)據(jù)采集系統(tǒng)設(shè)計

  • 　引言　　數(shù)據(jù)采集在工業(yè)測控領(lǐng)域里有廣泛的應(yīng)用，它已成為計算機(jī)測控系統(tǒng)的一個重要的環(huán)節(jié)，尤其在設(shè)備故障監(jiān)測系統(tǒng)中，由于各種設(shè)備的結(jié)構(gòu)復(fù)雜，運動形式多種多樣，發(fā)生故障的可能部位很難確定，因此我們需要從設(shè)
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NEXYS3 FPGA 開發(fā)平臺

  • Digilent公司推出了一款新型的基于FPGA的硬件開發(fā)平臺，NEXYSTM3開發(fā)板。此開發(fā)板采用了Xilinx公司最先進(jìn)的Spartan6 FPGA芯片，擁有48M字節(jié)大小的外部存儲器（包括2個由Micron公司生產(chǎn)的非易失性的相變存儲器）、USB以及以太網(wǎng)接口，還有其他通用的I/O器件。
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基于FPGA的交通燈系統(tǒng)控制設(shè)計

  • 摘要：為了對交通燈系統(tǒng)進(jìn)行精確控制，采用FPGA實驗板，在QuartusⅡ軟件環(huán)境下，分別實現(xiàn)脈沖發(fā)生模塊、狀態(tài)定時模塊、交通燈顯示模塊、時間顯示模塊，進(jìn)行仿真實驗和硬件下載，獲得的測試結(jié)果滿足設(shè)計要求。由于采用
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基于FPGA的遠(yuǎn)距離測溫器數(shù)控系統(tǒng)設(shè)計

  • 摘要：介紹了遠(yuǎn)距離測溫器的結(jié)構(gòu)組成和工作原理，設(shè)計了基于FPGA的遠(yuǎn)距離測溫器數(shù)控系統(tǒng)的數(shù)據(jù)采集與控制系統(tǒng)，使用Altera公司的Cyclonell系列的FPGA實現(xiàn)了包括數(shù)據(jù)采集、數(shù)據(jù)通信等控制功能，著重敘述了硬件與軟件的
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基于FPGA的DDS+DPLL跳頻信號源設(shè)計

  • 摘要：針對跳頻通信系統(tǒng)有固有噪聲的特點，結(jié)合DDS+DPLL高分辨率、高頻率捷變速度的優(yōu)點，并采用Altera公司的Quartus-Ⅱ_10．1軟件進(jìn)行設(shè)計綜合，提出了一種新型的跳頻信號源。結(jié)果表明，該設(shè)計中DPLL時鐘可達(dá)到12
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FPGA實現(xiàn)復(fù)接與分接系統(tǒng)

  • FPGA實現(xiàn)復(fù)接與分接系統(tǒng),引言　　近年來可編程器件的應(yīng)用日益廣泛，使用較多的是現(xiàn)場可編程門陣列(FPGA)和復(fù)雜可編程邏輯器件(CPLD)。FPGA器件性能優(yōu)越，使用方便，成本低廉，投資風(fēng)險小，使用FPGA設(shè)計可以完全根據(jù)設(shè)計者需要開發(fā)ASIC芯片，
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以FPGA為基礎(chǔ)的SoC驗證平臺 自動化電路仿真?zhèn)慑e功

  • 隨著系統(tǒng)芯片(SoC)設(shè)計的體積與復(fù)雜度持續(xù)升高，驗證作業(yè)變成了瓶頸：占了整個SoC研發(fā)過程中70% 的時間。因此，任何能夠降低驗證成本并能更早實現(xiàn)驗證sign-off的方法都是眾人的注目焦點。臺灣工業(yè)技術(shù)研究院 (工研院
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基于FPGA軟核的高速數(shù)據(jù)采集系統(tǒng)設(shè)計

  • 為解決不同性能指標(biāo)數(shù)據(jù)采集系統(tǒng)開發(fā)時間較長的問題，提出了一種將FPGA軟核技術(shù)應(yīng)用于高速數(shù)據(jù)采集系統(tǒng)設(shè)計的方法。系統(tǒng)以Xilinx公司的FPGA為例設(shè)計軟核，使用VHDL語言對軟核進(jìn)行模塊化設(shè)計。介紹了數(shù)據(jù)采集系統(tǒng)的硬件電路、USB固件程序、USB驅(qū)動程序以及LabVIEW上位機(jī)的設(shè)計。該數(shù)據(jù)采集系統(tǒng)結(jié)構(gòu)可移植性強(qiáng)，有利于縮短同類型系統(tǒng)設(shè)計研發(fā)周期。
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基于FPGA的高清視頻采集與顯示系統(tǒng)設(shè)計

  • 高清視頻采集與顯示系統(tǒng)設(shè)計近年來，高清網(wǎng)絡(luò)攝像機(jī)席卷視頻監(jiān)控市場，傳統(tǒng)的模擬攝像機(jī)也在尋找新的出路提升圖像質(zhì)量，采用非壓縮方案的高清模擬攝像機(jī)成為首選。一般來說，非壓縮方案的硬件平臺有DSP或ASIC或FPGA。
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如何在FPGA中實現(xiàn)圖像格式轉(zhuǎn)換

  • 　首先由同步視頻輸入MegaCore 功能來處理SDI 視頻數(shù)據(jù)。該功能將同步視頻格式數(shù)據(jù)（ 例如， BT656 或者DVI） 轉(zhuǎn)換為流控制Avalon 流（Avalon-ST） 視頻協(xié)議，實現(xiàn)與數(shù)據(jù)通路后面其他視頻處理功能的鏈接?！　〔捎?/li>
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