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基于FPGA 的二維提升小波變換IP核設(shè)計(jì)
- 提出了一種高效并行的二維離散提升小波(DWT)變換結(jié)構(gòu),該結(jié)構(gòu)只需要7 行數(shù)據(jù)緩存,即可實(shí)現(xiàn)行和列方向同時(shí)進(jìn)行濾波變換。
- 關(guān)鍵字: 小波變換 數(shù)據(jù)緩存 FPGA IP核
基于FPGA的水聲信號(hào)高速采集存儲(chǔ)系統(tǒng)設(shè)計(jì)
- 介紹了一種基于FPGA的水聲信號(hào)數(shù)據(jù)采集與存儲(chǔ)系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn),給出了系統(tǒng)的總體方案,并對(duì)各部分硬件和軟件的設(shè)計(jì)進(jìn)行了詳細(xì)描述。系統(tǒng)以FPGA作為數(shù)據(jù)的控制處理核心,以存儲(chǔ)容量達(dá)2GB的大容量NAND型Flash作為存儲(chǔ)介質(zhì)。該系統(tǒng)主要由數(shù)據(jù)采集模塊、數(shù)據(jù)存儲(chǔ)模塊和RS~232串行通信模塊組成,具有穩(wěn)定可靠、體積小、功耗低、存儲(chǔ)容量大等特點(diǎn),實(shí)驗(yàn)證明該系統(tǒng)滿足設(shè)計(jì)要求。
- 關(guān)鍵字: 水聲信號(hào)數(shù)據(jù)采集 NANDFlash FPGA
基于FPGA控制的IDE磁盤(pán)陣列設(shè)計(jì)
- 設(shè)計(jì)了一種基于FPGA控制的高速數(shù)據(jù)存儲(chǔ)系統(tǒng)。該系統(tǒng)采用FPGA實(shí)現(xiàn)了對(duì)四個(gè)符合ATA-6規(guī)范的、RAID 0配置的IDE磁盤(pán)陣列的管理,并配合四個(gè)SDRAM實(shí)現(xiàn)對(duì)數(shù)據(jù)的高速穩(wěn)定存儲(chǔ)。該磁盤(pán)陣列同時(shí)掛四個(gè)IDE硬盤(pán),平均數(shù)據(jù)流達(dá)到200MB/s,峰值傳輸速率達(dá)到800MB/s,也可以擴(kuò)展更多硬盤(pán),構(gòu)成大容量的磁盤(pán)陣列。
- 關(guān)鍵字: 高速數(shù)據(jù)存儲(chǔ) IDE磁盤(pán)陣列 FPGA
基于FPGA的實(shí)時(shí)數(shù)字化光纖傳輸系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
- 提出一種實(shí)時(shí)數(shù)字化光纖傳輸系統(tǒng),該系統(tǒng)分為發(fā)送端和接收端。發(fā)送端用A/D轉(zhuǎn)換器將輸入的模擬信號(hào)數(shù)字化,再用FPGA對(duì)數(shù)據(jù)進(jìn)行處理,并通過(guò)光纖傳輸。同時(shí),F(xiàn)PGA還控制A/D轉(zhuǎn)換器的工作。接收端用串行收發(fā)器TLK1501對(duì)接收數(shù)據(jù)進(jìn)行解碼處理,還原有效信號(hào)。實(shí)驗(yàn)表明,該系統(tǒng)實(shí)時(shí)性好、信號(hào)傳輸誤碼率低、工作性能穩(wěn)定、抗干擾性強(qiáng),系統(tǒng)具有可行性和有效性。
- 關(guān)鍵字: 光纖通訊 高速數(shù)字信號(hào)傳輸 FPGA
基于FPGA的固定倍率圖像縮放的實(shí)現(xiàn)
- 基于FPGA硬件實(shí)現(xiàn)固定倍率的圖像縮放,將2維卷積運(yùn)算分解成2次1維卷積運(yùn)算,對(duì)輸入原始圖像像素先進(jìn)行行方向的卷積,再進(jìn)行列方向的卷積,從而得到輸出圖像像素。把圖像縮放過(guò)程設(shè)計(jì)為一個(gè)單元體的循環(huán)過(guò)程,在單元體內(nèi)部,事先計(jì)算出卷積系數(shù)。降低了FPGA設(shè)計(jì)的復(fù)雜性,提高了圖像縮放算法的運(yùn)算速度,增強(qiáng)了系統(tǒng)的實(shí)時(shí)性,已經(jīng)應(yīng)用于某款航空電子產(chǎn)品中,應(yīng)用效果良好。
- 關(guān)鍵字: 圖像縮放 卷積運(yùn)算 FPGA
基于FPGA的雙路可移相任意波形發(fā)生器
- 本文論述了利用用FPGA來(lái)開(kāi)發(fā)DDS函數(shù)發(fā)生器的總體設(shè)計(jì)思路,詳細(xì)討論了任意波形產(chǎn)生、頻率精確調(diào)整、雙路移相輸出、PWM調(diào)制波產(chǎn)生、D/A轉(zhuǎn)換與濾波電路、鍵盤(pán)與顯示等諸方面軟硬件實(shí)現(xiàn)方法。 整個(gè)設(shè)計(jì)
- 關(guān)鍵字: DDS 任意波形發(fā)生器 FPGA
基于FPGA的水聲信號(hào)高速采集存儲(chǔ)系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
- 介紹了一種基于FPGA的水聲信號(hào)數(shù)據(jù)采集與存儲(chǔ)系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn),給出了系統(tǒng)的總體方案,并對(duì)各部分硬件和軟件的設(shè)計(jì)進(jìn)行了詳細(xì)描述。系統(tǒng)以FPGA作為數(shù)據(jù)的控制處理核心,以存儲(chǔ)容量達(dá)2 GB的大容量NAND型Flash作為存儲(chǔ)介質(zhì)。該系統(tǒng)主要由數(shù)據(jù)采集模塊、數(shù)據(jù)存儲(chǔ)模塊和RS-232串行通信模塊組成,具有穩(wěn)定可靠、體積小、功耗低、存儲(chǔ)容量大等特點(diǎn),實(shí)驗(yàn)證明該系統(tǒng)滿足設(shè)計(jì)要求。
- 關(guān)鍵字: 數(shù)據(jù)采集 Flash FPGA
基于FPGA的全數(shù)字交流伺服系統(tǒng)信號(hào)處理
- 在交流伺服驅(qū)動(dòng)系統(tǒng)概念的基礎(chǔ)上,提出了基于ACTEL現(xiàn)場(chǎng)可編程邏輯器件APA300的光電編碼器與光柵尺信號(hào)處理電路設(shè)計(jì)原理,該電路由4倍頻細(xì)分、辨向電路、計(jì)數(shù)電路組成,信號(hào)處理模塊通過(guò)VHDL語(yǔ)言實(shí)現(xiàn)。
- 關(guān)鍵字: 交流伺服系統(tǒng) VHDL FPGA 光柵尺信號(hào)處理
一種并行存儲(chǔ)器系統(tǒng)的FPGA實(shí)現(xiàn)
- 圍繞小衛(wèi)星體積小、重量輕和價(jià)格低廉的特點(diǎn),一個(gè)多CPU共享內(nèi)存的系統(tǒng)(CPU仍然采用有相應(yīng)宇航級(jí)器件的8086)將是比較合適的選擇。同時(shí)為了提高共享內(nèi)存的數(shù)據(jù)通信帶寬,使其不成為整個(gè)系統(tǒng)的瓶頸,本文提出了一個(gè)用ASIC設(shè)計(jì)一個(gè)共享總線開(kāi)關(guān)網(wǎng)絡(luò)(簡(jiǎn)稱(chēng)SBSN,下同),組合成Omega網(wǎng)絡(luò)的方案,以消除對(duì)某一組內(nèi)存的總線競(jìng)爭(zhēng),實(shí)現(xiàn)多CPU對(duì)共享分組存儲(chǔ)系統(tǒng)的低位交叉并行訪問(wèn)。
- 關(guān)鍵字: 并行存儲(chǔ)器 多CPU共享內(nèi)存 FPGA
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