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基于DSP EMIF口及FPGA設計并實現(xiàn)多DSP嵌入式系統(tǒng)
- 在實時圖像處理、雷達信號處理、軟件無線電、電子對抗、3G數(shù)值仿真計算中,單DSP無法滿足實時性和高速運算量要求,往往需要多DSP進行協(xié)同處理。本文針對DSP的EMIF接口和FPGA的特點,設計8個DSP通信的嵌入式系統(tǒng)。
- 關鍵字: 多DSP嵌入式系統(tǒng) EMIF FPGA
基于FPGA和PCI的AFDX終端接口卡設計
- 航空電子全雙工交換式以太網(wǎng)(AFDX)是在商用以太網(wǎng)的基礎上經(jīng)過改進實時性和可靠性建立起來的。依據(jù)ARINC664規(guī)范第7部分對終端接口卡時延和抖動的性能要求,提出基于FPGA和PCI的AFDX終端接口卡的整體設計方案,對發(fā)送和接收模塊等關鍵模塊進行了設計,并分析了PCI接口驅(qū)動程序。測試結(jié)果表明,該接口卡實時性好、傳輸速率高、穩(wěn)定可靠,符合AFDX協(xié)議標準。
- 關鍵字: 全雙工交換式以太網(wǎng) 實時性 FPGA
基于FPGA的四通道視頻縮放引擎的研究及設計
- 設計了一種可實現(xiàn)4路視頻信號縮放和幀率轉(zhuǎn)換的電路架構。視頻信號依次經(jīng)過縮小模塊、幀率轉(zhuǎn)換模塊以及放大模塊,有效地減少了幀率轉(zhuǎn)換對存儲器帶寬的需求。
- 關鍵字: 幀率轉(zhuǎn)換 加權均值算法 FPGA
LTE上行DFT/IDFT的一種設計實現(xiàn)
- MSL4163提供1MHz I2C串口,器件包括先進的PWM引擎以及片上EEPROM等。主要用在電視和臺式電腦監(jiān)視器、醫(yī)療、工業(yè)儀表和汽車音/視頻顯示器。本文介紹了MSL4163/MSL4164主要特性、方框圖和典型應用電路、級聯(lián)連接電路。
- 關鍵字: 3GPP協(xié)議 流水線結(jié)構 FPGA
數(shù)字基帶預失真系統(tǒng)中環(huán)路延遲估計的FPGA實現(xiàn)
- 基于FPGA芯片Stratix II EP2S60F672C4設計實現(xiàn)了數(shù)字基帶預失真系統(tǒng)中的環(huán)路延遲估計模塊。該模塊運用了一種環(huán)路延遲估計新方法,易于FPGA實現(xiàn)。同時,在信號失真的情況下也能給出正確的估計結(jié)果。Modelsim SE 6.5c的時序仿真結(jié)果和SignalTaps II的硬件調(diào)試結(jié)果驗證了模塊的有效性。
- 關鍵字: 數(shù)字基帶預失真系統(tǒng) 環(huán)路延遲估計 FPGA
基于FPGA的VHDL語言電路優(yōu)化設計
- 在VHDL語言電路優(yōu)化設計當中,優(yōu)化問題主要包括面積優(yōu)化和速度優(yōu)化。面積優(yōu)化是指CPLD/FPGA的資源利用率優(yōu)化,即用盡可能少的片內(nèi)資源實現(xiàn)更多電路功能;速度優(yōu)化是指設計系統(tǒng)滿足一定的速度要求。
- 關鍵字: 電路優(yōu)化設計 VHDL FPGA
基于FPGA的SoC/IP驗證平臺的設計與應用
- SoC是大規(guī)模集成電路的發(fā)展趨勢。SoC設計必須依靠完整的系統(tǒng)級驗證來保證其正確性?;贔PGA的驗證平臺能夠縮短SoC驗證時間,并提高驗證工作的可靠性,還具有可重用性。本文利用Altera公司的FPGA設計了一個基于片上總線的SoC原型驗證平臺,并將VxWorks嵌入式操作系統(tǒng)應用于此平臺,通過軟硬件協(xié)同驗證的方法,驗證了平臺的可靠性。該平臺在CF卡及通用智能卡SoC芯片驗證中得以應用。
- 關鍵字: SoC驗證平臺 系統(tǒng)級驗證 FPGA
基于FPGA實現(xiàn)CPCI數(shù)據(jù)通信
- 本文設計的系統(tǒng)采用PLX公司生產(chǎn)的CPCI協(xié)議轉(zhuǎn)換芯片PCI9054,通過Verilog HDL語言在FPGA中產(chǎn)生相應的控制信號,完成對數(shù)據(jù)的快速讀寫,從而實現(xiàn)了與CPCI總線的高速數(shù)據(jù)通信。
- 關鍵字: CPCI協(xié)議轉(zhuǎn)換 Verilog FPGA
基于FPGA的主從式高速數(shù)據(jù)采集與傳輸系統(tǒng)
- 針對數(shù)據(jù)采集系統(tǒng)有信號形式多樣、實時傳輸和靈活配置的要求,介紹了一種基于FPGA的數(shù)據(jù)采集和傳輸系統(tǒng),以及系統(tǒng)數(shù)字電路的程序設計。該系統(tǒng)以現(xiàn)場可編程邏輯陣列(FPGA)作為數(shù)據(jù)采集、預處理、組幀和傳輸?shù)目刂坪诵?,通過低速串口接收控制命令,以高速USB接口向控制臺發(fā)送采集數(shù)據(jù)幀,設計了數(shù)字FIR濾波器濾除采集電路的信號干擾。
- 關鍵字: 數(shù)字FIR濾波器 數(shù)據(jù)采集系統(tǒng) FPGA
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