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【E課堂】幾組實(shí)用FPGA原理設(shè)計(jì)圖

  • 　　FPGA(Field-Programmable?Gate?Array)，即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。FPGA的開發(fā)相對(duì)于傳統(tǒng)PC、單片機(jī)的開發(fā)有很大不同。FPGA以并行運(yùn)算為主，以硬件描述語(yǔ)言來(lái)實(shí)現(xiàn);相比于PC或單片機(jī)(無(wú)論是馮諾依曼結(jié)構(gòu)還是哈佛結(jié)構(gòu))的順序操作有很大區(qū)別，也造成了FPGA開發(fā)入
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FPGA學(xué)習(xí)筆記之mif文件生成方法總結(jié)

  • 　　方法1：利用Quartus自帶的mif編輯器　　優(yōu)點(diǎn)：對(duì)于小容量RAM可以快速方便的完成mif文件的編輯工作，不需要第三方軟件的編輯;　　缺點(diǎn)：一旦數(shù)據(jù)量過大，一個(gè)一個(gè)的輸入會(huì)使人崩潰;　　使用方法：在quartus中，【file】/【new】，選擇Memory?Initialization?file，彈出如下窗口：　　Number?of?words：可尋址的存儲(chǔ)單元數(shù)，對(duì)于8bit地址線，此處選擇256;　　words?size：存儲(chǔ)單元寬度，8bi
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詳解人工智能芯片 CPU/GPU/FPGA有何差異？

  • CPU與GPU在各自領(lǐng)域都可以高效地完成任務(wù)，但當(dāng)同樣應(yīng)用于通用基礎(chǔ)計(jì)算領(lǐng)域時(shí)，設(shè)計(jì)架構(gòu)的差異直接導(dǎo)致了兩種芯片性能的差異。
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FPGA外圍電路集成運(yùn)算放大器實(shí)用電路分析（四）

  • 　　首先，我們簡(jiǎn)單來(lái)介紹下比較器　　?? ?　　1.12?過零比較器　　?? ?　　1.13?一般單限比較器　　?? ?　　1.14?滯回比較器　　?? ?　　1.15?窗口比較器　　?? ?　　本次專題到此結(jié)束，謝謝大家閱讀，希望對(duì)大家有所幫助
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魏少軍關(guān)于《中國(guó)IC設(shè)計(jì)業(yè)宏觀分析和未來(lái)發(fā)展方向》報(bào)告

  • 　　清華大學(xué)微納電子學(xué)系主任暨中國(guó)半導(dǎo)體行業(yè)協(xié)會(huì)IC設(shè)計(jì)分會(huì)理事長(zhǎng)魏少軍教授，一如繼往地對(duì)于中國(guó)IC設(shè)計(jì)產(chǎn)業(yè)給出他獨(dú)家的宏觀分析，以及魏教授本人對(duì)于中國(guó)IC產(chǎn)業(yè)的未來(lái)發(fā)展方向的點(diǎn)評(píng)。 　　   　　   　　   　　   　　   　　   　　   　　   　　
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FPGA外圍電路集成運(yùn)算放大器實(shí)用電路分析（三）

  • 　　今天繼續(xù)更新FPGA外圍電路集成運(yùn)算放大器的信號(hào)產(chǎn)生電路，let's?go~~　　?? ?　　1.11?方波發(fā)生電路　　?? 　　今天的信號(hào)產(chǎn)生電路部分就到這了，下節(jié)將會(huì)介紹電壓比較器部分，敬請(qǐng)期待!
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英特爾：下一代DNN到來(lái)時(shí) 未來(lái)FPGA能將敗GPU

  • 當(dāng)下一代DNN到來(lái)時(shí)，F(xiàn)PGA的表現(xiàn)能否擊敗GPU?英特爾對(duì)比兩代FPGA以及最新的TITAN X GPU，結(jié)果顯示目前DNN算法的趨勢(shì)可能有利于FPGA。
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FPGA外圍電路集成運(yùn)算放大器實(shí)用電路分析（二）

  • 　　今天我們更新FPGA外圍電路集成運(yùn)算放大器的第二部分　　1.5?加減運(yùn)算電路　　? 5.jpg906x336?35.4?KB? ?　　? ?　　1.6積分運(yùn)算電路　　? ?　　在使用積分器時(shí)，為了防止低頻信號(hào)增益過高，常在電容上并聯(lián)一個(gè)電阻，如下圖所示　　? ?　　1.7微分運(yùn)算電路　　? ?　　實(shí)用微分電路如下圖所示，其中R1用以限制輸入電流;穩(wěn)壓二
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FPGA外圍電路集成運(yùn)算放大器實(shí)用電路分析（一）

  • 　　集成運(yùn)算放大器加上反饋電路，使其具有各種各樣的特性，實(shí)現(xiàn)各種各樣的電路功能，集成運(yùn)算放大器的主要應(yīng)用有：　　DC放大器——DC低頻信號(hào)的放大器?！　∫纛l放大器——數(shù)十赫茲至數(shù)十千赫茲的低頻信號(hào)的放大器。　　視頻放大器——數(shù)十赫茲至數(shù)十兆赫茲的視頻信號(hào)的放大器?！　∮性礊V波器——低通濾波器、高通濾波器、帶通濾波器、帶阻濾波器。　　模擬運(yùn)算——模擬信號(hào)的加法、減法、微分、積分等運(yùn)算。　　信號(hào)的發(fā)生和轉(zhuǎn)換——正弦波振蕩電路、矩形波發(fā)生電路、電壓比較器、電壓—電流轉(zhuǎn)換電路等?！　??集成運(yùn)算放大器典
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跳上Avalon總線：一種簡(jiǎn)化的FPGA接口

  • 　　引言　　許多新式FPGA設(shè)計(jì)采用了一些用于控制的嵌入式處理器。一種典型解決方案需要使用諸如NIOS等嵌入式軟處理器。另一種解決方案則使用包含一個(gè)內(nèi)置硬處理器的SoC(片上系統(tǒng))器件。圖1所示為一個(gè)典型的Altera?FPGA系統(tǒng)，該系統(tǒng)包含處理器和一系列通過Avalon內(nèi)存映射(MM)總線連接的外設(shè)。這些處理器極大地簡(jiǎn)化了最終應(yīng)用，但是要求開發(fā)人員擁有堅(jiān)實(shí)的編程背景和精細(xì)復(fù)雜工具鏈的相關(guān)知識(shí)。這會(huì)阻礙調(diào)試工作的推進(jìn)，特別是如果硬件工程師需要一種不會(huì)煩擾軟件工程師即可完成外設(shè)讀寫的簡(jiǎn)單方法?！?/li>
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超強(qiáng)科普帖：薩德到底是個(gè)什么鬼？

  • 這個(gè)“薩德”到底是什么鬼，為什么中國(guó)對(duì)它如此敏感?下面就用來(lái)自“路透社”(Reuters)制作的“薩德”詳解圖，給大家科普下。
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基于FPGA的分時(shí)長(zhǎng)期演進(jìn)能量擴(kuò)散模塊實(shí)現(xiàn)

  • 　　*基金項(xiàng)目：國(guó)家科技重大專項(xiàng)(編號(hào)：2016ZX03002010)　　引言　　我國(guó)移動(dòng)通信的發(fā)展經(jīng)歷了從模擬到數(shù)字的過程，包括TACS、GSM、CDMA等2G移動(dòng)通信系統(tǒng)以及WCDMA和TD-SCDMA等3G移動(dòng)通信系統(tǒng)。3G及其以后的移動(dòng)通信系統(tǒng)追求的主要目標(biāo)是高速率數(shù)據(jù)、廣覆蓋和大容量。我國(guó)已從3G逐步過渡到4G無(wú)線技術(shù)，隨著4G技術(shù)的大量普及，其峰值速率要求越來(lái)越高，比如4G中低速移動(dòng)性時(shí)峰值傳輸速率能超過100Mbit/s甚至更高。鑒于4G?TD-LTE標(biāo)準(zhǔn)下傳輸速率要求過高，本文在
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2016年FPGA供貨商營(yíng)收排行榜

  • 　　FPGA供貨商的表現(xiàn)看來(lái)超越整體半導(dǎo)體市場(chǎng)... 　　筆者在先前的一篇文章提到，2016年對(duì)半導(dǎo)體產(chǎn)業(yè)來(lái)說是艱難的一年，最后的統(tǒng)計(jì)數(shù)字也顯示整體產(chǎn)業(yè)成長(zhǎng)表現(xiàn)平平;不過在FPGA領(lǐng)域卻看到不少變化，最引人矚目的就是英特爾(Intel)在2015年完成收購(gòu)Altera。 　　另一家FPGA供貨商Microsemi則在2015年完成收購(gòu)PMC-Sierra，接著又將遠(yuǎn)程無(wú)線電頭端業(yè)務(wù)(Remote Radio Head Business)出售給MaxLinear，以及將電路板級(jí)產(chǎn)品出售給Mercury
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理解并滿足FPGA電源要求(下)

  • 接上篇5 電源是一種系統(tǒng)級(jí)問題電源軌通常有特殊的硬件和互操作性要求，而當(dāng)前的 需求很大程度上取決于每一用戶獨(dú)特的設(shè)計(jì)，因此，盡可能 在設(shè)計(jì)早期階段考慮FPGA電源管理就顯得非常重要。系統(tǒng) 級(jí)決定包括電源供電分組和排序、數(shù)字控制，而硬件設(shè)計(jì)對(duì) 系統(tǒng)性能、成本和設(shè)計(jì)時(shí)間有較高的要求，這意味著要通過 合理的規(guī)劃來(lái)降低風(fēng)險(xiǎn)。6 ?電源軌分組和排序一片F(xiàn)PG A會(huì)有很多需要電源供電的輸入引腳， 但是 并沒有必要為每一FPGA電源軌輸入專門供電。對(duì)于每一種 FPGA，Altera提供了引腳連接指南文檔，不但
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理解并滿足FPGA電源要求(上)

  • ? ? ?靈活的FPGA實(shí)現(xiàn)方案具有很多優(yōu)勢(shì)但也面臨很大的挑戰(zhàn)：為FPGA供電以確保無(wú)縫工作。本白皮書旨在找到是什 么原因?qū)е翭PGA供電越來(lái)越復(fù)雜，介紹設(shè)計(jì)FPGA電源樹時(shí) 必須要綜合考慮的問題，研究FPGA電源為什么是真正的系 統(tǒng)級(jí)問題，這一系統(tǒng)級(jí)問題為什么日益突出。1 是什么決定了FPGA電源要求?FPGA的功耗需求是由固定的和變化的兩種因素綜合決 定的：工藝技術(shù)和硅片設(shè)計(jì)所帶來(lái)的靜態(tài)功耗，以及每一設(shè) 計(jì)獨(dú)特的應(yīng)用所帶來(lái)的動(dòng)態(tài)功耗。動(dòng)態(tài)功耗是每一資源具體的使用及其使用量
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