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解析ADC不同類型數(shù)字輸出及挑戰(zhàn) ― 全方位學(xué)習(xí)模數(shù)轉(zhuǎn)換器(ADC)

  • ADC不同類型數(shù)字輸出深解在當(dāng)今的模數(shù)轉(zhuǎn)換器(ADC)領(lǐng)域，ADC制造商主要采用三類數(shù)字輸出。這三種輸出分別是：互補金屬氧化物半導(dǎo)體(CMOS)、低壓差分信號(LVDS)和電流模式邏輯(CML)。每類輸出均基于采樣速率、分辨率、
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ADC輸入轉(zhuǎn)換器電路分析 ― 全方位學(xué)習(xí)模數(shù)轉(zhuǎn)換器(ADC)

  • ADC輸入轉(zhuǎn)換器電路分析許多高精度模/數(shù)轉(zhuǎn)換器的輸入范圍要求介于0.0V至5.0V之間。例如，MAX1402 (18位多通道Sigma;-Delta; ADC)測量兩個輸入之間的差值。典型的單端應(yīng)用中，該ADC將輸入電壓與固定的基準(zhǔn)電壓(例如2
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ADC關(guān)鍵性能指標(biāo)及誤區(qū) ― 全方位學(xué)習(xí)模數(shù)轉(zhuǎn)換器(ADC)

  • ADC關(guān)鍵性能指標(biāo)及誤區(qū)由于ADC產(chǎn)品相對于網(wǎng)絡(luò)產(chǎn)品和服務(wù)器需求小很多，用戶和集成商在選擇產(chǎn)品時對關(guān)鍵指標(biāo)的理解難免有一些誤區(qū)，加之部分主流廠商刻意引導(dǎo)，招標(biāo)規(guī)范往往有不少非關(guān)鍵指標(biāo)作被作為必須符合項。接下
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JESD204B轉(zhuǎn)換器內(nèi)確定性延遲解密

  • 對于需要一系列同步模數(shù)轉(zhuǎn)換器(ADC)的高速信號采樣和處理應(yīng)用，轉(zhuǎn)換器具有去相位偏移和匹配延遲變化的能力至關(guān)重要。圍繞該特性展開的系統(tǒng)設(shè)計極為關(guān)鍵，因為從模擬采樣點到處理模塊之間的任何延遲失配都會使性能下
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用于±10 V輸入的12位、300 kSPS、單電源、完全隔離式數(shù)據(jù)采集系統(tǒng)

  • 連接/參考器件AD8606/ 精密、低噪聲、雙通道CMOS、軌到軌輸入/輸出運算放大器AD7091R/ 1 MSPS、超低功耗、12位ADCADuM5401/ 集成DC/DC轉(zhuǎn)換器的四通道2.5 kV隔離器12位、300 kSPS、單電源、完全隔離式數(shù)據(jù)采集系統(tǒng)，
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大信號輸出的硅應(yīng)變計與模數(shù)轉(zhuǎn)換器(ADC)的接口實現(xiàn)方法

  • 電橋是精密測量電阻或其他模擬量的一種有效的方法。本文介紹了如何實現(xiàn)具有較大信號輸出的硅應(yīng)變計與模數(shù)轉(zhuǎn)換器(ADC)的接口，特別是Sigma;-Delta; ADC，當(dāng)使用硅應(yīng)變計時，它是一種實現(xiàn)壓力變送器的低成本方案　　
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基于單片機(jī)的數(shù)控恒流源系統(tǒng)設(shè)計

  • 摘要：主要介紹了一種高穩(wěn)定性恒流源系統(tǒng)的設(shè)計方案，該系統(tǒng)在負(fù)載為1Omega;～15Omega;時，恒流輸出可調(diào)范圍0A～1A，且恒流源電流可以在該范圍內(nèi)任意設(shè)定，精度為plusmn;3mA。該恒流源系統(tǒng)主要由PIC單片機(jī)電路、A
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用于低噪聲CMOS圖像傳感器的流水線ADC設(shè)計及其成像驗證

  • 摘要：在對低噪聲CMOS圖像傳感器的研究中，除需關(guān)注其噪聲外，目前數(shù)字化也是它的一個重要的研究和設(shè)計方向，設(shè)計了一種可用于低噪聲CMOS圖像傳感器的12 bit，10 Msps的流水線型ADC，并基于0．5mu;m標(biāo)準(zhǔn)CMOS工藝進(jìn)行
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SoC內(nèi)ADC子系統(tǒng)集成驗證挑戰(zhàn)

  • 現(xiàn)實世界的本質(zhì)就是模擬。我們需要從周圍世界采集的任何信息始終是一個模擬值。但要在微處理器內(nèi)處理模擬數(shù)據(jù)需要先將這些數(shù)據(jù)轉(zhuǎn)換為數(shù)字形式。因此，SoC中使用多種不同的ADC(模數(shù)轉(zhuǎn)換器)。根據(jù)幾個參數(shù)(即吞吐量、
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Giga ADC 介紹及雜散分析

  • 摘要Giga ADC 是 TI 推出的采樣率大于 1GHz 的數(shù)據(jù)轉(zhuǎn)換產(chǎn)品系列，主要應(yīng)用于微波通信、衛(wèi)星通信以及儀器儀表。本文介紹了 Giga ADC 的主要架構(gòu)以及 ADC 輸出雜散的成因分析，以及優(yōu)化性能的主要措施。1、Giga ADC
  • 關(guān)鍵字： Giga  ADC  雜散分析  射頻  通信  

在不損失SNR的前提下，將高壓信號轉(zhuǎn)換成低壓ADC輸入

  • 　　模/數(shù)轉(zhuǎn)換器(ADC)電路設(shè)計中，特別是當(dāng)系統(tǒng)設(shè)計人員需要處理各種擺幅的電壓信號時，很容易產(chǎn)生的一個誤區(qū)是縮小輸入信號范圍，以適應(yīng)ADC的滿量程范圍，這將大大降低信噪比(SNR)。綜合來看，相對于高壓ADC，低壓(5V或者更低) ADC的選擇范圍更寬。高電源電壓通常會導(dǎo)致大的功耗，電路板設(shè)計也更加復(fù)雜，例如，需要使用更多的去耦電容。這篇應(yīng)用筆記討論了由于信號縮小所引起的SNR損失，如何量化這些損失，以及如何減小這些損失。 　　很多傳感器或系統(tǒng)輸出為高壓或雙極性消耗，比如，常見的±10V
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【E課堂】Σ-Δ型ADC拓?fù)浣Y(jié)構(gòu)基本原理：第二部分

  • 　　AD717x是ADI公司最新系列的精密Σ-Δ型ADC。該ADC系列是市場上第一個提供真正24位無噪聲輸出的轉(zhuǎn)換器系列。AD717x器件可使對噪聲異常敏感的儀器儀表電路的動態(tài)范圍最大化，支持降低或消除信號調(diào)理級中的前置放大器增益。這些器件還能高速運行，提供比以前更短的建立時間。由此可縮短器件對控制環(huán)路對輸入激勵信號的響應(yīng)時間，或通過更快的每通道吞吐速率來提高轉(zhuǎn)換通道密度。 　　AD717x頁面(analog.com )提供了完整系列的詳細(xì)信息，包括有關(guān)AD7172-2、AD71
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【E課堂】Σ-Δ型ADC拓?fù)浣Y(jié)構(gòu)基本原理

  • 　　Σ-Δ型ADC是當(dāng)今信號采集和處理系統(tǒng)設(shè)計人員的工具箱中必不可少的基本器件。本文的目的是讓讀者對Σ-Δ型號ADC拓?fù)浣Y(jié)構(gòu)背后的根本原理有一個基本了解。本文探討了與ADC子系統(tǒng)設(shè)計相關(guān)的噪聲、帶寬、建立時間和所有其他關(guān)鍵參數(shù)之間的權(quán)衡分析示例，以便為精密數(shù)據(jù)采集電路設(shè)計人員提供背景信息。 　　它通常包括兩個模塊：Σ-Δ調(diào)制器和數(shù)字信號處理模塊，后者通常是數(shù)字濾波器。Σ-Δ型ADC的簡要框圖和主要概念如圖1所
  • 關(guān)鍵字： ADC  數(shù)字濾波器  

關(guān)于STM8S ADC腳與其它功能復(fù)用時的問題

  • 　　之前寫過一篇關(guān)于STM8S芯片GPIO腳復(fù)用AD功能后無法回到GPIO狀態(tài)的小文，介紹STM8S芯片的ADC應(yīng)用時相關(guān)施密特觸發(fā)器未適時開關(guān)而導(dǎo)致的問題。 　　大致內(nèi)容就是某一GPIO口被復(fù)用為AD輸入腳做相關(guān)AD檢測。之后，把該腳AD功能禁用掉，再配置切換為帶下降沿觸發(fā)的外部中斷觸發(fā)腳，讓其作為芯片休眠喚醒腳。 　　奇怪的是，那樣設(shè)置后根本沒法喚醒。即使不做休眠，做好切換配置后，直接查看該腳的IDR位的電平，不管外部輸入如何，發(fā)現(xiàn)對應(yīng)IDR位始終提示為0. 　　后來找到原因是跟那個施密特觸發(fā)器
  • 關(guān)鍵字： STM8S  ADC  

基于變換采樣的超寬帶接收機(jī)設(shè)計

  • 基于變換采樣的超寬帶接收機(jī)設(shè)計, 在高精度UWB定位系統(tǒng)中，目標(biāo)信號是超短脈寬的脈沖，有很寬的帶寬，為了對這種寬帶信號進(jìn)行處理，我們要求如下兩個條件。1)設(shè)計應(yīng)該實現(xiàn)超高的采樣率。對于UWB定位系統(tǒng)，恢復(fù)較好的脈沖波形以獲得較高時間分辨率信息
  • 關(guān)鍵字： 變換采樣  FPGA  可編程延時芯片  ADC  UWB  接收機(jī)  
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