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解析ADC不同類型數(shù)字輸出及挑戰(zhàn) ― 全方位學(xué)習(xí)模數(shù)轉(zhuǎn)換器(ADC)

  • ADC不同類型數(shù)字輸出深解在當(dāng)今的模數(shù)轉(zhuǎn)換器(ADC)領(lǐng)域，ADC制造商主要采用三類數(shù)字輸出。這三種輸出分別是：互補(bǔ)金屬氧化物半導(dǎo)體(CMOS)、低壓差分信號(LVDS)和電流模式邏輯(CML)。每類輸出均基于采樣速率、分辨率、
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工業(yè)信號電平的單電源ADC系統(tǒng)設(shè)計

  • 連接/參考器件AD7176-2 24位、250 kSPS Sigma;-Delta;型ADC，建立時間20 mu;sAD8475 精密、可選增益、全差分漏斗放大器ADR445 5 V超低噪聲LDO XFET基準(zhǔn)電壓源評估和設(shè)計支持電路評估板AD7176-2電路評估板(EVAL-A
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好噪聲？壞噪聲？教你認(rèn)識ADC輸入噪聲

  • 引言所有模數(shù)轉(zhuǎn)換器(ADC)都有一定數(shù)量的折合到輸入端的噪聲——它被看作一種與無噪聲ADC的輸入端串聯(lián)的噪聲源模型。不能把折合到輸入端的噪聲與量化噪聲相混淆，量化噪聲僅在ADC處理隨時間變化的信號時有
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ADC應(yīng)用工程師困惑：是ENOB還是有效分辨率？

  • 您可能知道，有效位數(shù) (ENOB) 和有效分辨率都是與 ADC 分辨率有關(guān)的參數(shù)。理解它們的區(qū)別并確定哪個更具相關(guān)性，是令 ADC 用戶與應(yīng)用工程師等極為困惑的問題，經(jīng)常因此發(fā)生爭論。您認(rèn)為哪個更重要?ADC 的分辨率位數(shù)
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高動態(tài)范圍ADC：逐次逼近型抑或Σ-Δ型？

  • 工業(yè)、儀器儀表和醫(yī)療設(shè)備中使用的高性能數(shù)據(jù)采集信號鏈需要寬動態(tài)范圍和高精度。 通過增加可編程增益放大器，或者并聯(lián)使用多個ADC，然后利用數(shù)字后處理對結(jié)果進(jìn)行平均，可以提高ADC的動態(tài)范圍，但受制于功耗、空間
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強(qiáng)化無線通信濾波效果 連續(xù)時間ΔΣ調(diào)制器受矚目

  • 連續(xù)時間Sigma;-Delta;調(diào)制器(Continuous-Time Delta;Sigma; Modulator)先天上具有對輸入信號濾波的效果，可降低前級濾波器設(shè)計復(fù)雜度，并提升信號質(zhì)量，因而成為現(xiàn)今無線通信系統(tǒng)接收機(jī)(Receiver)設(shè)計的常用方
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SAR ADC功率技術(shù)規(guī)格的謎團(tuán)

  • 逐次逼近寄存器(SAR)型ADC的謎團(tuán)之一，或者至少是造成嚴(yán)重混淆的原因，就是計算系統(tǒng)級的確切電源需求。經(jīng)研究發(fā)現(xiàn)，相關(guān)技術(shù)手冊對于該技術(shù)規(guī)格讓人難以捉摸，而且令人沮喪。SAR ADC提供一種低功耗方法來測量輸入信
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噪聲：模擬輸入的諸多討論

  • 在考慮噪聲因素以及與ADC模擬輸入和共模電壓節(jié)點有關(guān)的其他失真情況時，自帶開關(guān)電容輸入采樣網(wǎng)絡(luò)的ADC同樣也可作為一個簡單的指標(biāo)。圖1顯示集成驅(qū)動放大器和抗混疊濾波器(AAF)的典型ADC模擬輸入。集成放大器和AAF的
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定制化PSoC實現(xiàn)8通道SAR ADC采樣16通道

  • 通過ADC進(jìn)行信號采樣是MCU應(yīng)用的常見任務(wù)，這可以將連續(xù)模擬信號轉(zhuǎn)換為一系列離散的數(shù)字?jǐn)?shù)據(jù)供MCU處理。在某些應(yīng)用中，單個ADC需要以高采樣率對多個通道進(jìn)行采樣。例如電源監(jiān)測系統(tǒng)的管理子系統(tǒng)需要對多個穩(wěn)壓電源的
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理解ADC電源噪聲的PSRR與PSMR

  • 研究電源噪聲時有三個熟悉的術(shù)語，分別是：PSRR-DC、PSRR-AC和PSMR。其中PSRR表示電源抑制比，PSMR表示電源調(diào)制比。為了理解電源噪聲入口，需要了解這些術(shù)語，以及它們對于ADC的含義。 一般而言，這些術(shù)語告訴我們?nèi)?/li>
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逐次逼近型 ADC：確保首次轉(zhuǎn)換有效

  • 簡介最高 18 位分辨率、10 MSPS 采樣速率的逐次逼近型模數(shù)轉(zhuǎn)換器(ADC)可以滿足許多數(shù)據(jù)采集應(yīng)用的需求，包括便攜式、工 業(yè)、醫(yī)療和通信應(yīng)用。本文介紹如何初始化逐次逼近型 ADC 以實現(xiàn)有效轉(zhuǎn)換。逐次逼近型架構(gòu)逐次
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為逐次逼近型ADC 設(shè)計可靠的數(shù)字接口

  • 簡介逐次逼近型模數(shù)轉(zhuǎn)換器(因其逐次逼近型寄存器而稱為SAR ADC)廣泛運用于要求最高18 位分辨率和最高5 MSPS 速率的應(yīng)用中。其優(yōu)勢包括尺寸小、功耗低、無流水線延遲和易用。主機(jī)處理器可以通過多種串行和并行接口(
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針對交流性能優(yōu)化的18 位、5 MSPS數(shù)據(jù)采集系統(tǒng)

  • 電路功能與優(yōu)勢圖1中的電路是一款完整的18位、5 MSPS、低功耗、低噪聲、高精度數(shù)據(jù)采集信號鏈解決方案，功耗僅122 mW。基準(zhǔn)電壓源、基準(zhǔn)電壓源緩沖器、驅(qū)動放大器和ADC提供優(yōu)化解決方案，具有業(yè)界領(lǐng)先的99 dB SNR和
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用于±10 V輸入的12位、300 kSPS、單電源、完全隔離式數(shù)據(jù)采集系統(tǒng)

  • 連接/參考器件AD8606/ 精密、低噪聲、雙通道CMOS、軌到軌輸入/輸出運算放大器AD7091R/ 1 MSPS、超低功耗、12位ADCADuM5401/ 集成DC/DC轉(zhuǎn)換器的四通道2.5 kV隔離器12位、300 kSPS、單電源、完全隔離式數(shù)據(jù)采集系統(tǒng)，
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JESD204B轉(zhuǎn)換器內(nèi)確定性延遲解密

  • 對于需要一系列同步模數(shù)轉(zhuǎn)換器(ADC)的高速信號采樣和處理應(yīng)用，轉(zhuǎn)換器具有去相位偏移和匹配延遲變化的能力至關(guān)重要。圍繞該特性展開的系統(tǒng)設(shè)計極為關(guān)鍵，因為從模擬采樣點到處理模塊之間的任何延遲失配都會使性能下
  • 關(guān)鍵字： JESD204B    ADC    FPGA  
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