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如何不大量犧牲 AC 性能的情況下利用開(kāi)關(guān)穩(wěn)壓器在為高速 ADC 供電

  • 在選擇高速數(shù)據(jù)轉(zhuǎn)換器時(shí)，功耗是最為重要的系統(tǒng)設(shè)計(jì)參數(shù)之一。不管是更長(zhǎng)電池使用壽命的便攜式設(shè)計(jì)，還是散熱能力較低的小型產(chǎn)品，數(shù)據(jù)轉(zhuǎn)換器的功耗都至關(guān)重要。一般而言，系統(tǒng)設(shè)計(jì)人員都通過(guò)一個(gè)低噪線性穩(wěn)壓器（例
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適合高效精密控制的高速、高精度、低功耗ADC

  • 當(dāng)今的馬達(dá)控制與汽車(chē)應(yīng)用設(shè)計(jì)要求高速ADC能夠?qū)o助輸入/輸出信號(hào)進(jìn)行數(shù)字化，將結(jié)果實(shí)時(shí)輸出至處理器，并同步進(jìn)行采樣以維持正確的相位信息。在小尺寸封裝內(nèi)滿足這些要求是所有IC供應(yīng)商面臨的挑戰(zhàn)。解決方案AD7356
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ADC設(shè)計(jì)挑戰(zhàn)：從高性能轉(zhuǎn)向低功耗

  • 　新的應(yīng)用需求不斷推動(dòng)模擬技術(shù)的發(fā)展：性能越來(lái)越高，集成度不斷提高。ADC產(chǎn)品作為模擬IC的重要成員，在符合上述發(fā)展的趨勢(shì)下，還存在自身的特點(diǎn)hellip;hellip;

    　　當(dāng)使用“巧克力”手機(jī)時(shí)，不用按
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3GSps超高速ADC系統(tǒng)設(shè)計(jì)解決方案

  • 包含千兆采樣率ADC的系統(tǒng)設(shè)計(jì)會(huì)遇到許多復(fù)雜情況。面臨的主要挑戰(zhàn)包括時(shí)鐘驅(qū)動(dòng)、模擬輸入級(jí)和高速數(shù)字接口。本文探討了如何才能克服這些挑戰(zhàn)，并給出了在千兆赫茲的速度下進(jìn)行系統(tǒng)優(yōu)化的方法。在討論中，時(shí)鐘設(shè)計(jì)、差
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ADC的SNR：位數(shù)到底去那了？

  • 理論上，一個(gè)ADC的SNR(信號(hào)與噪聲的比值)等于(6.02N＋1.76)dB，這里N等于ADC的位數(shù)。雖然我的數(shù)學(xué)技巧有點(diǎn)生疏，但我認(rèn)為任何一個(gè)16位轉(zhuǎn)換器的信噪比應(yīng)該是98.08dB。但當(dāng)我查看模數(shù)轉(zhuǎn)換器 的數(shù)據(jù)手冊(cè)時(shí)，我看到一些不
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一種多路可編程高速時(shí)鐘電路的設(shè)計(jì)

  • 摘要：本文采用博亞20MHz高穩(wěn)定度晶體振蕩器、集成VCO的低相位噪聲鎖相環(huán)時(shí)鐘芯片LMX2531、高精度時(shí)鐘扇出器HMC987LP5E和多階低通濾波器，實(shí)現(xiàn)具有低相噪特性的4路并行輸出、頻率最高為2.5GHz的高速時(shí)鐘電路的設(shè)計(jì)。
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一種可重構(gòu)流水線ADC的設(shè)計(jì)

  • 摘要：對(duì)多標(biāo)準(zhǔn)無(wú)線通信系統(tǒng)中的A／D轉(zhuǎn)換器進(jìn)行了研究，根據(jù)無(wú)線通信系統(tǒng)的特點(diǎn)，構(gòu)建了一個(gè)新型可重構(gòu)流水線A／D轉(zhuǎn)換器結(jié)構(gòu)，該A／D轉(zhuǎn)換器的可重構(gòu)功能是通過(guò)在低分辨率下關(guān)斷子級(jí)流水線來(lái)實(shí)現(xiàn)的。轉(zhuǎn)換器的系統(tǒng)指標(biāo)
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三階單環(huán)Delta-sigma調(diào)制器在ADC中的應(yīng)用

  • 0 引言　　模數(shù)轉(zhuǎn)換器(ADC)在信號(hào)處理中起了一個(gè)非常重要的作用。在數(shù)字音頻、數(shù)字電視、圖像編碼及頻率合 ...
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為高速ADC選擇最佳的緩沖放大器

  • Maxim 高速ADC MAX12559 MAX2055 MAX2027 緩沖器現(xiàn)代通信系統(tǒng)創(chuàng)新設(shè)計(jì)主要表現(xiàn)在直接變頻和高中頻架構(gòu)，全數(shù)字接收機(jī)的設(shè)計(jì)目標(biāo)要求模數(shù)轉(zhuǎn)換器(ADC)以更高的采樣率提供更高的分辨率(擴(kuò)大系統(tǒng)的動(dòng)態(tài)范圍)。在新興的3G
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什么是雙積分式ADC（模數(shù)轉(zhuǎn)換器）

  • ADC 雙積分式1.轉(zhuǎn)換方式V-T型間接轉(zhuǎn)換ADC。2. 電路結(jié)構(gòu)圖11.11.1是這種轉(zhuǎn)換器的原理電路，它由積分器(由集成運(yùn)放A組成)、過(guò)零比較器(C)、時(shí)鐘脈沖控制門(mén)(G)和計(jì)數(shù)器(FF0～FFn)等幾部分組成。 圖11.11.1 雙積分A/D轉(zhuǎn)
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什么是并行比較型ADC

  • ADC 并行比較型1.轉(zhuǎn)換方式直接轉(zhuǎn)換ADC。2.電路結(jié)構(gòu)3位并行比較型A/D轉(zhuǎn)換器原理電路如圖11.9.1所示。它由電阻分壓器、電壓比較器、寄存器及編碼器組成。
    圖11.9.1 3位并行A/D轉(zhuǎn)換器3.工作原理圖中的8個(gè)電阻將參考電
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什么是逐次比較型ADC

  • ADC 逐次比較型1.轉(zhuǎn)換方式直接轉(zhuǎn)換ADC2.電路結(jié)構(gòu)逐次逼近ADC包括n位逐次比較型A/D轉(zhuǎn)換器如圖11.10.1所示。它由控制邏輯電路、時(shí)序產(chǎn)生器、移位寄存器、D/A轉(zhuǎn)換器及電壓比較器組成。
    圖11.10.1逐次比較型A/D轉(zhuǎn)換器框
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找出微處理器ADC電壓的十六進(jìn)制編碼值

  • 這種設(shè)計(jì)方案針對(duì)低檔八管腳flash存儲(chǔ)的8位微處理器，例如Freescale的MC68HC908QT4A，但是它也同樣適用于任何一款擁有ADC模塊的8位微處理器。在芯片內(nèi)，ADC轉(zhuǎn)換輸入的模擬電壓成數(shù)字信號(hào)格式。數(shù)字信號(hào)格式為8位的十
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Stellaris系列微控制器的ADC過(guò)采樣技術(shù)（二）

  • 例1 利用驅(qū)動(dòng)庫(kù)函數(shù)的8x過(guò)采樣代碼段1.a ADC配置－驅(qū)動(dòng)庫(kù)函數(shù)// // 初始化ADC，使用定序器0對(duì)通道1進(jìn)行8x過(guò)采樣// 定序器將被其中一個(gè)通用定時(shí)器觸發(fā)// ADCSequenceConfigure(ADC_BASE, 0, ADC_TRIGGER_TIMER, 0);
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Stellaris系列微控制器的ADC過(guò)采樣技術(shù)（一）

  • 概述 Luminary Micro在Stellaris系列微控制器的部分產(chǎn)品中提供了模數(shù)轉(zhuǎn)換器（ADC）模塊。ADC的硬件分辨率為10位，但由于噪音和其它使精度變
  • 關(guān)鍵字： 采樣  技術(shù)  ADC  控制器  系列  Stellaris  
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adc）介紹

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