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EEPW首頁 >> 主題列表 >> cpld／fpga

基于FPGA的SOC外部組件控制器IP的設(shè)計

  • 1 引言

    嵌入式系統(tǒng)已經(jīng)發(fā)展成為應(yīng)用最廣的計算機系統(tǒng)［1］。SOC（System On a Chip）則是嵌入式系統(tǒng)的研究和開發(fā)熱點。SOC 的核心概念是把整個系統(tǒng)集成到一片半導(dǎo)體芯片上。目前SOC 的中文名稱還不統(tǒng)一，可被叫做
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基于FPGA的NCO設(shè)計方案

  • 　隨著數(shù)字通信技術(shù)的飛速發(fā)展，軟件無線電的應(yīng)用愈加的廣泛， 而影響軟件無線電性能的關(guān)鍵器件數(shù)控振蕩器NCO(Numerical CONtrolled Oscillator) 的設(shè)計至關(guān)重要直接數(shù)字頻率合成(DDS)技術(shù)是一種從相位概念出發(fā)直接合
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基于C/C++的大規(guī)模FPGA設(shè)計

  • 背景可編程邏輯器件的設(shè)計方法經(jīng)歷了布爾等式，原理圖輸入，硬件描語言這樣一個發(fā)展過程。隨著設(shè)計的日益復(fù)雜和可編程邏輯器件規(guī)模的不斷擴大，人們不停地尋求更加抽象的行為級設(shè)計方法，以便在盡可能短時間內(nèi)完成自
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CPLD與16C554在航空發(fā)動機參數(shù)采集器中的應(yīng)用

  • 0 引 言

    隨著航空工業(yè)和計算機工業(yè)的飛速發(fā)展，傳統(tǒng)的機械式儀表已經(jīng)逐漸被數(shù)字顯示儀表所替代，嵌入式系統(tǒng)越來越多地應(yīng)用于航空儀表之中。航空發(fā)動機是飛機上最重要的部件之一，需要測量的數(shù)據(jù)較多，而其各項參數(shù)
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多節(jié)點大容量FPGA系統(tǒng)的遠程升級方法

  • 引言　　多節(jié)點系統(tǒng)，在目前的很多電子系統(tǒng)應(yīng)用場合都可以看到。這種多節(jié)點系統(tǒng)由于具有結(jié)構(gòu)可擴展性、功能配置的靈活性以及便于查找故障節(jié)點等良好的可維護性得到了越來越廣泛的應(yīng)用。通常，多節(jié)點系統(tǒng)各個節(jié)點的主
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基于FPGA的嵌入式系統(tǒng)USB接口設(shè)計

  • 基于FPGA的嵌入式系統(tǒng)USB接口設(shè)計,摘要：設(shè)計基于FPGA的IP-BX電話應(yīng)用系統(tǒng)，用于傳統(tǒng)的電話網(wǎng)絡(luò)(PSTN)與PC機之間的接口連接。USB2．0接口器件EZ-USB FX2 CY7C68013A-56工作在slave FIFO模式，為基于FPGA的嵌入式系統(tǒng)與PC機之間提供數(shù)據(jù)和命令通道，從
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裝入CPLD/FPGA的步進電機運動控制器與驅(qū)動器

  • 本設(shè)計實例進一步拓展了以前將步進電機驅(qū)動器集成到CPLD中的設(shè)計（參考文獻1）。本實例不僅集成了驅(qū)動器，而且還集成了一個簡單的單軸步進電機運動控制器。根據(jù)CPLD大小，可以將多個運動控制器設(shè)計到單一設(shè)備中。例如
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利用FPGA解決TMS320C54K與SDRAM的接口問題

  • 在DSP應(yīng)用系統(tǒng)中，需要大量外擴存儲器的情況經(jīng)常遇到。例如，在數(shù)碼相機和攝像機中，為了將現(xiàn)場拍攝的諸多圖...
  • 關(guān)鍵字： FPGA  TMS320C54K  SDRAM  

基于FPGA與外部SRAM的大容量數(shù)據(jù)存儲

  • 1引言我們將針對FPGA中內(nèi)部BlockRAM有限的缺點，提出了將FPGA與外部SRAM相結(jié)合來改進設(shè)計的方法，并給出...
  • 關(guān)鍵字： FPGA  SRAM  

MELP語音編碼的FPGA實現(xiàn)的系統(tǒng)框架

  • NiosII處理器是Intel公司為Altera公司推出的32位精簡指令處理器軟核。在Altera公司推出的軟件SOPC中加載...
  • 關(guān)鍵字： MELP  FPGA  

基于AXI總線的MicroBlaze雙核SoPC系統(tǒng)設(shè)計

  • 目的是利用嵌入在Xilinx FPGA中的MicroBlaze核實現(xiàn)基于AXI總線的雙核嵌入式系統(tǒng)設(shè)計以及共享實現(xiàn)LED燈的時控。對于共享實現(xiàn)LED燈時控的方法是通過在兩個低速總線之間加入一個axi2axi_connector實現(xiàn)axilite總線上的slave共享。對于實現(xiàn)雙核之間的通信主要方法是利用mailbox和mutex完成核間通信。硬件平臺采用的是Xilinx FPGA Spartan -6 Atlys板，軟件平臺是Xilinx EDK，主要使用的是XPS(硬件設(shè)計)和SDK(軟件設(shè)計)，開發(fā)出
  • 關(guān)鍵字： Xilinx  FPGA  AXI  201201  

基于FPGA技術(shù)的智能導(dǎo)盲犬方案設(shè)計

  • 基于FPGA技術(shù)的智能導(dǎo)盲犬方案設(shè)計,眾所周知眼晴是“心靈之窗”，而對于突然失去或從未擁有過“心靈之窗”的盲人來說，生活上的困難與心理上的痛苦是可想而知的。他們的衣食住行存在諸多不便，而在出行與人際交往中遇到的困難更加
  • 關(guān)鍵字： 方案設(shè)計  智能  技術(shù)  FPGA  基于  

基于CPLD/FPGA的VHDL電路優(yōu)化設(shè)計

  • 基于CPLD/FPGA的VHDL電路優(yōu)化設(shè)計,VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)展起來的。它是一種面向設(shè)計、多層次的硬件描述語言，是集行為描述、RTL
  • 關(guān)鍵字： 優(yōu)化  設(shè)計  電路  VHDL  CPLD/FPGA  基于  

Cyclone III FPGA技術(shù)在高清晰LCD HDTV中的應(yīng)用

  • Cyclone III FPGA技術(shù)在高清晰LCD HDTV中的應(yīng)用,當(dāng)今的液晶顯示(LCD) 技術(shù)在高清晰電視(HDTV) 領(lǐng)域得到了廣泛應(yīng)用，其挑戰(zhàn)在于如何獲得更高的分辨率，實現(xiàn)更快的數(shù)據(jù)速率。提高數(shù)據(jù)速率需要專業(yè)圖像處理算法來支持快速移動的視頻。業(yè)界遇到的主要問題是：怎樣實現(xiàn)這
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在FPGA上實現(xiàn)H.264/AVC視頻編碼標(biāo)準(zhǔn)

  • 盡管H.264/AVC承諾將此已有視頻編碼標(biāo)準(zhǔn)具有更高的編碼效率，它仍為系統(tǒng)架構(gòu)師、DSP工程師和硬件設(shè)計人員帶來了巨大的工程設(shè)計挑戰(zhàn)。H.264/AVC 標(biāo)準(zhǔn)引入了自 1990 年推出 H.261 之后視頻編碼標(biāo)準(zhǔn)演進過程中出現(xiàn)的大部
  • 關(guān)鍵字： FPGA  264  AVC  視頻編碼    
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