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CPLD在基于PCI總線的功率模塊設(shè)計(jì)中的應(yīng)用

  •  1 引言  在機(jī)電一體化控制系統(tǒng)中,直流電機(jī)常用于控制系統(tǒng)的執(zhí)行器,是電機(jī)控制的重要部分,能按照處理器指令驅(qū)動(dòng)電機(jī)運(yùn)轉(zhuǎn)實(shí)現(xiàn)電機(jī)控制。目前直流電機(jī)PWM(pulse width modulation,脈寬調(diào)制)驅(qū)動(dòng)控制方式應(yīng)用最為
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基于CPLD的模數(shù)轉(zhuǎn)換組合研究

  • 1引言  

    A/D轉(zhuǎn)換組合是雷達(dá)目標(biāo)諸元數(shù)據(jù)轉(zhuǎn)換、傳輸?shù)暮诵牟考?,一旦出現(xiàn)故障,目標(biāo)信號(hào)將無法傳送到信息處理中心進(jìn)行處理,從而導(dǎo)致雷達(dá)主要功能失效。某設(shè)備的A/D轉(zhuǎn)換設(shè)備結(jié)構(gòu)復(fù)雜,可靠性差,可維修性差,故障
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一種基于FPGA的信道化接收機(jī)的研究與設(shè)計(jì)

  • 現(xiàn)代電子戰(zhàn)場(chǎng)的電磁環(huán)境復(fù)雜多變,信號(hào)環(huán)境朝著密集化、復(fù)雜化、占用電磁頻譜寬帶化的方向發(fā)展。另一方面...
  • 關(guān)鍵字: 信道化接收機(jī)  FPGA  信道化  ADC  

短幀Turbo譯碼器的FPGA實(shí)現(xiàn)

  • 短幀Turbo譯碼器的FPGA實(shí)現(xiàn),  Turbo碼雖然具有優(yōu)異的譯碼性能,但是由于其譯碼復(fù)雜度高,譯碼延時(shí)大等問題,嚴(yán)重制約了Turbo碼在高速通信系統(tǒng)中的應(yīng)用。因此,如何設(shè)計(jì)一個(gè)簡(jiǎn)單有效的譯碼器是目前Turbo碼實(shí)用化研究的重點(diǎn)。本文主要介紹了短幀
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基于CPLD的DSP人機(jī)接口模塊設(shè)計(jì)

  • 基于CPLD的DSP人機(jī)接口模塊設(shè)計(jì),  CPLD(Complex programmable Logic Device,復(fù)雜可編程邏輯器件)是在傳統(tǒng)的PAL、GAL基礎(chǔ)上發(fā)展而來的,具有多種工作方式和高集成、高速、高可靠性等明顯的特點(diǎn)?! ≡诔咚兕I(lǐng)域和實(shí)時(shí)測(cè)控方面有非常廣泛的應(yīng)用,
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基于FPGA處理器的數(shù)字光端機(jī)系統(tǒng)分析

  • 目前在高速公路、交通、電子警察、監(jiān)控、安防、工業(yè)自動(dòng)化、電力、海關(guān)、水利、銀行等領(lǐng)域視頻圖像、音...
  • 關(guān)鍵字: FPGA  處理器  數(shù)字光端機(jī)  

Microsemi發(fā)布全新65nm嵌入式快閃平臺(tái)

  •   致力實(shí)現(xiàn)智能化的安全互連世界的半導(dǎo)體技術(shù)領(lǐng)先供應(yīng)商─美高森美公司(Microsemi Corporation)宣布,旗下SoC產(chǎn)品部門(原為愛特公司Actel Corporation)發(fā)布全新65nm嵌入式快閃平臺(tái),以用于構(gòu)建公司下一代基于快閃的可定制系統(tǒng)級(jí)芯片(system-on-chip, SoC)。美高森美的低功耗智能混合信號(hào)和系統(tǒng)關(guān)鍵系列SoC具有四輸入查找表(look up table, LUT)架構(gòu),將會(huì)集中使用現(xiàn)代化的65nm嵌入式快閃工藝。
  • 關(guān)鍵字: Microsemi  65nm  FPGA  

美高森美擴(kuò)展溫度范圍的Fusion混合信號(hào)FPGA器件開始供貨

  •   致力實(shí)現(xiàn)智能化的安全互連世界的半導(dǎo)體技術(shù)領(lǐng)先供應(yīng)商─美高森美公司(Microsemi Corporation)宣布提供100% 通過 -55°C至 +100°C溫度范圍測(cè)試的Fusion混合信號(hào)FPGA器件。這一項(xiàng)性能提升使美高森美能夠?qū)usion器件獨(dú)特的混合信號(hào)綜合優(yōu)勢(shì)帶至必須在極端溫度下保持高可靠性運(yùn)作的軍事、航空和防御行業(yè)。設(shè)計(jì)人員能夠利用Fusion器件固有的可重編程、高可靠性和非易失性等特性,以及固件錯(cuò)誤免疫能力的附加優(yōu)勢(shì)。
  • 關(guān)鍵字: Fusion  FPGA  

基于IP核的PSTN短消息終端SoC軟硬件協(xié)同設(shè)計(jì)

  • 摘要 介紹在基于微控制器IP核的PSTN短消息終端SoC設(shè)計(jì)當(dāng)中,如何合理劃分硬件和軟件的功能;從對(duì)微控制器IP核的配置與擴(kuò)展、片上外設(shè)在SFR總線上的映射、存儲(chǔ)空間的劃分與映射等三個(gè)方面,詳細(xì)講述SoC的軟硬件協(xié)同設(shè)
  • 關(guān)鍵字: LCD  接口  鍵盤掃描  數(shù)據(jù)存儲(chǔ)器  FPGA  接收  

基于FPGA的高速同步HDLC通信控制器設(shè)計(jì)

  • 摘要:高級(jí)數(shù)據(jù)鏈路控制HDLC協(xié)議是一種面向比特的鏈路層協(xié)議,具有同步傳輸數(shù)據(jù)、冗余度低等特點(diǎn),是在通信領(lǐng)域中應(yīng)用最廣泛的鏈路層協(xié)議之一。提出實(shí)現(xiàn)HDLC通信協(xié)議的主要模塊——CRC校驗(yàn)?zāi)K及l(fā)squo;0
  • 關(guān)鍵字: FPGA  HDLC  通信  制器設(shè)計(jì)    

一種基于DDS的電路板檢測(cè)儀信號(hào)源設(shè)計(jì)

  • 0引言某型導(dǎo)彈測(cè)試設(shè)備電路板檢測(cè)儀主要完成該測(cè)試設(shè)備的電路板的故障檢測(cè)。該檢測(cè)系統(tǒng)要求激勵(lì)...
  • 關(guān)鍵字: DDS  信號(hào)源  電路板檢測(cè)儀  FPGA  

基于DSP+ARM架構(gòu)的協(xié)議轉(zhuǎn)換器設(shè)計(jì)

  • 基于DSP+ARM架構(gòu)的協(xié)議轉(zhuǎn)換器設(shè)計(jì), 摘要:介紹基于DSP+ARM架構(gòu)協(xié)議轉(zhuǎn)換器的系統(tǒng)組成及其工作原理,給出了DSP通過EMIF接口與FPGA無縫連接的接口實(shí)現(xiàn),DSP通過HPI接口與ARM高速接口的實(shí)現(xiàn),以及基于ARM的高速以太網(wǎng)接口。簡(jiǎn)要介紹了基于嵌入式操作系
  • 關(guān)鍵字: DSP  ARM  FPGA  I/O  通信  數(shù)據(jù)  

基于nRF24L01和Actel FPGA的智能探測(cè)系統(tǒng)設(shè)計(jì)

  • 摘要:設(shè)計(jì)了基于nRF24L01無線數(shù)據(jù)傳輸芯片和Fusion StartKit開發(fā)板的智能探測(cè)系統(tǒng)。通過開啟nRF24L01的ACK PAYLOAD功能實(shí)現(xiàn)車載系統(tǒng)與上位機(jī)之間的雙向通信,采用Actel公司帶有APB3總線的8051S軟核在Fusion Star
  • 關(guān)鍵字: 單片機(jī)  FPGA  
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