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基于單片機(jī)和FPGA的頻率特,tt測(cè)試儀

  • 介紹基于89S51單片機(jī)和FPGA的頻率特性測(cè)試儀的設(shè)計(jì)。該系統(tǒng)設(shè)計(jì)利用DDS原理由FPGA經(jīng)D/A轉(zhuǎn)換產(chǎn)生掃頻信號(hào),再經(jīng)待測(cè)網(wǎng)絡(luò)實(shí)現(xiàn)峰值檢測(cè)和相位檢測(cè),從而完成了待測(cè)網(wǎng)絡(luò)幅頻和相頻特性曲線的測(cè)量和顯示。經(jīng)過(guò)調(diào)試,示波器顯示待測(cè)網(wǎng)絡(luò)頻率范圍100 Hz~100 kHz的幅頻和相頻特性曲線,該系統(tǒng)工作穩(wěn)定,操作方便。
  • 關(guān)鍵字: tt  測(cè)試儀  頻率  FPGA  單片機(jī)  基于  轉(zhuǎn)換器  

用FPGA實(shí)現(xiàn)靈活的汽車電子設(shè)計(jì)

  • 引言   微控制器在汽車和消費(fèi)類市場(chǎng)上得到了廣泛應(yīng)用,能夠以相對(duì)較低的成本實(shí)現(xiàn)系統(tǒng)高度集成。然而,這類產(chǎn)品也有潛在的成本問(wèn)題。例如,如果元件功能不符合要求,就必須采用外部邏輯、軟件或者其他集成器件
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幾家公司聯(lián)合在亞洲啟動(dòng)協(xié)處理研討會(huì)

  •         安富利公司 (NYSE: AVT) 旗下安富利電子元件部、The MathWorks、德州儀器(TI) 和賽靈思(Xilinx)宣布將舉辦為期2天的協(xié)處理SpeedWay設(shè)計(jì)研討會(huì)(Co-Processing SpeedWay Design Workshop™)。研討會(huì)將以最新推出的Spartan-3A DSP FPGA / DaVinci開(kāi)發(fā)平臺(tái)為基礎(chǔ),講解如何“用基于模型化的設(shè)計(jì)方法,進(jìn)行FP
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CPLD 實(shí)現(xiàn) GPIB 控制器的設(shè)計(jì)

  • 摘要:GPIB 控制器芯片是組建自動(dòng)測(cè)試系統(tǒng)的核心,在測(cè)試領(lǐng)域應(yīng)用廣泛。本文擬討論用
    ALTERA 公司的低成本 CPLD 來(lái)實(shí)現(xiàn) GPIB 控制器的功能。GPIB 控制器芯片的硬件設(shè)計(jì)主 要分為狀態(tài)機(jī)的實(shí)現(xiàn)、數(shù)據(jù)通道和微處
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基于FPGA 的簡(jiǎn)化UART 電路設(shè)計(jì)

  • 摘要: 本文闡述了通用異步發(fā)生器UART 的功能特點(diǎn),介紹了用硬件描述語(yǔ)言Verilog 來(lái)開(kāi)發(fā)各個(gè)模塊,并給出仿真結(jié)果。本設(shè)計(jì)使用Altera 的FPGA 芯片,將UART 的核心功能嵌入到FPGA 內(nèi)部,能夠?qū)崿F(xiàn)異步通信的功能,可以
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基于FPGA的線陣CCD驅(qū)動(dòng)時(shí)序及 模擬信號(hào)處理的設(shè)計(jì)

  • 為保證線陣CCD在圖像測(cè)量中正常、穩(wěn)定工作,必須設(shè)計(jì)出適合其工作的時(shí)序驅(qū)動(dòng)電路。在分析TCDl501D線陣CCD驅(qū)動(dòng)時(shí)序關(guān)系的基礎(chǔ)上,通過(guò)分析CCD輸出的圖像信號(hào),給出了內(nèi)、外相關(guān)雙采樣的時(shí)序控制。最后,利用quanus7.2軟件平臺(tái)結(jié)合VHDL語(yǔ)言進(jìn)行開(kāi)發(fā),對(duì)所需驅(qū)動(dòng)脈沖進(jìn)行仿真設(shè)計(jì)。仿真結(jié)果表明,該驅(qū)動(dòng)電路簡(jiǎn)單、功耗小、成本低、抗干擾能力強(qiáng),適用于設(shè)備小型化的要求。
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基于FPGA的全數(shù)字鎖相環(huán)的設(shè)計(jì)

  • 簡(jiǎn)單介紹了全數(shù)字鎖相環(huán)(ADPLL)的結(jié)構(gòu)和工作原理,提出一種在FPGA的基礎(chǔ)上可增大全數(shù)字鎖相環(huán)同步范圍的設(shè)計(jì)方法,并給出了部分verilog HDL設(shè)計(jì)程序的代碼和仿真波形。
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基于FPGA的RS編碼器的設(shè)計(jì)與實(shí)現(xiàn)

  • RS碼是線性分組碼中一種典型的糾錯(cuò)碼,既能糾正隨機(jī)錯(cuò)誤,也能糾正突發(fā)錯(cuò)誤,在現(xiàn)代通信領(lǐng)域越來(lái)越受到重視。文中介紹基于FPGA使用Verilog―HDL語(yǔ)言的RS(15,9)編碼器的設(shè)計(jì)方法,并在QuartusII 5.O軟件環(huán)境下進(jìn)行了功能仿真,仿真結(jié)果與理論分析相一致,該設(shè)計(jì)方法對(duì)實(shí)現(xiàn)任意長(zhǎng)度的RS編碼有重要參考價(jià)值。
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基于FPGA的圖像采集系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

  • 1、引言 視頻圖像采集是視頻信號(hào)處理系統(tǒng)的前端部分,正在向高速、高分辨率、高集成化、高可靠性方向發(fā)展。圖像采集系統(tǒng)在當(dāng)今工業(yè)、軍事、醫(yī)學(xué)各個(gè)領(lǐng)域都有著極其廣泛的應(yīng)用,如使用在遠(yuǎn)程監(jiān)控、安防、遠(yuǎn)程抄
  • 關(guān)鍵字: 設(shè)計(jì)  實(shí)現(xiàn)  系統(tǒng)  采集  FPGA  圖像  基于  

用內(nèi)部邏輯分析儀調(diào)試FPGA

  • 推動(dòng)FPGA調(diào)試技術(shù)改變的原因  進(jìn)行硬件設(shè)計(jì)的功能調(diào)試時(shí),F(xiàn)PGA的再編程能力是關(guān)鍵的優(yōu)點(diǎn)。CPLD和FPGA早期使用時(shí),如果發(fā)現(xiàn)設(shè)計(jì)不能正常工作,工程師就使用“調(diào)試鉤”的方法。先將要觀察的FPGA內(nèi)部信號(hào)引到引腳,然
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擴(kuò)散爐溫度自動(dòng)控制系統(tǒng)中的FPGA設(shè)計(jì)

  • 擴(kuò)散爐溫度自動(dòng)監(jiān)控系統(tǒng)是對(duì)雙管擴(kuò)散爐溫控部分進(jìn)行改造,以提高爐溫精度,從而提高生產(chǎn)線的成品率,降低系統(tǒng)能耗。通過(guò)對(duì)Actel公司的Fusion系列器件FPGA編程實(shí)現(xiàn)系統(tǒng)的硬件控制。用C語(yǔ)言對(duì)Actel FPGA內(nèi)置的8051軟核編程實(shí)現(xiàn)系統(tǒng)的軟件控制。整個(gè)監(jiān)控系統(tǒng)完成數(shù)據(jù)采集、控制算法和ZigBee無(wú)線傳輸?shù)裙δ?。測(cè)試表明,采用Fusion FPGA設(shè)計(jì).可以同時(shí)完成多路溫度控制,整個(gè)系統(tǒng)的控制精度也有進(jìn)一步的提高。
  • 關(guān)鍵字: FPGA  設(shè)計(jì)  控制系統(tǒng)  自動(dòng)  溫度  擴(kuò)散  轉(zhuǎn)換器  

計(jì)算機(jī)EPP控制CPLD顯示點(diǎn)陣漢字的實(shí)現(xiàn)

  • 1 引言隨著人們生活節(jié)奏的加快,越來(lái)越多的場(chǎng)合需要使用電子手段動(dòng)態(tài)發(fā)布信息,其中應(yīng)用非常廣泛的一種方法就是LED點(diǎn)陣顯示。傳統(tǒng)的點(diǎn)陣漢字顯示通常采用單片機(jī)作為控制核心,結(jié)合存儲(chǔ)器、邏輯電路和LED點(diǎn)陣來(lái)
  • 關(guān)鍵字: 點(diǎn)陣  漢字  實(shí)現(xiàn)  顯示  CPLD  EPP  控制  計(jì)算機(jī)  EDA  EPP  CPLD  VHDL  漢字點(diǎn)陣  

基于單片機(jī)、EDA技術(shù)的波形發(fā)生器的設(shè)計(jì)

FPGA的可重構(gòu)測(cè)控系統(tǒng)應(yīng)用設(shè)計(jì)的研究

  • 1可重構(gòu)測(cè)控系統(tǒng)的提出測(cè)控系統(tǒng)一般是指基于計(jì)算機(jī)實(shí)現(xiàn)數(shù)據(jù)采集和控制的系統(tǒng)。測(cè)控系統(tǒng)在工業(yè)現(xiàn)場(chǎng)控制、家...
  • 關(guān)鍵字: FPGA  測(cè)控系統(tǒng)  應(yīng)用設(shè)計(jì)  

千兆位無(wú)源光網(wǎng)絡(luò)(07-100)

  •   在2005年,F(xiàn)SAN(全業(yè)務(wù)接入網(wǎng))組商定了千兆位無(wú)源光網(wǎng)絡(luò)(GPON)規(guī)范(見(jiàn)圖1)。此規(guī)范建立了語(yǔ)音、數(shù)據(jù)和視頻具有成本效益的遞交過(guò)程,這包括遞交到終端用戶的服務(wù)質(zhì)量?!甪irst mile’接入技術(shù)采用光纖連接(光纖到用戶系統(tǒng)連接)可增加寬帶內(nèi)容選擇。GPON很可能超過(guò)以太網(wǎng)無(wú)源光網(wǎng)絡(luò)成為未來(lái)光網(wǎng)絡(luò)的選擇。
  • 關(guān)鍵字: FSAN  GPON  FPGA  
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