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CPLD 在線纜快速測(cè)試技術(shù)中的應(yīng)用(05-100)

  • 線纜測(cè)試是電氣柜線纜安裝過(guò)程中十分重要的環(huán)節(jié)。本文根據(jù)國(guó)內(nèi)外線纜測(cè)試技術(shù)的發(fā)展及生產(chǎn)企業(yè)的實(shí)際要求，將CPLD 引入線纜測(cè)試系統(tǒng)，實(shí)現(xiàn)了對(duì)多條線纜的連通性能（通斷、短路、錯(cuò)接）同時(shí)、準(zhǔn)確地測(cè)試，并詳細(xì)介紹了基于CPLD 的接口電路的設(shè)計(jì)。
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基于TCA785和FPGA的觸發(fā)器設(shè)計(jì)

  • 摘 要： 以晶閘管構(gòu)成的全橋整流電路為對(duì)象，分析和建立了兩種觸發(fā)器以實(shí)現(xiàn)對(duì)晶閘管的觸發(fā)控制。一種是以TCA785為核心芯片的模擬觸發(fā)器，另一種是以可編程邏輯陣列（FPGA）為核心芯片的數(shù)字觸發(fā)器。試驗(yàn)表明兩種觸
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基于FPGA器件的Sobel算法實(shí)現(xiàn)

  • 0引言邊緣檢測(cè)技術(shù)是圖像處理的一項(xiàng)基本技術(shù)，在工業(yè)、航天、醫(yī)學(xué)、軍事等領(lǐng)域中有著廣泛的應(yīng)用。邊緣檢測(cè)算法的實(shí)現(xiàn)涉及復(fù)雜的計(jì)算步驟，故對(duì)處理速度有較高要求。采用FPGA器件實(shí)現(xiàn)系統(tǒng)設(shè)計(jì)是一種純硬件的解決方案，
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嵌入式SATA存儲(chǔ)系統(tǒng)的研究

  • 嵌入式SATA存儲(chǔ)系統(tǒng)的研究,SATA硬盤作為新型的存儲(chǔ)介質(zhì)，具有高速、海量、價(jià)格低廉、使用方便等優(yōu)點(diǎn)。SATA2.5協(xié)議支持3.0Gb/s的接口速度，SATA2.5硬盤的持續(xù)存儲(chǔ)速度可達(dá)80MB/s，最大存儲(chǔ)容量已經(jīng)達(dá)到750GB(如希捷ST3750640AS硬盤)。SATA硬盤已
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基于cyclone EP1C6的LED大屏設(shè)計(jì)方案

  • 目前采用的LED大屏幕顯示系統(tǒng)的控制電路，大多由單個(gè)或多個(gè)CPU及復(fù)雜的外圍電路組成，這種電路設(shè)計(jì)，單片機(jī)編程比較復(fù)雜，整個(gè)電路的調(diào)試比較麻煩，可靠性和實(shí)時(shí)性很難得到保證。針對(duì)這種情況，介紹一種基于cyclone
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Altium 推出 Altera Cyclone III FPGA 新型子板

  • 　　日前，Altium 宣布推出另一款面向桌面 NanoBoard 可重構(gòu)硬件開發(fā)平臺(tái)的全新子板，進(jìn)一步幫助電子設(shè)計(jì)人員輕松利用可編程硬件的優(yōu)勢(shì)。 　　這款最新插入式子板采用 780 BGA 封裝，內(nèi)置 Altera 的低成本 Cyclone® III EP3C40 FPGA。該子板包含可充分滿足應(yīng)用需求的各種板載存儲(chǔ)器以及用來(lái)存儲(chǔ)電路板識(shí)別數(shù)據(jù)與相關(guān)信息的 1-Wire 存儲(chǔ)器器件。 　　電子產(chǎn)品設(shè)計(jì)人員可充分利用桌面 NanoBoard 的高靈活性以及可對(duì) FPGA 進(jìn)行再編程的特性，快速
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Altera發(fā)售業(yè)界密度最高的收發(fā)器FPGA

  • 　　Altera公司(NASDAQ: ALTR)今天宣布，開始提供業(yè)界密度最高的收發(fā)器FPGA芯片。作為Altera® Stratix® IV GX FPGA系列中發(fā)售的第二個(gè)型號(hào)器件，EP4SGX530比市場(chǎng)上最大的收發(fā)器FPGA大60％。該器件提供530K邏輯單元(LE)，48個(gè)工作速率高達(dá)8.5 Gbps的收發(fā)器，20.3 Mbits RAM以及1,040個(gè)嵌入式乘法器。Stratix IV GX器件面向通信、廣播、測(cè)試、醫(yī)療和軍事市場(chǎng)等多種應(yīng)用領(lǐng)域。 　　Agilent邏輯和協(xié)議
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基于FPGA的無(wú)線通信收發(fā)模塊設(shè)計(jì)方案

基于FPGA的HDB3編解碼器設(shè)計(jì)

  • 基于FPGA的HDB3編解碼器設(shè)計(jì),本方案設(shè)計(jì)模塊可以作為IP(Intellectual Property)核，與嵌入式處理器及其他功能模塊或IP芯核相結(jié)合在一片F(xiàn)PGA上構(gòu)成片上可編程系統(tǒng)SOPC，使得所設(shè)計(jì)的系統(tǒng)在其規(guī)模、可靠性、體積、功耗、性能等方面實(shí)現(xiàn)最優(yōu)化。
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基于FPGA的高速數(shù)據(jù)中繼器設(shè)計(jì)的研究

  • 1 前言 高速以太網(wǎng)可以滿足新的容量需求，解決了低帶寬接入、高帶寬傳輸?shù)钠款i問(wèn)題，擴(kuò)大了應(yīng)用范圍，并與以前的所有以太網(wǎng)兼容。全雙工的以太網(wǎng)協(xié)議并無(wú)傳輸距離的限制，只是在實(shí)際應(yīng)用中，物理層技術(shù)限制了最
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脈沖信號(hào)源的CPLD實(shí)現(xiàn)方法

  • 為滿足生產(chǎn)和科研的需要，研制了―種用Altera公司MAX7000系列CPLD芯片，實(shí)現(xiàn)的程控脈沖信號(hào)源。實(shí)踐證明，應(yīng)用此種方案設(shè)計(jì)的信號(hào)源，頻率高、頻率穩(wěn)定、步進(jìn)小(通過(guò)選用高速CPLD可提高頻率及縮小步進(jìn))、精度高、參數(shù)調(diào)節(jié)方便，同時(shí)操作簡(jiǎn)單方便，功能更易擴(kuò)展。文中給出了該信號(hào)源的詳細(xì)系統(tǒng)設(shè)計(jì)方法及程序源代碼。
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賽靈思25周年論行業(yè)短長(zhǎng)新款FPGA重拳出擊

  •         近日，賽靈思公司在北京舉辦隆重的25周年慶典，并宣布推出全新一代旗艦產(chǎn)品系列——高性能Virtex? -6和低成本Spartan? -6 FPGA，同時(shí)提出了“目標(biāo)設(shè)計(jì)平臺(tái)”的新理念。         出席慶典和新聞發(fā)布會(huì)的有賽靈思公司產(chǎn)品營(yíng)銷高級(jí)總監(jiān)Chuck Tralka，亞太區(qū)執(zhí)行總裁/質(zhì)量管理和
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基于FPGA的A/D轉(zhuǎn)換采樣控制模塊的設(shè)計(jì)

  • 摘要：本文采用FPGA器件EP1C6T144C8芯片代替單片機(jī)控制A/D轉(zhuǎn)換芯片ADC0809進(jìn)行采樣控制，整個(gè)設(shè)計(jì)用VHDL語(yǔ)言描述，在QuartusⅡ平臺(tái)下進(jìn)行軟件編程實(shí)現(xiàn)正確的A/D轉(zhuǎn)換的工作時(shí)序控制過(guò)程，并將采樣數(shù)據(jù)從二進(jìn)制轉(zhuǎn)化成B
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一種寬帶復(fù)接器的設(shè)計(jì)與實(shí)現(xiàn)

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