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EEPW首頁 >> 主題列表 >> cpld-jtag接口

Verilog HDL語言在FPGA/CPLD開發(fā)中的應(yīng)用

  • 1 引言近30年來，由于微電子學(xué)和計(jì)算機(jī)科學(xué)的迅速發(fā)展，給EDA(電子設(shè)計(jì)自動(dòng)化)行業(yè)帶來了巨大的變化。特別是進(jìn)入20世紀(jì)90年代后，電子系統(tǒng)已經(jīng)從電路板級系統(tǒng)集成發(fā)展成為包括ASIC、FPGA和嵌入系統(tǒng)的多種模式?？梢哉f
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基于CPLD的MAX1032采樣控制的實(shí)現(xiàn)

  • 基于CPLD的MAX1032采樣控制的實(shí)現(xiàn),0 引言本文主要介紹MAX1032采樣芯片以及使用CPLD對MAX1032采樣進(jìn)行控制的方法。事實(shí)上，雖然微控制器也能對MAX1032進(jìn)行方便的控制，但使用CPLD來控制系統(tǒng)外圍設(shè)備，可以節(jié)省微控制器的資源，減輕其負(fù)擔(dān)，同時(shí)可以讓其
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XC9500系列CPLD遙控編程的實(shí)現(xiàn)

  • 摘 要： 簡單介紹了XC9500系列CPLD器件及其系統(tǒng)內(nèi)編程(ISP)性能，接著講述了XC9500系列CPLD器件遙控編程的實(shí)現(xiàn)方法，并重點(diǎn)介紹了在遙控編程系統(tǒng)中應(yīng)用微控制器(lntel 8031)實(shí)現(xiàn)嵌入式ISP的軟硬件設(shè)計(jì)。關(guān)鍵詞： CPL
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FPGA與CPLD的比較

  • 盡管FPGA和CPLD都是可編程器件,有很多共同特點(diǎn),但由于CPLD和FPGA結(jié)構(gòu)上的差異，具有各自的特點(diǎn)：1、CPLD更適合完成各種算法和組合邏輯,FPGA更適合于完成時(shí)序邏輯。換句話說,FPGA更適合于觸發(fā)器豐富的結(jié)構(gòu),而CPLD更適
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基于CPLD與單片機(jī)的雙向通信控制器設(shè)計(jì)

  • 在傳統(tǒng)的控制系統(tǒng)中，人們常常采用單片機(jī)作為控制核心。但這種方法硬件連線復(fù)雜，可靠性差，且單片機(jī)的端口數(shù)目、內(nèi)部定時(shí)器和中斷源的個(gè)數(shù)都有限，在實(shí)際應(yīng)用中往往需要外加擴(kuò)展芯片。這無疑對系統(tǒng)的設(shè)計(jì)帶來諸多不
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基于CPLD的MAX1032采樣控制的方法與實(shí)現(xiàn)

  • 基于CPLD的MAX1032采樣控制的方法與實(shí)現(xiàn), 引言
    本文主要介紹MAX1032采樣芯片以及使用CPLD對MAX1032采樣進(jìn)行控制的方法。事實(shí)上，雖然微控制器也能對MAX1032進(jìn)行方便的控制，但使用CPLD來控制系統(tǒng)外圍設(shè)備，可以節(jié)省微控制器的資源，減輕其負(fù)擔(dān)，同時(shí)可
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采用CPLD的片內(nèi)環(huán)形振蕩器的方案設(shè)計(jì)

  • 采用CPLD的片內(nèi)環(huán)形振蕩器的方案設(shè)計(jì),本文介紹一種通用的基于CPLD的片內(nèi)振蕩器設(shè)計(jì)方法，它基于環(huán)形振蕩器原理，只占用片上普通邏輯資源(LE)，無需使用專用邏輯資源(如MaxII中的UFM)，從而提高了芯片的資源利用率；振蕩頻率可在一定范圍內(nèi)調(diào)整，振蕩輸出
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FPGA/CPLD設(shè)計(jì)思想與技巧簡介

  • FPGA/CPLD設(shè)計(jì)思想與技巧簡介,本文討論的四種常用FPGA/CPLD設(shè)計(jì)思想與技巧：乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化，都是FPGA/CPLD邏輯設(shè)計(jì)的內(nèi)在規(guī)律的體現(xiàn)，合理地采用這些設(shè)計(jì)思想能在FPGA/CPLD設(shè)計(jì)工作中取得事半功倍的效果?！　
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一種基于CPLD的16位VFC式AD轉(zhuǎn)換器設(shè)計(jì)

  • 隨著科技的飛速發(fā)展、高分辨率的數(shù)?；旌想娐返膽?yīng)用不斷深入，電路設(shè)計(jì)日趨復(fù)雜，精度越來越高，所以高精度AD轉(zhuǎn)換電路的設(shè)計(jì)就成了儀器儀表及各種測量控制系統(tǒng)的難點(diǎn)。本系統(tǒng)來源于儀器儀表的溫控系統(tǒng)設(shè)計(jì)，采用高精
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基于CPLD的發(fā)射機(jī)控制保護(hù)系統(tǒng)介紹

  • 摘要：可編程控制器（PLD）自20世紀(jì)60年代末出現(xiàn)以來，就以其靈活、高效、可靠性高等優(yōu)點(diǎn)受到設(shè)計(jì)者的青睞。而CPLD是20世紀(jì)90年代推出的一種復(fù)雜的PLD，其主要特征是集成規(guī)模大于1000門以上的可編程邏輯器件。它以其
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用CPLD器件及VDHL語言實(shí)現(xiàn)電梯控制系統(tǒng)

  • 1 引言隨著社會的發(fā)展。使用電梯越來越普遍，已從原來只在商業(yè)大廈、賓館過渡到在辦公室、居民樓等多種建筑中，并且對電梯功能的要求也不斷提高，其相應(yīng)控制方式也在不斷發(fā)生變化。電梯的微機(jī)化控制主要有：PLC控制、
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基于CPLD的數(shù)字濾波及抗干擾實(shí)現(xiàn)

  • 基于CPLD的數(shù)字濾波及抗干擾實(shí)現(xiàn),1 濾波和抗干擾概述

    單片機(jī)應(yīng)用系統(tǒng)的輸入信號常含有種種噪聲和干擾，它們來自被測信號源、傳感器、外界干擾源等。為了提高測量和控制精度，必須消除信號中的噪聲和干擾。噪聲有兩大類：一類為周期性的；另一類為
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基于CPLD和MAX7000系列的數(shù)據(jù)采集系統(tǒng)簡介

  • 基于CPLD和MAX7000系列的數(shù)據(jù)采集系統(tǒng)簡介,CPLD是復(fù)雜的PLD，專指那些集成規(guī)模大于1000門以上的可編程邏輯器件。它由與陣列、或陣列、輸入緩沖電路、輸出宏單元組成，具有門電路集成度高、可配置為多種輸入輸出形式、多時(shí)鐘驅(qū)動(dòng)、內(nèi)含ROM或FLASH(部分支持在系
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基于CPLD的多DSP及FPGA遠(yuǎn)程加載的設(shè)計(jì)原理分析

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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CPLD在無功補(bǔ)償控制儀鍵盤設(shè)計(jì)中的應(yīng)用

  • 摘 要：本控制儀以單片機(jī)80c196kc為核心，集無功補(bǔ)償、電度量計(jì)量、電能質(zhì)量監(jiān)測及通信于一體，能實(shí)時(shí)顯示電網(wǎng)的各項(xiàng)參數(shù)，通過鍵盤可人工設(shè)定系統(tǒng)運(yùn)行的參數(shù)。單片機(jī)外圍芯片PSD8XX及復(fù)雜可編程邏輯器件（CPLD）的使
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