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EEPW首頁 >> 主題列表 >> cpld-pci接口

基于CPLD和ARM的異步LED顯示屏控制系統(tǒng)設(shè)計

  • 基于LED技術(shù)的大屏幕顯示屏已經(jīng)廣泛用于廣場、機場、體育場館和車站等公共場所，在大屏幕上顯示文字、動畫、...
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DM642和CPLD外部中斷的寄存器式鍵盤設(shè)計

  • 摘要：介紹了一種采用DM642和CPLD相配合的擴展鍵盤方法。CPLD管理鍵盤電路中的芯片邏輯，DM642的外部中斷監(jiān)控按鍵的狀態(tài)。簡單闡述了鍵盤的分類，給出系統(tǒng)的硬件電路原理圖，在CCS軟件中調(diào)試程序方法。仿真結(jié)果表明，
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基于CoolRunner CPLD的MP3應(yīng)用開發(fā)板的設(shè)計

  • 便攜式MP3播放器作為一種集音頻播放、數(shù)據(jù)存儲為一身的數(shù)碼產(chǎn)品，其功能結(jié)構(gòu)為電子設(shè)計人員所津津樂道。新功...
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基于ARM和CPLD的嵌入式視覺系統(tǒng)設(shè)計

  • 目前，關(guān)于視覺系統(tǒng)的研究已經(jīng)成為熱點，也有開發(fā)出的系統(tǒng)可供參考。但這些系統(tǒng)大多是基于PC機的，由于算法和硬件結(jié)構(gòu)的復(fù)雜性而使其在小型嵌入式系統(tǒng)中的應(yīng)用受到了限制。上述系統(tǒng)將圖像數(shù)據(jù)采集后，視覺處理算法是
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一款基于CPLD的LED顯示屏控制電路解決方案

基于CoolRunner CPLD的MP3應(yīng)用開發(fā)板的設(shè)計與實現(xiàn)

  • 本文介紹了基于CoolRunner CPLD的MP3應(yīng)用開發(fā)板的設(shè)計流程，驗證了利用現(xiàn)有IP Core設(shè)計的可行性和高效性。在設(shè)計過程中，硬件（實驗評估板）的設(shè)計和基于IP Core的算法設(shè)計可同步進行，避免了兩者因異步帶來的設(shè)計周期的延長。實踐證明本文的設(shè)計思路和實現(xiàn)方法是一種靈活、快速、可靠地開發(fā)數(shù)字系統(tǒng)平臺的設(shè)計方案。
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基于CPLD與絕對式編碼器的高精度高速伺服單元

  • 　本設(shè)計已經(jīng)完成了硬件及軟件的全部設(shè)計，讀取帶有絕對式編碼器的電動機轉(zhuǎn)子的任何一個位置數(shù)據(jù)只需31μs，通信速率可達2.5Mb/s，將本設(shè)計集成在伺服驅(qū)動單元中，驅(qū)動和控制電動機轉(zhuǎn)數(shù)可達6000轉(zhuǎn)/分，控制電動機轉(zhuǎn)子的位置精度可達μM級。
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基于DSP+CPLD的異步電動機控制系統(tǒng)開發(fā)平臺設(shè)計

  • 隨著電力電子技術(shù)、電機控制理論和微控制器的不斷發(fā)展，現(xiàn)代交流調(diào)速技術(shù)在國民經(jīng)濟中得到了廣泛應(yīng)用。目前，高...
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基于Verilog簡易UART的FPGA/CPLD實現(xiàn)

  • 基于Verilog簡易UART的FPGA/CPLD實現(xiàn),目標(biāo)：在xo640上實現(xiàn)一個簡單的Uart，能夠解析串口數(shù)據(jù)，并在寄存器中存儲，用FIFO實現(xiàn)數(shù)據(jù)的傳遞。那么后期可以通過開發(fā)板上的串口經(jīng)CPLD訪問各種數(shù)據(jù)。比如PC=CPLD=EEPROM等等，極大方便后期的開發(fā)和調(diào)試。
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基于CPLD／FPGA的多串口設(shè)計與實現(xiàn)

  • 摘要：在工業(yè)控制中如何提高一對多的串口通訊可靠性和系統(tǒng)的集成性成為研究熱點。本文利用嵌入式技術(shù)，提出基于CPLD／FPGA的多串口擴展設(shè)計方案。實現(xiàn)并行口到多個全雙工異步通訊口之間的轉(zhuǎn)換，并根據(jù)嵌入式系統(tǒng)實時
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基于CPLD和嵌入式系統(tǒng)的LED點陣顯示

  • 基于CPLD和嵌入式系統(tǒng)的LED點陣顯示,采用自頂向下的設(shè)計思想，綜合運用EDA 技術(shù)、CPLD技術(shù)和共享式雙口RAM，解決了大屏幕LED點陣顯示屏無閃爍顯示的技術(shù)難題。給出了系統(tǒng)設(shè)計方法及實際電路。
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采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計方法

  • 采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計方法,采用圖像傳感器的CPLD視覺系統(tǒng)設(shè)計方法搭建一種低成本的嵌入式視覺系統(tǒng)，系統(tǒng)由CMOS圖像傳感器、CPLD、ARM7微處理器以及SRAM構(gòu)成。其中，CPLD識別時序，解決了圖像采集系統(tǒng)存在的嚴格時序同步和雙CPU共享一片SRAM的總
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基于Matlab/Simulink的滑模軟起動器仿真研究

基于CPLD的USB總線的隔離接口實現(xiàn)

  • 本設(shè)計的主要創(chuàng)新點在于 USB總線的協(xié)議的復(fù)雜性和快速性為設(shè)計實現(xiàn)必須面對許多的挑戰(zhàn)，能在分析協(xié)議的基礎(chǔ)上利用 CPLD解決了 USB總線隔離的問題，巧妙的檢測信息包起始、快切換和包結(jié)束的難題，克服了傳輸信息包結(jié)束慢上拉與過渡，保證系統(tǒng)的完整性。
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CPLD在線纜快速測試技術(shù)中的應(yīng)用

  • 1.引言隨著電子技術(shù)的發(fā)展，復(fù)雜可編程邏輯器件CPLD（ComplexProgrammableLogicDevice）以其高速、高...
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