design 文章 進(jìn)入design技術(shù)社區(qū)
使用 PlanAhead Design 工具提高設(shè)計(jì)性能
- PlanAhead 軟件提供了一種解決方案越來越多的客戶在賽靈思reg; PlanAheadtrade; 設(shè)計(jì)分析工具提供的層次化設(shè)計(jì)方法學(xué)中找到解決方案。PlanAhead 軟件為 FPGA 設(shè)計(jì)流程增加了可視性和控制。通過解決物理方面(介于邏
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BlackBerry Porsche Design P’9981 智能手機(jī)即將登陸市場(chǎng)
- ??????? 捷成集團(tuán)旗下代理品牌Porsche Design最近發(fā)布了BlackBerry?? Porsche Design P’9981 智能手機(jī)。這款手機(jī)由Porsche Design 和RIM 共同打造,是Porsche Design 奢侈品牌推出的第一款智能手機(jī)。這款手機(jī)即將登陸中國(guó)市場(chǎng),售價(jià)預(yù)計(jì)在20000元人民幣左右。由于是限量版產(chǎn)品,目前已有不少顧客聞風(fēng)搶訂。 ??&
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SOC設(shè)計(jì)方法
- SOC設(shè)計(jì)方法,本文通過對(duì)集成電路IC技術(shù)發(fā)展現(xiàn)狀的討論和歷史回顧,特別是通過對(duì)電子整機(jī)設(shè)計(jì)技術(shù)發(fā)展趨勢(shì)的探討,引入系統(tǒng)芯片(System on Chip,簡(jiǎn)稱SOC)的定義,主要特點(diǎn)及其設(shè)計(jì)方法學(xué)等基本概念,并著重探討面向SOC的新一代集成電
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SOC 軟硬件協(xié)同設(shè)計(jì) 超深亞微米 高層次綜合 IP核 設(shè)計(jì)再利用
引言
人類進(jìn)入21世界面臨的一個(gè)重要課題就是如何面對(duì)國(guó)民經(jīng)濟(jì)和社會(huì)發(fā)展信息化的挑戰(zhàn)。以網(wǎng)絡(luò)通信、軟件和微電子為主要標(biāo)志的信息產(chǎn)業(yè)的飛速發(fā)展既為我們提供了一個(gè)前所未有的發(fā)展機(jī)遇
也營(yíng)造了一個(gè)難得的市場(chǎng)與產(chǎn)業(yè)環(huán)境。集成電路作為電子工業(yè)乃至整個(gè)信息產(chǎn)業(yè)的基礎(chǔ)得益于這一難得的機(jī)遇
呈現(xiàn)出快速發(fā)展的態(tài)勢(shì)。以軟硬件協(xié)同設(shè)計(jì)(Software/Hardware Co-Design)、具有知識(shí)產(chǎn)權(quán)的內(nèi)核
Berkeley Design:IC設(shè)計(jì)需要高效軟件
- 與前面兩家公司不同,Berkeley Design是一家只有四年多歷史的公司,公司以提升模擬/射頻和混合信號(hào)IC的設(shè)計(jì)面市時(shí)間為主要奮斗目標(biāo),提供精確電路分析技術(shù)服務(wù),內(nèi)容涉及模擬和RF電路仿真、應(yīng)用數(shù)學(xué)、先進(jìn)數(shù)字分析技術(shù)和設(shè)備建模等。公司主要的優(yōu)勢(shì)是可以縮短消費(fèi)電子領(lǐng)域客戶的設(shè)計(jì)面市的時(shí)間。 數(shù)字技術(shù)在電子產(chǎn)品中得到了廣闊的應(yīng)用,數(shù)字技術(shù)的發(fā)展帶來的結(jié)果不是模擬技術(shù)的減少而是增加。數(shù)字采用的不過是新的技術(shù),而模擬采用的則是全部的技術(shù),現(xiàn)在模擬技術(shù)采用的技術(shù)已經(jīng)幾乎與數(shù)字完全相同。消費(fèi)電子的發(fā)展
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Synopsys公司Design Compiler拓樸繪圖技術(shù)助ST加速ASIC設(shè)計(jì)
- Synopsys宣布意法半導(dǎo)體在其90nm和65nm 的ASIC設(shè)計(jì)流程中,應(yīng)用Design Compiler拓樸繪圖技術(shù),縮短了整個(gè)設(shè)計(jì)時(shí)間。意法半導(dǎo)體在其ASIC方法集中應(yīng)用Design Compiler拓樸繪圖技術(shù),從而消除了設(shè)計(jì)的反復(fù)(Iteration),實(shí)現(xiàn)了內(nèi)部設(shè)計(jì)團(tuán)隊(duì)和外部客戶整個(gè)設(shè)計(jì)環(huán)節(jié)工作的順暢。 在ASIC模式下,設(shè)計(jì)能否按計(jì)劃完成,在很多程度上取決于設(shè)計(jì)收斂完成前,網(wǎng)表在客戶與ASIC供應(yīng)商間反復(fù)時(shí)間的縮短。Design Compil
- 關(guān)鍵字: ASIC設(shè)計(jì) Compiler拓樸繪圖技術(shù) Design ST Synopsys 單片機(jī) 嵌入式系統(tǒng) EDA IC設(shè)計(jì)
Forte推出升級(jí)版Cynthesizer行為綜合方案
- Forte Design升級(jí)了Cynthesizer行為綜合方案,可提供更廣泛的生產(chǎn)ESL設(shè)計(jì)流程。Cynthesizer v2.5支持功率估計(jì)、形式驗(yàn)證、模塊化接口IP、FPGA樣品及完整的設(shè)計(jì)報(bào)告子系統(tǒng)。這些新功率可使設(shè)計(jì)人員訪問關(guān)鍵的設(shè)計(jì)信息,簡(jiǎn)化高層設(shè)計(jì)的采用,進(jìn)一步提高設(shè)計(jì)質(zhì)量。 在該公司與Sequence Design的合作下,Cynthesizer客戶可用Sequence的PowerTheater自動(dòng)測(cè)量RTL及門電荷下的功耗。通過測(cè)量系統(tǒng)至網(wǎng)表
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EMA Design用于PSpice仿真器功率IC模型庫
- EMA Design Automation公司推出了適用于PSpice仿真器的功率IC模型庫,該模型庫由超過150個(gè)流行的功率IC和元件的時(shí)域仿真模型組成。每個(gè)模型均能模擬元件在實(shí)際工作條件下的開關(guān)性能,這對(duì)當(dāng)前開關(guān)模式電源至關(guān)重要。同時(shí)這些模型也可精確模擬傳播延遲、開關(guān)速度、驅(qū)動(dòng)容量、最大占空率和限流特性等非線性特性。 當(dāng)前,對(duì)器件功能、開關(guān)頻率和系統(tǒng)相互作用等設(shè)計(jì)要求日益增加,狀態(tài)空間模型不能揭示影響這些性能特性的重要非線性因素。而功率IC模型庫中的元件則能使用戶重復(fù)執(zhí)行高速仿真以揭示各種性能
- 關(guān)鍵字: EMA Design Automation
design介紹
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