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ADI推出SHARC DSP產(chǎn)品組合
- Analog Devices, Inc.,全球領(lǐng)先的高性能信號處理解決方案供應(yīng)商,最新推出32位浮點(diǎn)數(shù)字信號處理器SHARC產(chǎn)品組合的最新成員——SHARC 2148x及SHARC 2147x系列。 高性能SHARC 2148x及低功耗SHARC 2147x系列處理器憑借集成高達(dá)5Mb 的存儲(chǔ)器,為各種應(yīng)用提高了單芯片、浮點(diǎn)信號處理精度,并為便攜式設(shè)備實(shí)現(xiàn)了高端系統(tǒng)功能。 通過SHARC 2148x及SHARC 2147x處理器,設(shè)計(jì)師可以利用端到端 SHARC 系列的代碼兼容
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CEVA發(fā)布針對6Gbps固態(tài)硬盤應(yīng)用的SATA3.0 IP
- 全球領(lǐng)先的硅產(chǎn)品知識產(chǎn)權(quán) (SIP) 平臺(tái)解決方案和數(shù)字信號處理器(DSP)內(nèi)核授權(quán)廠商CEVA公司宣布提供CEVA-SATA3.0設(shè)備控制器IP。基于與固態(tài)硬盤 (SSD) 客戶廣泛的合作經(jīng)驗(yàn),CEVA公司已經(jīng)提升其SATA設(shè)備控制器IP性能,提供 6Gbps 線路速率 (line rate) 以實(shí)現(xiàn)更快的數(shù)據(jù)傳輸,使得吞吐量較上代產(chǎn)品提高一倍。該IP已經(jīng)授權(quán)予一家領(lǐng)先的閃存半導(dǎo)體制造商,用于其未來的固態(tài)硬盤設(shè)計(jì)中。 CEVA-SATA3.0 IP 采用最新的原生指令排序 (Native Co
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DSP實(shí)現(xiàn)3G LTE應(yīng)用技術(shù)簡介
- DSP實(shí)現(xiàn)3G LTE應(yīng)用技術(shù)簡介,3G LTE是第三代伙伴計(jì)劃(3GPP)的一個(gè)高級標(biāo)準(zhǔn),為廣域網(wǎng)提供下一代寬帶無線技術(shù)。 與以前各階段的3GPP相比,3G LTE的目標(biāo)是更高的吞吐量、更低的時(shí)延以及高效的IP回程,提供一種新的可以大規(guī)模部署的移動(dòng)網(wǎng)絡(luò)技術(shù),預(yù)
- 關(guān)鍵字: 應(yīng)用技術(shù) 簡介 LTE 3G 實(shí)現(xiàn) DSP
基于ADSP-BF561的車輛輔助駕駛系統(tǒng)硬件設(shè)計(jì)
- 引言20世紀(jì)八十年代以來.電子技術(shù)和計(jì)算機(jī)技術(shù)快速發(fā)展,汽車行駛安全方面的研究也進(jìn)入了一個(gè)嶄新的領(lǐng)...
- 關(guān)鍵字: Blackfin DSP 硬件設(shè)計(jì) 輔助駕駛系統(tǒng) 車輛狀態(tài) 處理器
DSP內(nèi)嵌PLL中的CMOS壓控環(huán)形振蕩器設(shè)計(jì)
- DSP內(nèi)嵌PLL中的CMOS壓控環(huán)形振蕩器設(shè)計(jì),本文設(shè)計(jì)了一種應(yīng)用于DSP內(nèi)嵌鎖相環(huán)的低功耗、高線性CM0S壓控環(huán)形振蕩器。電路采用四級延遲單元能方便的獲得正交輸出時(shí)鐘,每級采用RS觸發(fā)結(jié)構(gòu)來產(chǎn)生差分輸出信號,在有效降低靜態(tài)功耗的同時(shí).具有較好的抗噪聲能力。在延遲單元的設(shè)計(jì)時(shí)。綜合考慮了電壓控制的頻率范圍以及調(diào)節(jié)線性度,選擇了合適的翻轉(zhuǎn)點(diǎn)。 仿真結(jié)果表明.電路叮實(shí)現(xiàn)2MHz至90MHz的頻率調(diào)節(jié)范圍,在中心頻率附近具有很高的調(diào)節(jié)線性度,可完全滿足DSP芯片時(shí)鐘系統(tǒng)的要求。
- 關(guān)鍵字: 振蕩器 設(shè)計(jì) 環(huán)形 CMOS 內(nèi)嵌 PLL DSP
TMS320C6713B DSP的外部FLASH引導(dǎo)
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字: TMS320C6713B DSP Flash
基于DSP的PDF417快速解碼終端的設(shè)計(jì)與實(shí)現(xiàn)
- 基于DSP的PDF417快速解碼終端的設(shè)計(jì)與實(shí)現(xiàn),設(shè)計(jì)并實(shí)現(xiàn)了一種基于DSP平臺(tái)的PDF417條碼快速解碼終端。該終端能對攝像頭采集的含有PDF417條碼的圖像進(jìn)行復(fù)雜背景下條碼區(qū)域提取、條碼畸變校正等條碼圖像預(yù)處理,實(shí)現(xiàn)了復(fù)雜背景和不均勻光照條件下條碼的全方位快速讀取。
- 關(guān)鍵字: 終端 設(shè)計(jì) 實(shí)現(xiàn) 解碼 快速 DSP PDF417 基于
基于DSP的CAN總線系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)
- 基于DSP的CAN總線系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn),摘要:介紹了基于DSP的CAN控制器的設(shè)計(jì)及應(yīng)用方法,利用該方法可以在波特率高達(dá)lMb/s的條件下穩(wěn)定、可靠地傳輸數(shù)據(jù),而且延遲時(shí)間很少。實(shí)驗(yàn)證明,利用TMS320F2812內(nèi)嵌的CAN模塊來構(gòu)成的硬件電路和軟件設(shè)計(jì)十分簡單
- 關(guān)鍵字: 設(shè)計(jì) 實(shí)現(xiàn) 系統(tǒng) 總線 DSP CAN 基于
基于DSP和Modbus總線的智能斷路器控制器設(shè)計(jì)
- 結(jié)合智能斷路器組網(wǎng)應(yīng)用的需求,闡述了Modbus總線智能斷路器的軟硬件設(shè)計(jì)和實(shí)現(xiàn)。智能控制器采用Modbus通信協(xié)議實(shí)現(xiàn)網(wǎng)絡(luò)互聯(lián),與上位監(jiān)控計(jì)算機(jī)實(shí)現(xiàn)網(wǎng)絡(luò)控制。實(shí)驗(yàn)表明,系統(tǒng)可靠性高、實(shí)時(shí)性好,具有廣闊的應(yīng)用前景。
- 關(guān)鍵字: 斷路器 控制器 設(shè)計(jì) 智能 總線 DSP Modbus 基于 通信協(xié)議
基于FPGA+DSP的雷達(dá)回波發(fā)生器設(shè)計(jì)
- 雷達(dá)回波發(fā)生器利用現(xiàn)代仿真技術(shù)生成蘊(yùn)含雷達(dá)目標(biāo)和環(huán)境信息的模擬雷達(dá)信號,用來對雷達(dá)系統(tǒng)進(jìn)行性能測試和評估。根據(jù)通用性、靈活性要求,提出了一種基于DSP+FPGA的雷達(dá)回波發(fā)生器的設(shè)計(jì)方法;簡要介紹了設(shè)計(jì)思想,詳細(xì)闡述了系統(tǒng)的硬件組成和軟件設(shè)計(jì),并給出了測試結(jié)果并總結(jié)了該雷達(dá)回波發(fā)生器的一些優(yōu)點(diǎn)。
- 關(guān)鍵字: FPGA DSP 雷達(dá)回波 發(fā)生器
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