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基于DSP的多頻帶混合信號(hào)測(cè)試系統(tǒng)的設(shè)計(jì)
- 隨著數(shù)字化浪潮的深入,具有混合信號(hào)功能的芯片越來越多地出現(xiàn)在人們的生活中。通訊領(lǐng)域的MODEM(如ADSL),CODEC和飛速發(fā)展的手機(jī)芯片,視頻處理器領(lǐng)域的MPEG,DVD 芯片,都是具有混合信號(hào)功能的芯片,其特點(diǎn)是處理速度高、覆蓋的頻率范圍寬,芯片的升級(jí)換代周期日益縮短。這就要求測(cè)試系統(tǒng)具有更高的性能和更寬的頻帶范圍,而且需要靈活的架構(gòu)來應(yīng)對(duì)不斷升級(jí)的芯片測(cè)試需求,以便有效降低新器件的測(cè)試成本。此外,混合信號(hào)芯片種類繁多,各種具有混合信號(hào)的芯片已經(jīng)廣泛運(yùn)用到生產(chǎn)和生活的各個(gè)領(lǐng)域,而不同的應(yīng)用領(lǐng)域,其工
- 關(guān)鍵字: 測(cè)試系統(tǒng) 設(shè)計(jì) 信號(hào) 混合 DSP 頻帶 基于 數(shù)字信號(hào)
基于FPGA設(shè)計(jì)DSP的實(shí)踐與改進(jìn)
- 當(dāng)設(shè)計(jì)的系統(tǒng)需要對(duì)數(shù)字信號(hào)進(jìn)行處理時(shí),常采用通用 DSP(Digital Signal Process)處理器,這樣的設(shè)計(jì)方案通用性好,且還有各種較為成熟的 DSP算法可以參考。但是,這類方案通常是雙核設(shè)計(jì),即采用通用控制器(MCU)加上通用 DSP處理器實(shí)現(xiàn),在實(shí)現(xiàn)系統(tǒng)時(shí)開發(fā)的復(fù)雜程度、難度都較大,也難以滿足定制特殊處理的需要。為了解決這些問題,人們開始尋求新的設(shè)計(jì)方案,基于通用處理器加上FPGA(大規(guī)??删庨T陣列)的架構(gòu)方案逐漸成為主流,在新的方案中通用控制器完成控制和管理功能,專用的數(shù)字信號(hào)處理和組
- 關(guān)鍵字: FPGA DSP 實(shí)踐
海思將在網(wǎng)絡(luò)設(shè)備芯片中使用Tensilica的DPU和DSP內(nèi)核
- Tensilica日前宣布,授權(quán)海思半導(dǎo)體Xtensa系列可配置數(shù)據(jù)處理器(DPU)及ConnX™ DSP(數(shù)據(jù)信號(hào)處理)IP核。海思將在網(wǎng)絡(luò)設(shè)備芯片的設(shè)計(jì)中使用Tensilica的DPU和DSP內(nèi)核。 海思半導(dǎo)體副總裁Teresa He表示:“在選擇Tensilica之前我們對(duì)可授權(quán)的DSP IP核進(jìn)行了全面的考察和評(píng)估。Tensilica 公司的Xtensa系列DPU在提供世界一流DSP性能的同時(shí)又擁有卓越的靈活性和可配置性,給予海思半導(dǎo)體產(chǎn)品很強(qiáng)的差異化能力,帶給我
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基于SBC+DSP 的嵌入式系統(tǒng)設(shè)計(jì)與應(yīng)用
- 基于SBC+DSP 的嵌入式系統(tǒng)設(shè)計(jì)與應(yīng)用,根據(jù)嵌入式系統(tǒng)知識(shí),利用其優(yōu)點(diǎn),針對(duì)星圖識(shí)別的特征,設(shè)計(jì)一種以SBC+DSP為硬件平臺(tái)的嵌入式系統(tǒng),通過試驗(yàn)驗(yàn)證,系統(tǒng)能夠滿足星圖識(shí)別大數(shù)據(jù)量、實(shí)時(shí)響應(yīng)速度和高可靠性的要求。
- 關(guān)鍵字: 設(shè)計(jì) 應(yīng)用 系統(tǒng) 嵌入式 SBC DSP 基于 數(shù)字信號(hào)
基于FPGA實(shí)現(xiàn)DSP與RapidIO網(wǎng)絡(luò)互聯(lián)
- 本文首先簡(jiǎn)單的介紹了總線的發(fā)展,從而引出一種新型的串行點(diǎn)對(duì)點(diǎn)交換結(jié)構(gòu)RapidIO。DSP 在高性能處理系統(tǒng)中的重要性毋庸置疑,但是目前的很多DSP 并沒有RapidIO接口。本文提出了利用FPGA,將DSP 的總線橋接到一個(gè)RapidIO IP 上,從而實(shí)現(xiàn)了DSP與RapidIO 網(wǎng)絡(luò)的互聯(lián)。
- 關(guān)鍵字: RapidIO 網(wǎng)絡(luò)互聯(lián) DSP 實(shí)現(xiàn) FPGA 基于 RapidIO
TI推出多核片上系統(tǒng)架構(gòu) 實(shí)現(xiàn)5倍性能提升
- 日前,德州儀器 (TI) 宣布推出一款基于 TI 多核數(shù)字信號(hào)處理器 (DSP) 的新型片上系統(tǒng) (SoC) 架構(gòu),該架構(gòu)在業(yè)界性能最高的 CPU 中同時(shí)集成了定點(diǎn)和浮點(diǎn)功能。TI 全新的多內(nèi)核 SoC 運(yùn)行頻率高達(dá) 1.2GHz,引擎性能高達(dá) 256 GMACS 和 128 GFLOPS,與市場(chǎng)中現(xiàn)有的解決方案相比,能夠?qū)崿F(xiàn) 5 倍的性能提升,從而可為廠商加速無線基站、媒體網(wǎng)關(guān)以及視頻基礎(chǔ)架構(gòu)設(shè)備等基礎(chǔ)局端產(chǎn)品的開發(fā)提供通用平臺(tái)。 知名的技術(shù)分析公司 BDTI 在其《InsideDSP》通訊中
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CEVA DSP處理器獲Mindspeed選用于無線基帶處理器
- CEVA公司與業(yè)界領(lǐng)先的網(wǎng)絡(luò)基礎(chǔ)設(shè)施應(yīng)用半導(dǎo)體解決方案供應(yīng)商Mindspeed Technologies宣布,CEVA用于無線基站應(yīng)用的經(jīng)驗(yàn)證的高性能CEVA-X1641 DSP已獲Mindspeed選用于全新的Transcede 4000無線基帶處理器。Transcede 4000是能夠?qū)崿F(xiàn)全新級(jí)別之高性能、低功耗、軟件可編程設(shè)備,應(yīng)對(duì)下一代移動(dòng)網(wǎng)絡(luò)的計(jì)算挑戰(zhàn)。 Mindspeed的Transcede 4000器件在功能強(qiáng)大的多核架構(gòu)中集成了10個(gè)CEVA-X1641 DSP,能夠提供下一代移
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Tensilica日前發(fā)布第二代基帶引擎ConnX BBE16
- Tensilica日前發(fā)布第二代基帶引擎ConnX BBE16,用于LTE(長期演進(jìn)技術(shù))及4G基帶SoC(片上系統(tǒng))的設(shè)計(jì)。ConnX BBE16的16路MAC(乘數(shù)累加器)架構(gòu)經(jīng)過特別優(yōu)化,以滿足無線DSP(數(shù)字信號(hào)處理)算法需求,包括:OFDM(正交頻分復(fù)用)、FFT(快速傅氏變換)、FIR(有限脈沖響應(yīng))、IIR(無限脈沖響應(yīng))以及矩陣運(yùn)算。ConnX BBE16針對(duì)芯片面積以及低功耗應(yīng)用進(jìn)一步優(yōu)化,相比原先的ConnX BBE在某些關(guān)鍵算法上提供高達(dá)三倍的性能。該架構(gòu)適用于可編程無線手持設(shè)備
- 關(guān)鍵字: Tensilica 基帶 DSP
Tensilica推出HiFi EP音頻DSP
- Tensilica宣布即將推出基于HiFi 架構(gòu)的新一代產(chǎn)品HiFi EP音頻DSP,可同時(shí)支持家庭娛樂產(chǎn)品中的多聲道編解碼以及持續(xù)擴(kuò)展的音頻前/后處理等應(yīng)用,如:藍(lán)光播放器、數(shù)字電視(DTV)以及智能手機(jī)。HiFi EP增強(qiáng)了高效率、高質(zhì)量的語音前、后處理功能,與同類產(chǎn)品相比,HiFiEP最多可以減少40%的功耗及50%的芯片面積。Tensilica將于2010年2月15-18日西班牙巴塞羅那舉行的全球移動(dòng)大會(huì)展出其HiFi EP音頻DSP(數(shù)字信號(hào)處理)引擎,展位號(hào):7C35。 HiFi 2
- 關(guān)鍵字: Tensilica DSP HiFi
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