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適用于 FPGA、GPU 和 ASIC 系統(tǒng)的電源管理

在 FPGA、GPU 或 ASIC 控制的系統(tǒng)板上，僅有為數(shù)不多的幾種電源管理相關(guān)的設(shè)計(jì)挑戰(zhàn)，但是由于需要反復(fù)調(diào)試，所以這類(lèi)挑戰(zhàn)可能使系統(tǒng)的推出時(shí)間嚴(yán)重滯后
關(guān)鍵字： FPGA GPU ASIC 電源管理

FPGA開(kāi)發(fā)之IP核：軟核、硬核以及固核概念

IP(Intelligent Property)核是具有知識(shí)產(chǎn)權(quán)核的集成電路芯核總稱(chēng)，是經(jīng)過(guò)反復(fù)驗(yàn)證過(guò)的、具有特定功能的宏模塊，與芯片制造工藝無(wú)關(guān)，可以移植到不同的
關(guān)鍵字： FPGA IP核固核概念

如何基于蜜罐技術(shù)的FPGA實(shí)現(xiàn)技術(shù)？

1. 項(xiàng)目背景蜜罐技術(shù)由來(lái)已久，蜜罐(Honeypot)是一種在互聯(lián)網(wǎng)上運(yùn)行的計(jì)算機(jī)系統(tǒng)。它是專(zhuān)門(mén)為吸引并誘騙那些試圖非法闖入他人計(jì)算機(jī)系統(tǒng)的人(如電腦黑
關(guān)鍵字：蜜罐技術(shù) FPGA 實(shí)現(xiàn)技術(shù)

如何基于FPGA的短波通信接收機(jī)？

短波通信又稱(chēng)高頻通信，是利用HF波段(3-30MHz)電磁波進(jìn)行的無(wú)線(xiàn)電通信。短波通信主要靠天波傳播，可經(jīng)電離層一次或數(shù)次反射，最遠(yuǎn)可傳至上萬(wàn)里，如按氣
關(guān)鍵字： FPGA 短波通信接收機(jī)

十年FPGA開(kāi)發(fā)經(jīng)驗(yàn)工程師教你的絕密設(shè)計(jì)技巧

從大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間，至今記得當(dāng)初第一次在EDA實(shí)驗(yàn)平臺(tái)上完成數(shù)字秒表、搶答器、密碼鎖等實(shí)驗(yàn)時(shí)那個(gè)興奮勁。當(dāng)時(shí)由于沒(méi)有接
關(guān)鍵字： CPLD 電子工程師 FPGA

如何為基于FPGA的嵌入式系統(tǒng)進(jìn)行安全升級(jí)？

如何防止器件ldquo;磚頭化rdquo;，只發(fā)出警告就夠了嗎?ldquo;系統(tǒng)正在更新，請(qǐng)勿關(guān)閉電源。rdquo;我們都看到過(guò)這個(gè)警告，它通常在電子器件要在閃存
關(guān)鍵字：嵌入式 FPGA

引起的較高時(shí)鐘頻率仿真失敗原因

通常如果你的設(shè)計(jì)在較低時(shí)鐘頻率時(shí)通過(guò)了仿真，但是在較高時(shí)鐘頻率時(shí)卻失敗了，你的第一個(gè)問(wèn)題應(yīng)該是你的設(shè)計(jì)在某個(gè)較高時(shí)鐘頻率時(shí)是否達(dá)到了時(shí)序約束
關(guān)鍵字： FPGA 時(shí)鐘頻率賽靈思

如何設(shè)計(jì)基于FPGA的虛擬現(xiàn)實(shí)定位系統(tǒng)？

虛擬現(xiàn)實(shí)技術(shù)是目前計(jì)算機(jī)信息科學(xué)中的前沿學(xué)科，文中設(shè)計(jì)了一種以FPGA 為核心的數(shù)據(jù)采集處理系統(tǒng).利用HMC5883L和ADXL345對(duì)虛擬場(chǎng)景中物體的方位和朝
關(guān)鍵字： FPGA 虛擬現(xiàn)實(shí) 定位系統(tǒng)

經(jīng)驗(yàn)總結(jié)：電路設(shè)計(jì)的8個(gè)誤區(qū)

關(guān)于電路設(shè)計(jì)8個(gè)誤區(qū)的經(jīng)驗(yàn)總結(jié)
關(guān)鍵字： PCB FPGA CPU

怎么采用FPGA原型系統(tǒng)加速物聯(lián)網(wǎng)設(shè)計(jì)？

當(dāng)我們談?wù)撐锫?lián)網(wǎng) (IoT) 的時(shí)候，不夸張地說(shuō)，它可以將我們所使用的智能設(shè)備互相連接，彼此分享大量的數(shù)據(jù)，從而使我們的生活更高效。這不僅僅是消費(fèi)者
關(guān)鍵字： FPGA 物聯(lián)網(wǎng)

用C 語(yǔ)言描述AES256 加密算法

作者：Adam Taylor 首席工程師 e2v 公司 aptaylor@theiet.org 用C 語(yǔ)言描述AES256 加密算法，然后在硬件中加速性能。高級(jí)加密標(biāo)準(zhǔn) (AES) 已經(jīng)成為很多
關(guān)鍵字： FPGA ASIC

使用SDNet開(kāi)發(fā)創(chuàng)新型可編程網(wǎng)絡(luò)

日本電報(bào)電話(huà)公司 (NTT) 是一家全球電信集團(tuán)控股公司，負(fù)責(zé)制定管理策略和推動(dòng)研發(fā)工作發(fā)展。我們是 NTT 研發(fā)部的研究人員，正領(lǐng)導(dǎo)兩個(gè)針對(duì)軟件定義網(wǎng)
關(guān)鍵字： FPGA ASIC

AI芯片之戰(zhàn)：TPU/GPU/FPGA誰(shuí)稱(chēng)雄？

　　智能時(shí)代就要到來(lái)，芯片市場(chǎng)格局一變?cè)僮?。兩個(gè)典型例子：引領(lǐng)處理器市場(chǎng) 40 多年的英特爾 2015 年底收購(gòu)?fù)?Altera，今年 4 月就宣布計(jì)劃裁員 1.2 萬(wàn);另一方面，GPU 巨頭英偉達(dá)今年 3 月推出加速人工智能和深度學(xué)習(xí)的芯片 Tesla P100，投入研發(fā)經(jīng)費(fèi)超過(guò) 20 億美元，據(jù)《華爾街日?qǐng)?bào)》報(bào)道，今年 5 月英偉達(dá)售出的 GPU 比去年同月增長(zhǎng) 62%，公司當(dāng)前市值 240 億美元。　　深度學(xué)習(xí)應(yīng)用大量涌現(xiàn)使超級(jí)計(jì)算機(jī)的架構(gòu)逐漸向深度學(xué)習(xí)應(yīng)用優(yōu)化，從傳統(tǒng) CPU 為主 GPU 為輔的
關(guān)鍵字： AI TPU GPU FPGA

從設(shè)置、加載、啟動(dòng)看Xilinx FPGA配置流程

　　盡管FPGA的配置模式各不相同，但整個(gè)配置過(guò)程中FPGA的工作流程是一致的，分為三個(gè)部分：設(shè)置、加載、啟動(dòng)?！　?fù)位結(jié)束配置開(kāi)始　　有多種方式使FPGA的配置進(jìn)入這一過(guò)程。在上電時(shí)，電壓達(dá)到FPGA要求之前，F(xiàn)PGA的上電復(fù)位模塊將使FPGA保持在復(fù)位狀態(tài);外部控制PROG_B引腳出現(xiàn)一個(gè)低脈沖也可以使FPGA保持在復(fù)位狀態(tài)?！　∏宄渲么鎯?chǔ)內(nèi)容　　這一步稱(chēng)為初始化，當(dāng)FPGA復(fù)位結(jié)束，配置存儲(chǔ)器的內(nèi)容會(huì)被自動(dòng)清除。在這個(gè)步驟中，除配置專(zhuān)用接口外，F(xiàn)PGA I/O均被置于高阻態(tài)。在整個(gè)初始化過(guò)程中，I
關(guān)鍵字： Xilinx FPGA

FPGA開(kāi)發(fā)基本流程有哪些？

FPGA是可編程芯片，因此FPGA的設(shè)計(jì)方法包括硬件設(shè)計(jì)和軟件設(shè)計(jì)兩部分。硬件包括FPGA芯片電路、存儲(chǔ)器、輸入輸出接口電路以及其他設(shè)備，軟件即是相應(yīng)
關(guān)鍵字：微電子 SOC FPGA

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fpga 介紹

FPGA是英文Field－Programmable Gate Array的縮寫(xiě)，即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。 FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個(gè)新概念，內(nèi)部包括可 [ 查看詳細(xì) ]