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EEPW首頁 >> 主題列表 >> fpga：quartusⅡ

如何用PMIC快速、輕松且劃算的為FPGA供電

  • 　　如果你是一名研究現(xiàn)場可編程門陣列(FPGA)的工程師，你就應(yīng)該知道這些器件的高效運行需要優(yōu)化的電源序列。使用離散組件來滿足這些特定的電源需求通常需要一個額外的離散排序器或微控制器。然而，對于小外形尺寸應(yīng)用來說，找到合適的部件常常會增加成本、時間，甚至外形尺寸，而這樣就不能滿足客戶的技術(shù)規(guī)格了。 　　如果你不想這么麻煩，不妨考慮一下電源管理集成電路(PMIC)。它主要有三方面的優(yōu)勢： 　　這是一款滿足你整個系統(tǒng)電源需要的單芯片解決方案。 　　他提供對所有電壓軌的電源監(jiān)控，使你能夠確認(rèn)電源軌在系統(tǒng)技
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基于OTDR原理的光網(wǎng)絡(luò)智能測試技術(shù)方案

  • 　　隨著光通信行業(yè)的大力發(fā)展，光纜大規(guī)模部署，光網(wǎng)絡(luò)如何全面地測試成了運營商面臨的主要問題。傳統(tǒng)的測試方式有兩種：光損測試和OTDR測試法。光損測試采用光源和光功率計相結(jié)合來測試光鏈路的損耗，其優(yōu)點是設(shè)備價格低廉，使用簡單，但是需要兩名技術(shù)人員才能完成，并且無法準(zhǔn)確定位光鏈路的故障點及其原因。OTDR測試可以測量光纖長度、傳輸衰減、接頭衰減和故障定位，具有測試時間短、速度快和精度高等優(yōu)點，但是使用OTDR測試，測試人員對測試結(jié)果有不同的解讀，很大程度上取決于使用者的經(jīng)驗和能力，只有專家級的測試人員才能準(zhǔn)確
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多路SDI信號單波長無損光傳輸

  • 　　摘要：針對目前市場上越來越多針對SDI信號的應(yīng)用需求，提出了多路SDI電信號單波長光纖傳輸?shù)膶崿F(xiàn)方案，就方案中出現(xiàn)的由于FIFO“寫滿”或“讀空”引起的SDI信號傳輸誤碼，提出了一種基于FPGA內(nèi)部PLL的可控時鐘，利用該時鐘作為FIFO的讀時鐘，實現(xiàn)SDI信號無損傳輸。 　　引言 　　串行數(shù)字接口(Serial Digital Interface，簡寫為SDI)是針對演播室環(huán)境提出的用單根電纜來傳輸數(shù)字視音頻信號的方式。在SMTPE-259M標(biāo)準(zhǔn)中
  • 關(guān)鍵字： SDI  FPGA  光纖  FIFO  PLL  數(shù)據(jù)還原  201503  

降低工業(yè)應(yīng)用的總體擁有成本

  • 　　摘要：大約三分之一的嵌入式設(shè)計人員考慮在嵌入式應(yīng)用中采用FPGA，他們認(rèn)為在設(shè)計中使用FPGA過于昂貴。但是，從系統(tǒng)級了解總體擁有成本(TCO) (由產(chǎn)品生命周期中的開發(fā)、改進(jìn)、替換和維護(hù)成本來衡量)，您會發(fā)現(xiàn)FPGA是分立微控制器(MCU)/數(shù)字信號處理器(DSP)/ASSP產(chǎn)品靈活的競爭方案。 　　引言 　　工業(yè)自動化和過程控制生產(chǎn)商一直面臨持續(xù)的全球競爭和經(jīng)濟(jì)壓力，商業(yè)模式和利潤不斷受到威脅，不得不應(yīng)對成本挑戰(zhàn)，包括： 　　● 利潤和研發(fā)投入; 　　● 產(chǎn)品及時面市壓力以適應(yīng)經(jīng)濟(jì)狀況的變
  • 關(guān)鍵字： 嵌入式  FPGA  工業(yè)以太網(wǎng)  DSP  TCO  MCU  201503  

工業(yè)4.0為元器件廠商帶來新機(jī)遇

  • 　　摘要：當(dāng)前全球制造業(yè)發(fā)展越來越呈現(xiàn)數(shù)字化、網(wǎng)絡(luò)化和智能化的新特征，美國提出“工業(yè)互聯(lián)網(wǎng)”戰(zhàn)略、德國提出“工業(yè)4.0”戰(zhàn)略，主要意圖就是搶占智能制造這一未來產(chǎn)業(yè)競爭制高點。工業(yè)4.0革命將建立一個高度靈活的數(shù)字化、個性化產(chǎn)品與服務(wù)的生產(chǎn)模式，并將重組產(chǎn)業(yè)鏈分工。 　　第四次工業(yè)革命是綠色工業(yè)革命，一系列生產(chǎn)函數(shù)發(fā)生從自然要素投入為特征，到以綠色要素投入為特征的躍遷，并普及至整個社會。其核心特征應(yīng)該是高效節(jié)能，網(wǎng)絡(luò)化與模塊化。 　　工業(yè)4.0將會通過自動
  • 關(guān)鍵字： 工業(yè)4.0  物聯(lián)網(wǎng)  FPGA  處理器  201503  

基于FPGA的跨時鐘域信號處理——亞穩(wěn)態(tài)

  • 　　在特權(quán)的上篇博文《基于FPGA的跨時鐘域信號處理——專用握手信號》中提出了使用專門的握手信號達(dá)到異步時鐘域數(shù)據(jù)的可靠傳輸。列舉了一個簡單的由請求信號req、數(shù)據(jù)信號data、應(yīng)答信號ack組成的簡單握手機(jī)制。riple兄更是提出了req和ack這兩個直接的跨時鐘域信號在被另一個時鐘域的寄存器同步時的亞穩(wěn)態(tài)問題。這個問題估計是整個異步通信中最值得探討和關(guān)注的。 　　很幸運，特權(quán)同學(xué)找到了很官方的說法——《Application Note42:Metast
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【從零開始走進(jìn)FPGA】教你什么才是真正的任意分頻

  • 　　一、為啥要說任意分頻 　　也許FPGA中的第一個實驗應(yīng)該是分頻實驗，而不是流水燈，或者LCD1602的"Hello World"顯示，因為分頻的思想在FPGA中極為重要。當(dāng)初安排流水燈，只是為了能讓大家看到效果，來激發(fā)您的興趣(MCU的學(xué)習(xí)也是如此)。 　　在大部分的教科書中，都會提到如何分頻，包括奇數(shù)分頻，偶數(shù)分頻，小數(shù)分頻等。有些教科書中也會講到任意分頻(半分頻，任意分?jǐn)?shù)分頻)原理，用的是相位與的電路，并不能辦到50%的占空比，也不是很靈活。 　　但沒有一本教科書會講到精
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零基礎(chǔ)學(xué)FPGA（十四）第一片IC——精簡指令集RISC_CPU設(shè)計精講

  • 　　不得不說，SDRAM的設(shè)計是我接觸FPGA以來調(diào)試最困難的一次設(shè)計，早在一個多月以前，我就開始著手想做一個SDRAM方面的教程，受特權(quán)同學(xué)影響，開始學(xué)習(xí)《高手進(jìn)階，終極內(nèi)存技術(shù)指南》這篇論文，大家都知道這篇文章是學(xué)習(xí)內(nèi)存入門的必讀文章，小墨同學(xué)花了一些時間在這上面，說實話看懂這篇文章是沒什么問題的，文件講的比較直白，通俗易懂，很容易入手。當(dāng)了解了SDRAM工作方式之后，我便開始寫代碼，從特權(quán)同學(xué)的那篇經(jīng)典教程里面，我認(rèn)真研讀代碼的來龍去脈，終于搞懂了特權(quán)同學(xué)的設(shè)計思想，并花了一些時間將代碼自己敲一遍，
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美高森美使用物理不可克隆功能技術(shù)增強SmartFusion2 SoC FPGA和IGLOO2 FPGA器件

  • 　　致力于在電源、安全、可靠和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation)宣布為其旗艦SmartFusion®2 SoC FPGA和IGLOO®2 FPGA 器件的領(lǐng)先網(wǎng)絡(luò)安全功能組合加入Intrinsic-ID, B.V授權(quán)許可的物理不可克隆功能(Physically Unclonable Function, PUF) 。Intrinsic-ID是基于其專利硬件固有安全技術(shù)(Hardware Intrinsic Security
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OFDM信道調(diào)制解調(diào)的仿真及其FPGA設(shè)計

  • 　　OFDM(正交頻分復(fù)用)是一種高效的多載波調(diào)制技術(shù)，其最大的特點是傳輸速率高，具有很強的抗碼間干擾和信道選擇性衰落能力。OFDM最初用于高速MODEM、數(shù)字移動通信和無線調(diào)頻信道上的寬帶數(shù)據(jù)傳輸，隨著IEEE802.11a協(xié)議、BRAN(Broadband Radio Access Network)和多媒體的發(fā)展，數(shù)字音頻廣播(DAB)、地面數(shù)字視頻廣播((DVB-T)和高清晰度電視((HDTV)都應(yīng)用了OFDM技術(shù)。 　　OFDM利用離散傅立葉反變換/離散傅立葉變換(IDFT/DFT)代替多載波調(diào)
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OFDM系統(tǒng)中DAGC的應(yīng)用研究及FPGA實現(xiàn)

  • 　　O 引 言 　　隨著各種FFT算法的出現(xiàn)，DFT在現(xiàn)代信號處理中起著越來越重要的作用。在B3G和4G移動通信中所采用的0FDM技術(shù)，更是以IDFT/DFT來進(jìn)行OFDM調(diào)制和解調(diào)制，IDFT/DFT的精度直接影響基帶解調(diào)的性能。 　　在硬件實現(xiàn)中，通常影響定點化FFT算法精度的有量化誤差、舍入誤差和溢出誤差。一旦決定了量化方式和數(shù)據(jù)位寬后，量化誤差和舍入誤差都是可估計的，而溢出誤差則隨著輸入信號功率的增大而急劇增加，造成SNR嚴(yán)重惡化。 　　中射頻接收時，通常使用AAGc和DAGC來改善ADC正
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高速移動下OFDM均衡器的FPGA實現(xiàn)

  • 　　O 引言 　　正交頻分復(fù)用(OFDM)是一種正交多載波調(diào)制技術(shù)，它將寬帶頻率選擇性衰落信道轉(zhuǎn)換成一系列窄帶平坦衰落信道，在克服信道多徑衰落所引起的碼間干擾，實現(xiàn)高數(shù)據(jù)傳輸?shù)确矫婢哂歇毺氐膬?yōu)勢。但是由于OFDM信號頻譜重疊，對信道變化很敏感，在高速移動下，信道的時變特性更加明顯，此時OFDM系統(tǒng)載波間的正交性會遭到破壞，出現(xiàn)載波間干擾(ICI)，這會導(dǎo)致系統(tǒng)性能明顯降低。為了消除ICI，必須采用適當(dāng)?shù)木饧夹g(shù)以補償ICI。國內(nèi)外許多學(xué)者對這些問題進(jìn)行了大量的研究，提出了各種不同的方法，得到了一些階段性
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中頻軟件無線電系統(tǒng)的FPGA實現(xiàn)方案

  • 　　一、 引言 　　現(xiàn)代通信技術(shù)、微電子技術(shù)和計算機(jī)技術(shù)的飛速發(fā)展，促進(jìn)了無線通信技術(shù)從數(shù)字化走向軟件化。軟件無線電的出現(xiàn)掀起了無線通信技術(shù)的又一次革命，它已經(jīng)成為目前通信領(lǐng)域中最為重要的研究方向之一。所謂軟件無線電，是指構(gòu)造一個通用的、可重復(fù)編程的硬件平臺，使其工作頻段、調(diào)制解調(diào)方式、業(yè)務(wù)種類、數(shù)據(jù)速率與格式、控制協(xié)議等都可以進(jìn)行重構(gòu)和控制，選用不同的軟件模塊就可以實現(xiàn)不同類型和功能的無線電臺，其核心思想是在盡可能靠近天線的地方使用寬帶A/D和D/A變換器，并盡可能地用軟件來定義無線功能[1]。
  • 關(guān)鍵字： FPGA  無線電  

基于FPGA的軟件無線電平臺設(shè)計

  • 　　軟件無線電的出現(xiàn)，是無線電通信從模擬到數(shù)字、從固定到移動后，由硬件到軟件的第三次變革。簡單地說，軟件無線電就是一種基于通用硬件平臺，并通 過軟件可提供多種服務(wù)的、適應(yīng)多種標(biāo)準(zhǔn)的、多頻帶多模式的、可重構(gòu)可編程的無線電系統(tǒng)。軟件無線電的關(guān)鍵思想是，將AD(DA)盡可能靠近天線和用軟件來 完成盡可能多的無線電功能。 　　蜂窩移動通信系統(tǒng)已經(jīng)發(fā)展到第三代，3G系統(tǒng)進(jìn)入商業(yè)運行一方面需要解決不同標(biāo)準(zhǔn)的系統(tǒng)間的兼容性;另一方 面要求系統(tǒng)具有高度的靈活性和擴(kuò)展升級能力，軟件無線電技術(shù)無疑是最好的解決方案。用ASI
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【從零開始走進(jìn)FPGA】對立統(tǒng)一——異步時鐘同步化

  • 　　一、什么是對立統(tǒng)一 　　什么是CEO，就是首席執(zhí)行官，是在一個企業(yè)中負(fù)責(zé)日常經(jīng)營管理的最高級管理人員，又稱作行政總裁，或最高執(zhí)行長或大班。 　　那么，在FPGA系統(tǒng)，需不需要一個最高級別的執(zhí)行官，來管理所有進(jìn)程呢?為了系統(tǒng)的有序性，不至于凌亂、崩潰，答案必然是肯定的。 　　誰都知道，F(xiàn)PGA內(nèi)部時序邏輯的工作，是通過時鐘的配合來完成任務(wù)的。那么當(dāng)系統(tǒng)中有異步時鐘的時候，怎么辦?每一個系統(tǒng)必須有一個最高級別的時鐘，執(zhí)行力最強;同時它擔(dān)任著管理異步時鐘的任務(wù)，其它異步時鐘想讓手下執(zhí)行任務(wù)，必須告訴執(zhí)
  • 關(guān)鍵字： FPGA  異步時鐘  
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