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LZW改進(jìn)壓縮算法的FPGA實(shí)現(xiàn)
- 隨著實(shí)時(shí)監(jiān)控系統(tǒng)的發(fā)展,大容量高速數(shù)據(jù)采集與傳輸技術(shù)不斷取得新的進(jìn)展,針對(duì)當(dāng)前數(shù)據(jù)傳輸采用硬件實(shí)現(xiàn)速度快,但難以進(jìn)行數(shù)據(jù)處理,而軟件能實(shí)現(xiàn)很多算法但處理速度稍顯遜色的不足,采用了LZW壓縮算法及其改進(jìn)算法,并將該算法在可編程邏輯器件FPGA上進(jìn)行了實(shí)現(xiàn),通過(guò)仿真,驗(yàn)證了設(shè)計(jì)的正確性,提高了數(shù)據(jù)傳輸速度。
- 關(guān)鍵字: FPGA LZW 壓縮算法
航管二次雷達(dá)射頻切換單元FPGA實(shí)現(xiàn)
- 為適應(yīng)中國(guó)民航對(duì)單脈沖二次雷達(dá)的雙機(jī)熱備份功能要求,采用現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA),并使用硬件描述語(yǔ)言對(duì)可擦除可編程邏輯器件(EPLD)進(jìn)行編程控制,以實(shí)現(xiàn)單脈沖二次雷達(dá)切換單元的主要功能:響應(yīng)監(jiān)控系統(tǒng)的切換命令,當(dāng)設(shè)備故障時(shí)自動(dòng)或者手動(dòng)地切換到非故障機(jī)柜,使雷達(dá)連續(xù)地輸出航跡數(shù)據(jù)?,F(xiàn)場(chǎng)可編程門(mén)陣列的運(yùn)用增強(qiáng)了射頻切換單元控制的靈活性與可靠性,大大提高系統(tǒng)的檢測(cè)性能與處理性能。
- 關(guān)鍵字: FPGA 實(shí)現(xiàn) 單元 切換 雷達(dá) 射頻 航管
基于FPGA的LED大屏幕控制系統(tǒng)設(shè)計(jì)
- 摘要:介紹LED顯示屏的工作原理,提出大屏幕LED圖文顯示屏控制系統(tǒng)MCU+FPGA的設(shè)計(jì)方案。單片機(jī)系統(tǒng)負(fù)責(zé)接收和存儲(chǔ)上位機(jī)LED點(diǎn)陣數(shù)據(jù),F(xiàn)PGA控制器完成顯示數(shù)據(jù)的轉(zhuǎn)換、動(dòng)態(tài)掃描并驅(qū)動(dòng)大屏幕LED顯示屏。FPGA控制器由VH
- 關(guān)鍵字: 控制系統(tǒng) 設(shè)計(jì) 大屏幕 LED FPGA 基于
基于FPGA的高效FIR濾波器設(shè)計(jì)與實(shí)現(xiàn)
- 摘要: 給出了一種基于FPGA的數(shù)字濾波器的設(shè)計(jì)方法。該方法先通過(guò)MATLAB設(shè)計(jì)出一個(gè)具有具體指標(biāo)的FIR濾波器, 再對(duì)濾波器系數(shù)進(jìn)行處理, 使之便于在FPGA中實(shí)現(xiàn), 然后采用基于分布式算法和CSD編碼的濾波器結(jié)構(gòu)進(jìn)
- 關(guān)鍵字: FPGA FIR 濾波器設(shè)計(jì)
Microsemi發(fā)布可再生能源應(yīng)用產(chǎn)品
- 美高森美公司(Microsemi) 發(fā)布可再生能源應(yīng)用的產(chǎn)品,包括SmartFusion和IGLOO FPGA;模擬及混合信號(hào)器件如旁路二極管/開(kāi)關(guān)、MOSFET、FRED和IGBT;DC-DC轉(zhuǎn)換器,以及脈寬調(diào)制(PWM)模塊。這一種類(lèi)豐富的產(chǎn)品系列能夠在整個(gè)范圍的光伏(PV)應(yīng)用中實(shí)現(xiàn)高效、可靠且具有成本效益的解決方案,包括獲取電能、功率管理、功率開(kāi)關(guān)和功率監(jiān)控?!?/li>
- 關(guān)鍵字: Microsemi 太陽(yáng)能 FPGA
基于FPGA+DSP的多串口數(shù)據(jù)通信的實(shí)現(xiàn)
- 摘要: 串口傳輸常用于基于FPGA和DSP結(jié)構(gòu)的信號(hào)處理板和外部設(shè)備之間的數(shù)據(jù)交換。以GPS RTK定位應(yīng)用為基礎(chǔ),針對(duì)單個(gè)串口全雙工傳輸不足以應(yīng)對(duì)多種數(shù)據(jù)類(lèi)型同時(shí)輸入輸出的情形,設(shè)計(jì)并實(shí)現(xiàn)了一種面向多串口不同類(lèi)型
- 關(guān)鍵字: 數(shù)據(jù)通信 實(shí)現(xiàn) 串口 DSP FPGA 基于
基于FPGA的高精度信號(hào)源的設(shè)計(jì)
- 摘要:為進(jìn)行高精度信號(hào)源的設(shè)計(jì),同時(shí)降低設(shè)計(jì)成本,以CyclONe II系列低端FPGA為核心,利用直接頻率合成技術(shù),對(duì)正弦信號(hào)等數(shù)據(jù)進(jìn)行1/4周期壓縮存儲(chǔ)到ROM中,在外部時(shí)鐘頻率為50 MHz,實(shí)現(xiàn)了正弦信號(hào)源的設(shè)計(jì),同時(shí)
- 關(guān)鍵字: FPGA 高精度信號(hào)源
基于FPGA的IEEE-1394b雙向數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì)
- 隨著IEEE Std 1394-1995技術(shù)的高速發(fā)展,IEEE 1394已經(jīng)成為眾多電子設(shè)備基本的外部接口。然而,要進(jìn)一步擴(kuò)展它的適用領(lǐng)域,就必須克服其接口被限制工作在較短距離以及不適用于較高數(shù)據(jù)傳輸率的缺陷。IEEE Std 1394
- 關(guān)鍵字: FPGA 1394 IEEE 數(shù)據(jù)傳輸
基于FPGA的部分響應(yīng)CPM信號(hào)解調(diào)器的設(shè)計(jì)
- 在現(xiàn)有的民用、軍用通信系統(tǒng)的眾多應(yīng)用領(lǐng)域中,為了實(shí)現(xiàn)高速率數(shù)據(jù)傳輸,提高頻譜利用率,必須采用帶寬效率更高的編碼、調(diào)制技術(shù)。在眾多的調(diào)制方式中,連續(xù)相位調(diào)制信號(hào)(CPM 信號(hào))具有恒包絡(luò)特性,它用于承載信息
- 關(guān)鍵字: FPGA CPM 信號(hào)解調(diào)器
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