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基于CPLD/FPGA的半整數(shù)分頻器的設(shè)計(jì)實(shí)例

  • 1引言CPLD（ComplexprogrammableLogicDevice，復(fù)雜可編程邏輯器件）和FPGA（FieldprogrammableGatesArray...
  • 關(guān)鍵字： CPLD  FPGA  半整數(shù)分頻器  

非晶硅反熔絲FPGA提升系統(tǒng)可靠性

  • 　現(xiàn)場可編程門陣列（FPGA）技術(shù)因其提供的設(shè)計(jì)靈活性,已為系統(tǒng)設(shè)計(jì)人員廣泛采用。非晶硅反熔絲FPGA技術(shù)尤其有用,它可以提供一種高電路密度與低功耗,以及非易失性編程和高可靠性的組合。為了充分發(fā)揮其可靠性,FPGA廠
  • 關(guān)鍵字： FPGA  非晶硅  反熔絲  系統(tǒng)    

基于FPGA的915MHz射頻讀卡器設(shè)計(jì)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： FPGA  915MHz  射頻讀卡器  RFID  

基于麥克風(fēng)陣列聲源定位系統(tǒng)的FPGA實(shí)現(xiàn)

  • 摘要：論述了基于麥克風(fēng)陣列的聲源定位技術(shù)的基本原理，給出了利用FPGA實(shí)現(xiàn)系統(tǒng)各模塊的設(shè)計(jì)方法。重點(diǎn)介紹了其原理和模塊的電路實(shí)現(xiàn)，給出的基于FPGA設(shè)計(jì)實(shí)驗(yàn)結(jié)果表明，系統(tǒng)最大限度發(fā)揮了FPGA的優(yōu)勢、簡化了系統(tǒng)設(shè)
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FSK／PSK調(diào)制的FPGA實(shí)現(xiàn)

  • 摘要：基于DDS和VHDL硬件描述技術(shù)，采用大規(guī)?？删幊涕T陣列FPGA，實(shí)現(xiàn)了FSK和PSK數(shù)字調(diào)制。介紹了m偽隨機(jī)基帶碼元發(fā)生器、跳變檢測器和DDS信號(hào)發(fā)生等模塊。系統(tǒng)參數(shù)易修改、可移植性強(qiáng)、性能穩(wěn)定。
    關(guān)鍵詞：FSK／PS
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基于HyperLynx的FPGA系統(tǒng)信號(hào)完整性仿真分析

  • 摘要：針對目前高速電路發(fā)展帶來的信號(hào)完整性問題，在分析信號(hào)完整性要求的基礎(chǔ)上，借助HyperLynx仿真軟件，通過器件IBIS模型，對基于EP2C8和TMS320F2812組成的系統(tǒng)進(jìn)行信號(hào)完整性分析和仿真?；诜瓷湓韥斫榻B減少
  • 關(guān)鍵字： HyperLynx  FPGA  系統(tǒng)  仿真分析    

基于FPGA的二值圖像連通域快速標(biāo)記

  • 摘要：針對連通域標(biāo)記算法運(yùn)算量大、速度慢、硬件實(shí)現(xiàn)困難的缺點(diǎn)，提出一種適于現(xiàn)場可編程邏輯門陣列(FPGA)實(shí)現(xiàn)的二值圖像連通域快速標(biāo)記的算法，并用VHDL硬件開發(fā)語言在XILINX公司的FPGA上實(shí)現(xiàn)。實(shí)驗(yàn)結(jié)果表明了該算
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走向成熟的智能數(shù)字視頻監(jiān)控

  • 　　摘要：視頻監(jiān)控技術(shù)伴隨著“平安中國”的暢想以及北京奧運(yùn)會(huì)和上海世博會(huì)等大型活動(dòng)的順利舉辦，成為近期備受關(guān)注的電子技術(shù)應(yīng)用領(lǐng)域。作為智能數(shù)字視頻核心的半導(dǎo)體器件，在智能監(jiān)控技術(shù)的普及中占據(jù)著極為重要的地位，本文通過多個(gè)角度，解析數(shù)字視頻監(jiān)控發(fā)展趨勢及其對半導(dǎo)體產(chǎn)品的需求。 　　關(guān)鍵詞：視頻監(jiān)控;傳感器;DSP;FPGA 　　對于每個(gè)人而言，平安是幸福生活最基本的要素之一，而如何保障平安生活，無疑需要時(shí)刻有一雙慧眼的保護(hù)。無論是生活安全的監(jiān)控、突發(fā)事件的預(yù)警、交通違章情況和流量
  • 關(guān)鍵字： 視頻監(jiān)控  DSP  FPGA  201105  

基于FPGA的SPI總線在軟件接收機(jī)上的應(yīng)用

  • 摘要：在軟件接收機(jī)的研究中，為了實(shí)現(xiàn)在GPS或者北斗模式下基帶對射頻前端數(shù)據(jù)的采集，在Altera公司的CycloneⅢ系列FPGA器件上采用VERILOG語言編寫了SPI總線協(xié)議，完成了對射頻前端芯片GPS／北斗兩種工作模式的切換，
  • 關(guān)鍵字： FPGA  SPI  總線  軟件接收機(jī)    

基于FPGA的電臺(tái)接口轉(zhuǎn)換模塊設(shè)計(jì)

  • 摘要：目前市場上電臺(tái)接口轉(zhuǎn)換模塊大多都采用模擬電路，其帶來穩(wěn)定性差，工藝復(fù)雜等缺陷。通過采用數(shù)字信號(hào)處理技術(shù)來處理信號(hào)通信，提高信號(hào)的傳輸速率和降低傳輸?shù)恼`碼率，并提高系統(tǒng)的穩(wěn)定性，節(jié)省信道資源。這
  • 關(guān)鍵字： FPGA  電臺(tái)  接口轉(zhuǎn)換  模塊設(shè)計(jì)    

基于FPGA的多功能密碼鎖的設(shè)計(jì)

  • 摘要：本文設(shè)計(jì)的基于FPGA的電子密碼鎖，具有記憶和修改6位密碼、輸入密碼位數(shù)指示及防止多次試探密碼等功能，與銀行卡的原理和功能極其相似，使得密碼鎖的保密和安全性能進(jìn)一步增強(qiáng)。最后，給出了在Quartus II軟件
  • 關(guān)鍵字： FPGA  多功能  密碼鎖    

基于FPGA的FIR濾波器設(shè)計(jì)與仿真

  • 摘要：FIR數(shù)字濾波器以其良好的線性相位特性被廣泛使用，屬于數(shù)字信號(hào)處理的基本模塊之一。FPGA具有的靈活的可編程邏輯可以方便地實(shí)現(xiàn)高速數(shù)字信號(hào)處理。為了提高實(shí)時(shí)數(shù)字信號(hào)處理的速度，利用FPGA芯片內(nèi)部的ROM實(shí)現(xiàn)
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基于DDS技術(shù)三相功率可控PWM信號(hào)的FPGA實(shí)現(xiàn)

  • 摘要：本文利用FPGA和DDS技術(shù)實(shí)現(xiàn)了高精度、高分辨率的三相PWM脈沖信號(hào)，并通過AGC程控放大技術(shù)實(shí)現(xiàn)對PWM信號(hào)的功率可控。本設(shè)計(jì)具有控制靈活，輸出頻率穩(wěn)定和范圍寬等優(yōu)點(diǎn)，具有廣闊的應(yīng)用價(jià)值。
    關(guān)鍵詞：現(xiàn)場可
  • 關(guān)鍵字： FPGA  DDS  PWM  三相功率    

基于Nios II的過程控制實(shí)驗(yàn)裝置研究

  • 基于Nios II的過程控制實(shí)驗(yàn)裝置研究,利用SOPC強(qiáng)大的IP核和容易配置的優(yōu)勢簡化設(shè)計(jì)流程。充分發(fā)揮NiosⅡ強(qiáng)大的并行處理能力。該系統(tǒng)主要涉及多個(gè)下位機(jī)與FPGA的通信問題?！　?. 功能描述　　1.1 整體設(shè)計(jì)思路　　利用SOPC強(qiáng)大的IP核和容易配置的優(yōu)勢簡化
  • 關(guān)鍵字： 實(shí)驗(yàn)  裝置  研究  控制  過程  Nios  II  基于  

基于Nios II的UART與PC間的數(shù)據(jù)通信

  • 基于Nios II的UART與PC間的數(shù)據(jù)通信,Nios II系列嵌入式處理器使用32位的指令集結(jié)構(gòu)ISA，完全與二進(jìn)制代碼兼容，它是Altera公司的第二代軟核嵌入式處理器，性能超過200DMIPS。允許設(shè)計(jì)者在很短的時(shí)間內(nèi)構(gòu)建一個(gè)完整的可編程芯片系統(tǒng)，風(fēng)險(xiǎn)和成本比中小規(guī)
  • 關(guān)鍵字： PC  數(shù)據(jù)通信  UART  II  Nios  基于  
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